[发明专利]基板处理方法及基板处理系统在审
申请号: | 201911358613.1 | 申请日: | 2019-12-25 |
公开(公告)号: | CN111383910A | 公开(公告)日: | 2020-07-07 |
发明(设计)人: | 浅子竜一 | 申请(专利权)人: | 东京毅力科创株式会社 |
主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L21/311;H01J37/32 |
代理公司: | 北京品源专利代理有限公司 11332 | 代理人: | 吕琳;朴秀玉 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 处理 方法 系统 | ||
提供一种基板处理方法,其能够解决针对基板选择性地进行成膜、以及抑制成膜后的金属残留中的至少一个问题。该基板处理方法包括:提供基板的工序;向所述基板上供给用于与所述基板化学键结的单体的工序;以及向供给有所述单体的所述基板上,供给用于使所述单体聚合的引发剂,并形成聚合物的膜的工序。
技术领域
本公开涉及一种基板处理方法及基板处理系统。
背景技术
在半导体装置的制造工序中,为了形成用于构成装置的元件及布线等,进行用于在半导体晶片等基板上形成聚合物的膜的成膜处理。作为这种成膜处理的方法之一,存在一种方法,其在将用于使单体聚合的氧化剂预先涂布或使该氧化剂吸附在基板上的状态下,向基板上供给单体,并在基板上使各个单体气相沉积聚合,从而在基板表面进行聚合物膜的成膜(例如参见专利文献1及专利文献2)。
现有技术文献
专利文献
专利文献1:(日本)特开平10-53651号公报
专利文献2:(日本)特表2010-533219号公报
发明内容
本发明要解决的问题
本公开的目的在于提供一种基板处理方法,其能够解决针对基板选择性地进行成膜、以及抑制成膜后的金属残留中的至少一个问题。
用于解决问题的手段
为了解决上述问题,根据本公开的一个实施方式,提供一种基板处理方法,包括:提供基板的工序;向所述基板上供给用于与所述基板化学键结的单体的工序;以及向供给有所述单体的所述基板上,供给用于使所述单体聚合的引发剂,并形成聚合物的膜的工序。
发明的效果
根据本公开的一个实施方式,能够提供一种基板处理方法,其能够解决针对基板选择性地进行成膜、以及抑制成膜后的金属残留中的至少一个问题。
附图说明
图1是示出本公开中的基板处理方法的第1实施方式的工序图。
图2是示出本公开中的基板处理方法的第2实施方式的工序图。
图3是示出本公开中的基板处理方法的第3实施方式的工序图。
图4(a)~图4(e)是利用本公开中的基板处理方法针对具有2个区域的基板进行聚合物的成膜的情况的示意图。
图5(a)~图5(e)是利用本公开中的基板处理方法针对具有1个区域的基板进行聚合物的成膜的情况的示意图。
图6是示出本公开中的基板处理系统的实施方式的基板处理装置的剖面图。
图7是示出本公开中的基板处理系统中的各成分供给的时间的图。
图8是利用本公开中的基板处理系统所蚀刻的基板的剖面图。
图9是图8的基板中的一部分被蚀刻的基板的剖面图。
图10是在图9的基板中的露出的部分处形成有保护膜的基板的剖面图。
图11是图10的基板中一部分进一步被蚀刻的基板的剖面图。
图12是在图11的基板中进一步露出的部分处形成有保护膜的基板的剖面图。
图13是图12的基板中的一部分进一步被蚀刻的基板的剖面图。
图14是利用本公开中的基板处理系统将保护膜去除的基板的剖面图。
图15是用于对本公开中的基板处理方法进行评价的测量用的基板处理装置的概要图。
具体实施方式
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造