[发明专利]一种延迟电路及芯片在审
申请号: | 201911142942.2 | 申请日: | 2019-11-20 |
公开(公告)号: | CN112825479A | 公开(公告)日: | 2021-05-21 |
发明(设计)人: | 朱长峰;刘从振 | 申请(专利权)人: | 合肥格易集成电路有限公司;北京兆易创新科技股份有限公司;上海格易电子有限公司 |
主分类号: | H03K5/134 | 分类号: | H03K5/134;H03K5/00 |
代理公司: | 北京品源专利代理有限公司 11332 | 代理人: | 孟金喆 |
地址: | 230601 安徽省*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 一种 延迟 电路 芯片 | ||
1.一种延迟电路,其特征在于,包括:延迟装置和控制装置;
所述控制装置的第一控制输入端与所述延迟装置的信号检测端相连,第二控制输入端与所述延迟装置的输入端相连后接收输入信号,控制输出端与延迟装置的信号控制端相连;
所述控制装置,用于当所述第一控制输入端检测的第一电压信号到达所述控制装置的第一翻转电压时,根据所述输入信号调整向所述信号控制端输出的控制信号,其中,所述第一翻转电压大于所述延迟装置输出端的第二翻转电压;
所述延迟装置,用于基于所述控制信号和所述输入信号调整所述第一电压信号,并基于调整后的第一电压信号和所述第二翻转电压延迟输出所述输入信号。
2.根据权利要求1所述的延迟电路,其特征在于,所述控制装置,包括:
由与非门构成的第一RS触发器;
所述第一RS触发器的复位输入端与所述信号检测端相连,置位输入端接收所述输入信号,Q非输出端与所述信号控制端相连或Q输出端经过第一反相器与所述信号控制端相连。
3.根据权利要求2所述的延迟电路,其特征在于,所述控制装置,还包括:
第二反相器和第三反相器;
所述第二反相器的输入端与所述信号检测端相连,所述第二反相器的输出端与所述第三反相器的输入端相连,所述第三反相器的输出端与所述复位输入端相连。
4.根据权利要求1所述的延迟电路,其特征在于,所述控制装置,包括:
由或非门构成的第二RS触发器、第四反相器和第五反相器;
所述第四反相器的输入端与所述信号检测端相连,所述第四反相器的输出端与所述第二RS触发器的复位输入端相连,所述第五反相器的输入端接收所述输入信号,所述第五反相器的输出端连接所述第二RS触发器的置位输入端,所述第二RS触发器的输出端与所述信号控制端相连。
5.根据权利要求1-4任一所述的延迟电路,其特征在于,所述延迟装置为RC延迟装置。
6.根据权利要求5所述的延迟电路,其特征在于,所述RC延迟装置包括:输入反相器、输出反相器、电阻和电容;
所述输入反相器的输入端与所述第二控制输入端相连,所述输入反相器的输出端与所述电阻的一端相连,所述电阻的另一端分别与所述电容的一端、所述第一控制输入端和所述输出反相器的输入端相连,所述电容的另一端与所述控制输出端相连。
7.根据权利要求6所述的延迟电路,其特征在于,所述输入反相器,用于根据所述输入信号调整所述电阻的一端的第二电压信号;
所述电阻和所述电容基于所述第二电压信号和所述控制信号,调整所述第一电压信号。
8.根据权利要求1所述的延迟电路,其特征在于,所述延迟电路上升沿的延迟时间通过改变所述第一翻转电压和所述第一电压信号被推高到的电压来调节。
9.根据权利要求1所述的延迟电路,其特征在于,所述延迟电路下降沿的延迟时间为所述第一电压信号由负电压上升到所述第二翻转电压的时间。
10.根据权利要求1所述的延迟电路,其特征在于,所述延迟电路的等效电容根据所述第一翻转电压和所述第二翻转电压确定。
11.一种芯片,其特征在于,包括:如权利要求1-10中任一所述的延迟电路。
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