[发明专利]三维存储器件及其制作方法有效
申请号: | 201880005575.9 | 申请日: | 2018-03-02 |
公开(公告)号: | CN110140213B | 公开(公告)日: | 2020-06-26 |
发明(设计)人: | 朱继锋;吕震宇;陈俊;胡禺石;陶谦;S·S-N·杨;S·W·杨 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11578 | 分类号: | H01L27/11578;H01L27/1157;H01L27/11551 |
代理公司: | 北京永新同创知识产权代理有限公司 11376 | 代理人: | 刘健;张殿慧 |
地址: | 430074 湖北省武汉市东湖*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 三维 存储 器件 及其 制作方法 | ||
1.一种NAND存储器件,包括:
衬底;
在所述衬底上的多个NAND串;
在所述多个NAND串上方的一个或多个外围器件;
在所述一个或多个外围器件上方的单晶硅层;
在所述一个或多个外围器件与所述多个NAND串之间的一个或多个第一互连层;以及
在所述单晶硅层上方的第二互连层。
2.根据权利要求1所述的NAND存储器件,其中,所述一个或多个外围器件包括一个或多个MOSFET器件。
3.根据权利要求1或2所述的NAND存储器件,还包括导体/介电质交替堆叠,其中,所述NAND串中的每个NAND串包括:
垂直延伸贯穿所述导体/介电质交替堆叠的半导体沟道;
在所述导体/介电质交替堆叠与所述半导体沟道之间的穿隧层;以及
在所述穿隧层与所述导体/介电质交替堆叠之间的储存层。
4.根据权利要求3所述的NAND存储器件,还包括第一触点,其中,所述第一触点垂直延伸贯穿所述导体/介电质交替堆叠,并且包括与所述衬底相接触的下端。
5.根据权利要求1所述的NAND存储器件,其中,所述第二互连层包括形成在一个或多个介电质层中的一层或多层的导体层。
6.根据权利要求1所述的NAND存储器件,其中,所述多个NAND串包括在另一NAND串上方的NAND串。
7.根据权利要求6所述的NAND存储器件,其中,所述NAND串是通过导体电连接到所述另一NAND串的。
8.根据权利要求1所述的NAND存储器件,还包括贯穿硅触点,其中所述贯穿硅触点垂直延伸贯穿所述单晶硅层,并且其中,所述贯穿硅触点在所述贯穿硅触点的一端上与所述一个或多个第一互连层中的互连层电连接。
9.一种用于形成NAND存储器件的方法,包括:
在第一衬底上形成多个NAND串;
在第二衬底上形成一个或多个外围器件;
将所述一个或多个外围器件放置在所述多个NAND串上方,其中,所述第二衬底位于所述一个或多个外围器件上方;
连结所述多个NAND串和所述一个或多个外围器件;
薄化所述第二衬底,以使经薄化的第二衬底用作在所述多个外围器件上方的单晶硅层;以及
在所述单晶硅层上形成BEOL互连层。
10.根据权利要求9所述的方法,还包括形成多个第一触点,其中,所述多个第一触点中的每个第一触点垂直延伸,并且包括与所述第一衬底相接触的一端。
11.根据权利要求9或10所述的方法,还包括:在所述连结所述多个NAND串和所述一个或多个外围器件之前,形成针对所述多个NAND串的第一互连层。
12.根据权利要求9所述的方法,还包括:在所述连结所述多个NAND串和所述一个或多个外围器件之前,形成针对所述一个或多个外围器件的第二互连层。
13.根据权利要求9所述的方法,其中,所述连结包括经由热处理进行连结。
14.根据权利要求9所述的方法,其中,所述连结包括经由等离子处理进行连结。
15.根据权利要求9所述的方法,其中,所述连结包括经由湿工艺处理进行连结。
16.根据权利要求9所述的方法,其中,形成所述NAND串包括在所述第一衬底上形成导体/介电质交替堆叠。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的