[发明专利]半导体系统有效
申请号: | 201811345600.6 | 申请日: | 2018-11-13 |
公开(公告)号: | CN110246528B | 公开(公告)日: | 2023-04-18 |
发明(设计)人: | 宋根洙 | 申请(专利权)人: | 爱思开海力士有限公司 |
主分类号: | G11C7/22 | 分类号: | G11C7/22 |
代理公司: | 北京三友知识产权代理有限公司 11127 | 代理人: | 刘久亮;黄纶伟 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 半导体 系统 | ||
1.一种半导体系统,该半导体系统包括:
第一半导体装置,该第一半导体装置被配置为输出时钟信号、选通信号和模式信息信号,并且根据检测信号来检测所述时钟信号与所述选通信号的相位差;以及
第二半导体装置,该第二半导体装置被配置为基于所述模式信息信号来将所述选通信号或所述时钟信号中的至少一个设定为用于检测所述时钟信号与所述选通信号的相位差以生成所述检测信号的基准,并且
其中,所述第二半导体装置根据所述模式信息信号而将所述选通信号或所述时钟信号切换为所述基准。
2.根据权利要求1所述的半导体系统,其中,根据所述模式信息信号,与所述时钟信号的边沿同步地从所述选通信号生成所述检测信号,或者与所述选通信号的边沿同步地从所述时钟信号生成所述检测信号。
3.根据权利要求1所述的半导体系统,其中,所述第一半导体装置通过检测所述检测信号的逻辑电平来调节所述时钟信号与所述选通信号的相位差。
4.根据权利要求3所述的半导体系统,其中,当所述检测信号具有第一逻辑电平时,所述检测信号指示所述选通信号的相位早于所述时钟信号的相位,并且当所述检测信号具有第二逻辑电平时,所述检测信号指示所述选通信号的相位晚于所述时钟信号的相位。
5.根据权利要求1所述的半导体系统,其中,所述第二半导体装置通过根据所述模式信息信号将所述检测信号的逻辑电平反相或非反相来输出所述检测信号。
6.根据权利要求1所述的半导体系统,其中,所述第二半导体装置包括:
分频电路,该分频电路被配置为通过对所述选通信号的频率进行分频来生成第一内部选通信号至第四内部选通信号;
模式信号发生电路,该模式信号发生电路被配置为通过将所述模式信息信号解码来生成第一模式信号、第二模式信号和第三模式信号;以及
相位差检测电路,该相位差检测电路被配置为通过基于所述第一模式信号、所述第二模式信号和所述第三模式信号对所述时钟信号的相位与所述第一内部选通信号至所述第四内部选通信号当中的任一个的相位进行比较来生成所述检测信号。
7.根据权利要求6所述的半导体系统,其中,所述相位差检测电路包括:
输入电路,该输入电路被配置为通过对所述时钟信号进行缓冲来生成内部时钟信号,并且基于所述第一模式信号输出所述第一内部选通信号至所述第四内部选通信号当中的任一个作为所选选通信号;
传输信号发生电路,该传输信号发生电路被配置为基于所述第二模式信号,与所述所选选通信号的边沿同步输出所述内部时钟信号作为时钟传输信号并与所述内部时钟信号的边沿同步输出所述所选选通信号作为选通传输信号;以及
检测信号发生电路,该检测信号发生电路被配置为基于所述第三模式信号,输出所述时钟传输信号和所述选通传输信号中的任一个作为所述检测信号。
8.根据权利要求7所述的半导体系统,其中,所述输入电路包括:
内部时钟发生电路,该内部时钟发生电路被配置为通过对所述时钟信号与所述时钟信号的反相信号进行比较来生成所述内部时钟信号;以及
选择性传输电路,该选择性传输电路被配置为基于所述第一模式信号输出所述第一内部选通信号至所述第四内部选通信号当中的任一个作为所述所选选通信号。
9.根据权利要求7所述的半导体系统,其中,所述传输信号发生电路包括:
锁存电路,该锁存电路被配置为通过与所述所选选通信号的边沿同步锁存所述内部时钟信号来生成第一锁存信号,并且通过与所述内部时钟信号的边沿同步锁存所述所选选通信号来生成第二锁存信号;以及
传输电路,该传输电路被配置为基于所述第二模式信号,通过将所述第一锁存信号反相或非反相来输出所述时钟传输信号并通过将所述第二锁存信号反相或非反相来输出所述选通传输信号。
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