[发明专利]3D NAND闪存的接触窗形成方法及接触窗结构有效
申请号: | 201710726107.8 | 申请日: | 2017-08-22 |
公开(公告)号: | CN107731829B | 公开(公告)日: | 2019-04-16 |
发明(设计)人: | 宋豪杰;徐强;蓝天;夏志良;霍宗亮 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11524 | 分类号: | H01L27/11524;H01L27/11551;H01L27/1157;H01L27/11578 |
代理公司: | 北京辰权知识产权代理有限公司 11619 | 代理人: | 佟林松 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | dnand 闪存 接触 形成 方法 结构 | ||
1.3D NAND闪存的接触窗形成方法,其特征在于,所述方法包括:
提供衬底,在衬底表面沉积介质层;
第一次刻蚀,形成贯穿介质层、并伸入衬底上部一定距离的第一接触孔洞;
生长,向第一接触孔洞内沉积氮化硅,使得第一接触孔洞的底壁和侧壁生成氮化硅内墙,保证在沉积氮化硅过程中,介质层表面不产生或仅产生厚度为4nm以下的多余氮化硅;
第二次刻蚀,保证第二次刻蚀的方法对氮化硅和介质层的材料具有高度的选择比,从而能够穿透介质层表面的多余氮化硅,并在介质层内部形成第二接触孔洞,同时不穿透氮化硅内墙,所述第二接触孔洞的深度小于所述第一接触孔洞的深度;
所述第二次刻蚀之后回刻,去除生长在第一接触孔洞的底壁的氮化硅,形成在第一接触孔洞侧壁生长的氮化硅侧墙;以及
钨插塞-化学机械抛光,在第一接触孔洞和第二接触孔洞内沉积钨,并进行化学机械抛光,去除介质层表面沉积的微量氮化硅和钨,形成第一接触窗和第二接触窗。
2.如权利要求1所述的接触窗形成方法,其特征在于,
氮化硅侧墙的厚度大于60埃,且位于第一接触孔洞内的氮化硅侧墙的顶端厚度和底端厚度的比值(S/C)大于75%。
3.如权利要求1所述的接触窗形成方法,其特征在于,
第一接触孔洞的底部关键尺寸大于100nm,第一接触孔洞的顶部关键尺寸大于150nm。
4.如权利要求1所述的接触窗形成方法,其特征在于,
介质层的成份为二氧化硅。
5.如权利要求1所述的接触窗形成方法,其特征在于,
第一接触孔洞位于3D NAND闪存的外围电路区域,第二接触孔洞位于3D NAND闪存的核心存储区域,第二接触孔洞位于介质层的内部,并与位于介质层内部的钨引线连通。
6.如权利要求1~5任一所述的形成方法形成的接触窗结构,其特征在于,包括
内部设有金属钨插塞的所述第一接触孔洞,所述第一接触孔洞位于3D NAND闪存的外围电路区域;以及
内部设有金属钨插塞的所述第二接触孔洞,所述第二接触孔洞位于3D NAND闪存的核心存储区域;
其中,所述第一接触孔洞的侧壁贴设有氮化硅内墙层,氮化硅内墙层的与所述第一接触孔洞的内壁相对的一侧与内部对应设置的金属钨插塞的外周贴合;所述第二接触孔洞的内壁与内部对应设置的金属钨插塞的外周贴合。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的