[发明专利]混合高速缓存在审
| 申请号: | 201680073767.4 | 申请日: | 2016-09-20 |
| 公开(公告)号: | CN108431786A | 公开(公告)日: | 2018-08-21 |
| 发明(设计)人: | 加百利尔·H·罗 | 申请(专利权)人: | 超威半导体公司 |
| 主分类号: | G06F12/0811 | 分类号: | G06F12/0811;G06F12/0846;G06F12/0871 |
| 代理公司: | 上海胜康律师事务所 31263 | 代理人: | 樊英如;张静 |
| 地址: | 美国加利*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 高速缓存 处理器 高速缓存命中率 处理器动态 多核处理器 应用程序 跟踪 | ||
1.一种处理器,其包括:
高速缓存;以及
控制单元;
其中所述控制单元被配置来将所述高速缓存划分为第一逻辑高速缓存和第二逻辑高速缓存,其中所述第一逻辑高速缓存代表高速缓存分级结构的第一级别,并且其中所述第二逻辑高速缓存代表所述高速缓存分级结构的第二级别。
2.如权利要求1所述的处理器,其中所述高速缓存的大小是固定的,所述第一逻辑高速缓存是二级(L2)高速缓存,并且所述第二逻辑高速缓存是三级(L3)高速缓存。
3.如权利要求1所述的处理器,其中所述控制单元进一步被配置来重新分配所述第一逻辑高速缓存与所述第二逻辑高速缓存之间的存储容量。
4.如权利要求1所述的处理器,其中所述处理器进一步被配置来响应于确定第一高速缓存度量大于第一阈值,修改所述第一逻辑高速缓存的大小并修改所述第二逻辑高速缓存的大小。
5.如权利要求1所述的处理器,其中所述处理器进一步被配置来:
从所述第二逻辑高速缓存的第一部分向存储器发送第一请求,其中所述第一请求以第一存储器地址为目标;
在将所述第一请求发送到存储器之后并且在接收来自存储器的第一填充数据之前,将所述第二逻辑高速缓存的所述第一部分重新分配给所述第一逻辑高速缓存,其中所述第一填充数据对应于所述第一请求;
在所述第一逻辑高速缓存处接收来自存储器的所述第一填充数据;
确定所述第一存储器地址已经重映射到所述第二逻辑高速缓存的第二部分,其中将所述第二逻辑高速缓存的所述第一部分重新分配给所述第一逻辑高速缓存导致所述第一存储器地址重映射到所述第二逻辑高速缓存的所述第二部分;并且
将所述第一填充数据从所述第一逻辑高速缓存转发到所述第二逻辑高速缓存的所述第二部分。
6.如权利要求1所述的处理器,其中所述处理器被配置来响应于从执行第一应用程序切换到执行第二应用程序,减小所述第一逻辑高速缓存的存储容量并增大所述第二逻辑高速缓存的存储容量。
7.如权利要求1所述的处理器,其中所述处理器进一步被配置来:
将所述第二逻辑高速缓存的第一路径重新分配给所述第一逻辑高速缓存;
识别存储在所述第二逻辑高速缓存的所述第一路径中的第一高速缓存行;并且
响应于将所述第一路径从所述第二逻辑高速缓存重新分配到所述所述第一逻辑高速缓存,使所述第一高速缓存行无效。
8.一种方法,其包括:
将高速缓存划分为第一逻辑高速缓存和第二逻辑高速缓存,其中所述第一逻辑高速缓存代表高速缓存分级结构的第一级别,并且其中所述第二逻辑高速缓存代表所述高速缓存分级结构的第二级别。
9.如权利要求8所述的方法,其中所述高速缓存的大小是固定的,所述第一逻辑高速缓存是二级(L2)高速缓存,并且所述第二逻辑高速缓存是三级(L3)高速缓存。
10.如权利要求8所述的方法,其还包括:
重新分配所述第一逻辑高速缓存与所述第二逻辑高速缓存之间的存储容量。
11.如权利要求8所述的方法,其还包括:
响应于确定第一高速缓存度量大于第一阈值,修改所述第一逻辑高速缓存的大小并修改所述第二逻辑高速缓存的大小。
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