专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]对偶向量算术逻辑单元-CN202180088732.9在审
  • 何斌;布莱恩·恩贝林;马克·莱瑟;迈克尔·曼特 - 超威半导体公司
  • 2021-12-13 - 2023-10-27 - G06T1/60
  • 本发明公开了一种处理系统(100),该处理系统在单个执行循环中在单指令多数据(SIMD)单元(230)的多个算术逻辑单元(ALU)流水线(232,234)处执行波前(302,304)。该ALU流水线各自包括多个ALU,该多个ALU对从向量通用处理寄存器(VGPR)库(510,511,512,513)收集在高速缓存(220)处的波前操作数执行指令(310,312,314)并且在缓冲器(235)处输出对该波前执行的该指令的结果。通过在该高速缓存处存储由该VGPR库供应的波前,可使较大数量的波前对该SIMD单元可用而不增加VGPR带宽,从而使得多个ALU流水线能够在单个执行循环期间执行指令。
  • 对偶向量算术逻辑单元
  • [发明专利]相邻处理器的光桥互连单元-CN202280020107.5在审
  • 罗伯特·E·拉德克;克里斯多夫·M·贾格尔 - 超威半导体公司
  • 2022-03-30 - 2023-10-27 - G06F13/38
  • 描述了用于在计算系统中进行高效数据传输的系统和方法。计算系统包括接收要处理的任务的多个节点。桥互连件在两个处理节点之间进行数据传输,而无需母板上的系统总线的帮助。计算系统的多个桥互连件中的一个桥互连件是光桥互连件,其通过两个节点之间的光桥互连件传输光信息。接收节点使用光子集成电路将光学信息转变成电信息,由电集成电路进行处理。基于诸如所测量的功率消耗和所测量的数据传输错误率等一个或多个因素,一个或多个节点在使用光桥互连件和非光桥互连件之间进行切换。
  • 相邻处理器互连单元
  • [发明专利]用于异构存储器系统的信令-CN202080090910.7有效
  • 詹姆斯·R·马格罗;凯达尔纳特·巴拉里斯南 - 超威半导体公司
  • 2020-12-10 - 2023-10-27 - G06F13/16
  • 一种存储器控制器通过异构存储器通道与非易失性存储类存储器(SCM)模块对接,并且包括用于接收存储器访问命令的命令队列。存储器接口队列耦合到命令队列以保存导出命令。非易失性命令队列耦合到命令队列以用于存储置于存储器接口队列中的非易失性读取命令。仲裁器从命令队列中选择条目,并将它们置于存储器接口队列中以在异构存储器通道上传输。控制电路耦合到异构存储器通道以用于从非易失性SCM模块接收就绪响应,所述就绪响应指示响应数据可用于非易失性读取命令,并且响应于接收到就绪响应,导致发送命令被置于存储器接口队列中以用于命令非易失性SCM模块发送响应数据。
  • 用于存储器系统
  • [发明专利]服务质量脏线跟踪-CN202080062569.4有效
  • 保罗·詹姆斯·莫耶;道格拉斯·班森·亨特 - 超威半导体公司
  • 2020-09-03 - 2023-10-24 - G06F12/0891
  • 公开了用于生成写入存储器带宽的测量结果的系统、设备和方法。控制单元监测对高速缓存层次结构的写入。如果对高速缓存行的写入是高速缓存行自进入高速缓存层次结构以来第一次被修改,则控制单元递增写入存储器带宽计数器。否则,如果写入的是自进入高速缓存层次结构以来已被修改的高速缓存行,则写入存储器带宽计数器不被递增。对高速缓存行的第一次写入是用于写入存储器带宽的代理,因为这将最终引起对存储器的写入。控制单元使用写入存储器带宽计数器的值来生成写入存储器带宽的测量结果。另外,控制单元可针对不同线程类维持多个计数器,以计算每个线程类的写入存储器带宽。
  • 服务质量跟踪
  • [发明专利]高速缓存访问测量偏斜校正-CN202080073396.6有效
  • 保罗·莫耶;约翰·凯利 - 超威半导体公司
  • 2020-10-29 - 2023-10-24 - G06F12/126
  • 一种处理器[101],包括高速缓存[110],所述高速缓存具有两个或更多个测试区域[115,116]和较大的非测试区域[118]。所述处理器还包括:高速缓存控制器[105],所述高速缓存控制器对所述高速缓存的不同测试区域应用不同的高速缓存替换策略[111,112];和性能监视器[104],所述性能监视器测量所述不同测试区域的性能指标,诸如每个测试区域处的高速缓存命中率。基于所述性能指标,所述高速缓存控制器为所述非测试区域选择高速缓存替换策略,诸如选择与所述不同测试区域中具有较好性能指标的测试区域相关联的替换策略。响应于对所述不同测试区域的访问量的差值超过阈值,所述处理器对存储器访问测量进行偏斜校正。
  • 高速缓存访问测量偏斜校正
  • [发明专利]用于压缩的高速缓存的弹性字典共享-CN202310734347.8在审
  • 亚历山大·布雷斯洛;约翰·卡拉马丁纳斯 - 超威半导体公司
  • 2020-08-19 - 2023-10-20 - G06F12/0864
  • 公开了用于实现用于高速缓存的弹性字典共享技术的系统、设备和方法。集合关联高速缓存包括用于每个数据阵列集合的字典。当要在高速缓存中分配高速缓存行时,高速缓存控制器确定高速缓存行地址的基本索引映射到哪个集合。然后,选择器单元确定由与该集合相邻的那些集合存储的一组字典中的哪个字典对于高速缓存行将实现最大压缩。然后选择该字典来压缩高速缓存行。将偏移添加到高速缓存行的基本索引以生成完整索引以便将高速缓存行映射到与该选定字典相对应的集合。压缩的高速缓存行与选定字典一起存储在该集合中,并且偏移存储在对应的标签阵列条目中。
  • 用于压缩高速缓存弹性字典共享
  • [发明专利]可变波阵面大小-CN201880006415.6有效
  • 迈克尔·J·曼托尔;布莱恩·D·恩贝林;马克·福勒 - 超威半导体公司
  • 2018-02-21 - 2023-10-13 - G06F9/30
  • 公开了用于在处理器上处理可变波阵面大小的系统、设备和方法。在一个实施方案中,处理器包括至少调度器、高速缓存和多个执行单元。当在第一模式下操作时,所述处理器在继续到着色器程序的下一指令之前在波阵面的多个部分执行相同的指令。当在第二模式下操作时,所述处理器在波阵面的第一部分执行一组指令。在所述第二模式中,当所述处理器在所述波阵面的所述第一部分完成该组指令的执行时,所述处理器在所述波阵面的第二部分执行该组指令,依此类推,直到所述波阵面的所有部分都已经被处理。所述处理器基于一个或多个条件来确定所述操作模式。
  • 可变波阵面大小
  • [发明专利]用于高速缓存替换策略的缩放集合竞争-CN201680085894.6有效
  • 保罗·詹姆斯·莫耶 - 超威半导体公司
  • 2016-09-20 - 2023-10-03 - G06F12/0811
  • 一种处理系统(100、300),包括高速缓存(300),所述高速缓存包括高速缓存线(315),所述高速缓存线被划分为所述高速缓存线的第一子集(320)和所述高速缓存线的第二子集(320)。所述处理系统还包括与所述高速缓存线的所述第二子集相关联的一个或多个计数器(330)。所述处理系统还包括处理器(305),所述处理器被配置为响应于与所述第二子集相关联的高速缓存命中或高速缓存未命中来修改所述一个或多个计数器。所述一个或多个计数器被修改一定量,所述量由生成所述高速缓存命中或所述高速缓存未命中的存储器访问请求的一个或多个特性来确定。
  • 用于高速缓存替换策略缩放集合竞争

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