[发明专利]MOS器件及其形成方法有效
申请号: | 201210454951.7 | 申请日: | 2012-11-13 |
公开(公告)号: | CN103811348B | 公开(公告)日: | 2018-03-09 |
发明(设计)人: | 张海洋;张城龙 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28;H01L29/78;H01L29/423 |
代理公司: | 北京集佳知识产权代理有限公司11227 | 代理人: | 骆苏华 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | mos 器件 及其 形成 方法 | ||
1.一种MOS器件的形成方法,其特征在于,包括:
提供半导体衬底;
在所述半导体衬底上形成伪栅结构,所述伪栅结构包括位于半导体衬底上的伪栅以及位于伪栅侧壁上的侧墙;
在所述伪栅结构两侧的半导体衬底内形成应力层;
在所述伪栅结构两侧的应力层和半导体衬底上形成层间介质层,所述层间介质层的上表面与伪栅结构的上表面齐平;
对所述伪栅和半导体衬底进行刻蚀,形成凹槽,所述凹槽的底面低于所述半导体衬底的上表面;
在所述凹槽内依次形成栅介质层和位于所述栅介质层上的栅极,所述栅极的上表面与所述层间介质层的上表面齐平,所述栅介质层的上表面低于半导体衬底的上表面或与半导体衬底的上表面持平,所述栅介质层位于应力层之间的半导体衬底内。
2.如权利要求1所述的MOS器件的形成方法,其特征在于,所述凹槽的底面距所述半导体衬底的上表面的距离为10埃~50埃。
3.如权利要求1或2所述的MOS器件的形成方法,其特征在于,所述栅介质层的上表面低于所述半导体衬底的上表面,或者所述栅介质层的上表面与所述半导体衬底的上表面持平,所述栅介质层的厚度为5埃~50埃。
4.如权利要求1所述的MOS器件的形成方法,其特征在于,形成凹槽的方法为干法刻蚀。
5.如权利要求1所述的MOS器件的形成方法,其特征在于,所述MOS器件为NMOS器件,所述应力层的材料为碳化硅。
6.如权利要求1所述的MOS器件的形成方法,其特征在于,所述MOS器件为PMOS器件,所述应力层的材料为锗硅。
7.如权利要求1所述的MOS器件的形成方法,其特征在于,在所述伪栅结构两侧的半导体衬底内形成应力层的方法包括:
在所述伪栅结构两侧的半导体衬底内形成开口;
通过外延生长工艺在所述开口内填充满应力层。
8.如权利要求1所述的MOS器件的形成方法,其特征在于,在所述半导体衬底上形成伪栅结构之前,还包括:在所述半导体衬底上形成氧化层。
9.一种MOS器件,其特征在于,包括:
半导体衬底;
栅极结构,所述栅极结构包括栅介质层、位于所述栅介质层上的栅极和位于所述栅极两侧半导体衬底上的侧壁,所述栅介质层位于半导体衬底内且其上表面低于所述半导体衬底的上表面,或者所述栅介质层的上表面与所述半导体衬底的上表面持平,所述栅介质层位于应力层之间的半导体衬底内,所述栅极的上表面高于所述半导体衬底的上表面;
应力层,位于所述栅极结构两侧的半导体衬底内。
10.如权利要求9所述的MOS器件,其特征在于,所述MOS器件为NMOS器件,所述应力层的材料为碳化硅。
11.如权利要求9所述的MOS器件,其特征在于,所述MOS器件为PMOS器件,所述应力层的材料为锗硅。
12.如权利要求9所述的MOS器件,其特征在于,所述栅介质层和位于半导体衬底内的栅极的厚度和为10埃~50埃。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造