[发明专利]半导体结构的形成方法有效
| 申请号: | 201210241509.6 | 申请日: | 2012-07-12 |
| 公开(公告)号: | CN103545246A | 公开(公告)日: | 2014-01-29 |
| 发明(设计)人: | 王文博 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
| 主分类号: | H01L21/768 | 分类号: | H01L21/768 |
| 代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 骆苏华 |
| 地址: | 201203 *** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 半导体 结构 形成 方法 | ||
1.一种半导体结构的形成方法,其特征在于,包括:
提供衬底,所述衬底包括第一区域和第二区域;
在所述衬底表面形成第一介质层;
在第一区域上方的第一介质层中形成贯穿所述第一介质层厚度的第一类插塞;
在所述第一介质层和第一介质层中第一类插塞表面形成第二介质层;
在第一区域上方形成贯穿所述第二介质层厚度、且与所述第一类插塞连接的第一类金属互连层;
在所述第二介质层和第二介质层中第一类金属互连层表面由下至上依次形成N-2层介质层;
在第二区域上方形成贯穿第一介质层至第N介质层厚度的第二类插塞;
其中,N为大于2的正整数。
2.如权利要求1所述的半导体结构的形成方法,其特征在于,第一介质层至第N介质层的材质为低介电常数材料或超低介电常数材料。
3.如权利要求1所述的半导体结构的形成方法,其特征在于,形成第二类插塞的步骤包括:
在第二区域上方形成贯穿第一介质层至第N介质层厚度的第二类通孔;
在所述第二类通孔中填充金属材料,形成第二类插塞。
4.如权利要求1所述的半导体结构的形成方法,其特征在于,形成第二类插塞的步骤包括:
在所述第N层介质层表面形成第N+1介质层;
在第二区域上方形成贯穿第一介质层至第N介质层厚度的第二类通孔以及与所述第二类通孔正对且贯穿所述第N+1介质层厚度的第二类沟槽;
在所述第二类通孔和第二类沟槽中填充金属材料,形成贯穿第一介质层至第N介质层厚度的第二类插塞和贯穿第N+1介质层厚度的第二类金属互连层。
5.如权利要求4所述的半导体结构的形成方法,其特征在于,所述第二类通孔和第二类沟槽构成大马士革结构,所述大马士革结构的形成方法为先形成通孔再形成沟槽、先形成沟槽再形成通孔或自对准工艺中的一种。
6.如权利要求1所述的半导体结构的形成方法,其特征在于,所述第一类插塞的材质为铜。
7.如权利要求1所述的半导体结构的形成方法,其特征在于,所述第二类插塞的材质为铜。
8.如权利要求6或7所述的半导体结构的形成方法,其特征在于,所述第一类插塞或第二类插塞的形成工艺为物理气相沉积工艺或化学气相沉积工艺。
9.如权利要求1所述的半导体结构的形成方法,其特征在于,当N为3时,还包括:在第三介质层形成后,在第一区域上方形成贯穿第三介质层厚度且与第二介质层中第一类金属互连层连接的第一类插塞。
10.如权利要求9所述的半导体结构的形成方法,其特征在于,还包括:在所述第三介质层和第三介质层中第一类插塞表面形成第四介质层;
形成贯穿所述第四介质层厚度且与第三介质层中第一类插塞和第一介质层至第三介质层中第二类插塞连接的金属互连层。
11.如权利要求1所述的半导体结构的形成方法,其特征在于,当N为4时,所述半导体结构的形成方法还包括:
在第三介质层形成后,在第一区域上方形成贯穿第三介质层厚度且与第二介质层中第一类金属互连层连接的第一类插塞;
在第三介质层和第三介质层中第一类插塞表面形成第四介质层;
形成贯穿第四介质层厚度且与第三介质层中第一类插塞连接的第一类金属互连层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





