[发明专利]一种时钟分频方法及装置有效
申请号: | 200910261738.2 | 申请日: | 2009-12-29 |
公开(公告)号: | CN101783676A | 公开(公告)日: | 2010-07-21 |
发明(设计)人: | 吴雪松 | 申请(专利权)人: | 中兴通讯股份有限公司 |
主分类号: | H03K23/66 | 分类号: | H03K23/66 |
代理公司: | 北京派特恩知识产权代理事务所(普通合伙) 11270 | 代理人: | 蒋雅洁;王黎延 |
地址: | 518057 广东省深圳市南山*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 时钟 分频 方法 装置 | ||
1.一种时钟分频方法,其特征在于,所述方法包括:
根据当前输入时钟频率和输出时钟频率,确定当前的分频系数,输出该分 频系数整数部分、小数部分以及得到该小数部分的小数进位阈值的数值;
对输入的时钟信号进行计数,并根据计数结果以及所述分频系数的整数部 分数值,输出计数的标识;
根据所述计数的标识,以所述分频系数的小数部分数值为累加值进行累加 计算,并根据累加计算结果以及所述小数进位阈值,输出累加的标识;
根据所述计数的标识以及所述累加的标识,控制输出时钟的电平;
所述方法具体为:对输入时钟信号进行计数,在计数结果与所述分频系数 的整数部分数值相等时,输出本次计数结束标识;在所述计数的标识是计数结 束标识时,以所述分频系数的小数部分数值为累加值进行累加计算,在累加计 算结果等于所述小数进位阈值时,输出累加结束标识;在所述累加的标识是累 加结束标识,则延迟一个时钟周期后再驱动输出时钟的电平为高。
2.根据权利要求1所述的时钟分频方法,其特征在于,所述方法还包括:
在计数结果等于所述分频系数的整数部分数值一半的整数位时,输出计数 一半标识;
在所述计数的标识是计数一半标识时,驱动输出时钟的电平为低。
3.根据权利要求1或2所述的时钟分频方法,其特征在于,所述根据所述 计数的标识以及所述累加的标识,控制输出时钟的电平,包括:
在所述计数的标识是计数结束标识且未输出累加结束标识时,直接驱动输 出时钟的电平为高。
4.一种时钟分频装置,其特征在于,所述装置包括:
确定单元,用于根据当前输入时钟频率和输出时钟频率,确定当前的分频 系数,并分别输出当前分频系数的整数部分、小数部分以及该小数部分的小数 进位阈值的数值;
计数单元,用于对输入时钟信号进行计数,并根据计数结果以及所述确定 单元输出的当前分频系数的整数部分数值,输出计数的标识;
累加单元,用于根据所述计数单元所输出计数的标识,以所述确定单元所 输出的小数部分数值为累加值进行累加计算,并根据累加计算结果以及所述确 定单元输出的小数进位阈值,输出累加的标识;
输出时钟控制单元,用于根据所述计数单元所输出计数的标识以及所述累 加单元所输出累加的标识,控制输出时钟的电平;
所述计数单元具体用于:对输入时钟信号进行计数,在计数结果与所述确 定单元输出的当前分频系数的整数部分数值相等时,输出本次计数结束标识;
所述累加单元具体用于:在所述计数单元输出本次计数结束标识时,以所 述确定单元所输出的小数部分数值为累加值进行累加计算;并在累加计算结果 不小于所述确定单元所输出的小数进位阈值时,输出累加结束标识;
所述输出时钟控制单元用于:在接收到所述累加单元所输出累加结束标识 时,延迟一个时钟周期后再驱动输出时钟的电平为高。
5.根据权利要求4所述的时钟分频装置,其特征在于,所述计数单元还用 于:在输出本次计数结束标识之后,将所述计数结果清零。
6.根据权利要求4所述的时钟分频装置,其特征在于,所述计数单元还用 于:在所述计数结果等于接收到的所述确定单元所输出当前分频系数的整数部 分数值一半的整数位时,输出计数一半标识。
7.根据权利要求4至6任一所述的时钟分频装置,其特征在于,所述输出 时钟控制单元具体用于:
在接收到所述累加单元所输出累加结束标识时,延迟一个时钟周期后再驱 动输出时钟的电平为高;
在接收到所述计数单元所输出计数结束标识且所述累加单元未输出累加结 束标识时,直接驱动输出时钟的电平为高;
在接收到所述计数单元所输出计数一半标识时,驱动输出时钟的电平为低。
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