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农业化学；冶金建筑机械工程区域搜索

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B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]PLL装置-CN200780011596.3有效
发明人：若松俊一;盐原毅;大西直树 -专利权人：日本电波工业株式会社
申请日： 2007-03-30 - 公布日： 2009-04-22 - 主分类号： H03L7/06 文献下载
摘要：本发明的目的在于提供一种能够得到极高的频率稳定度的PLL装置。
pll 装置

[发明专利]PLL电路-CN03812036.4有效
发明人： J·H·A·布雷克曼斯;C·奥里维尔 -专利权人：皇家飞利浦电子股份有限公司
申请日： 2003-05-13 - 公布日： 2005-08-17 - 主分类号： H03L7/099 文献下载
摘要：一种PLL电路(1)，包含串联连接的电荷泵(10)、环路滤波器(20)和产生输出频率(f)的压控振荡器(30)，所述压控振荡器(30)包含由受环路滤波器(20)产生的第一控制信号(Vt1)控制的可调器件(C1，C2，C1’，C2，C3)，该PLL电路(1)其特征在于，还包括产生泄漏补偿信号(IL)以修正对压控振荡器(30)控制的泄漏补偿电路(40)，该泄漏补偿信号(IL)表示压控振荡器(30)的可调器件中的漏电流
pll 电路

[发明专利]PLL电路-CN200580006038.9有效
发明人：木村修治;桥爪崇 -专利权人：三洋电机株式会社
申请日： 2005-02-14 - 公布日： 2007-02-28 - 主分类号： H03L7/18 文献下载
摘要：[解决问题的装置]一种PLL电路，包括控制单元，其在预定的时刻切换以便使能/禁止相位差信号从相位比较器提供到低通滤波器；和电阻元件，其放置在预定电位和信号之间用于将相位差信号从相位比较器提供到低通滤波器
pll 电路

[发明专利]PLL电路-CN00801804.9无效
发明人：木村卓士;中鸟正道 -专利权人：富士通将军股份有限公司
申请日： 2000-08-23 - 公布日： 2001-11-07 - 主分类号： H03L7/083 文献下载
摘要：当电压控制振荡器异常振荡,并且PLL电路停止操作时,为了迅速返回正常操作,检测从一个分频器(4)输出的一个比较信号(fc)的有/无,并且在当没有比较信号(fc)时,把一个相位比较器(4)的一个输出信号暂时强迫控制到低电平
pll 电路

[发明专利]PLL电路-CN200480040259.3无效
发明人：约翰内斯·P.·M.·范拉默壬;约瑟夫·J.·A.·M.·韦尔兰当;埃德温·J.·斯哈本当克 -专利权人：皇家飞利浦电子股份有限公司
申请日： 2004-12-29 - 公布日： 2007-01-24 - 主分类号： H03L7/107 文献下载
摘要：因此，虽然只需要一个PLL电路，可以阻止PLL装置的输出频率改变超过频率阈值。
pll 电路

[发明专利]PLL电路-CN200380103727.2无效
发明人：前多正;松野典朗;沼田圭市 -专利权人：日本电气株式会社
申请日： 2003-11-21 - 公布日： 2005-12-28 - 主分类号： H03L7/10 文献下载
摘要：一种PLL电路，具有：相位比较机构，其对基准信号和内部信号的相位进行比较，并输出与其相位差对应的相位差信号；多个振荡器，其具有互不相同的频率可变范围，且根据各个相位控制信号控制振荡频率；选择机构，其根据相位差信号或相位控制信号
pll 电路

[发明专利]一种用于同步网络环网的时钟系统和时钟自愈方法-CN201810158654.5有效
发明人：白宗元;钟有平;李兴;黄忠旭;漆中元 -专利权人：柳州达迪通信技术股份有限公司;北京荣达千里科技有限公司;广州蓝码信息科技有限公司
申请日： 2018-02-26 - 公布日： 2020-02-28 - 主分类号： H04J3/06 文献下载
摘要：所述系统包括第一PLL时钟芯片和第二PLL时钟芯片，第一PLL时钟芯片和第二PLL时钟芯片均包括多个输入端和接收端，第一PLL时钟芯片和第二PLL时钟芯片分别从各自的多个输入端中选择一个作为参考时钟；所述方法包括各网元将本身的
一种用于同步网络时钟系统自愈方法

[发明专利]电子调整器的电路装置及方法-CN200510092278.7无效
发明人： I·希普;J·拉特尔曼 -专利权人：西门子公司
申请日： 2005-07-21 - 公布日： 2006-02-01 - 主分类号： H03L7/06 文献下载
摘要：在电路装置及所属的方法中，在二阶PLL中给数字积分器添加平衡模块。由此消除PLL的比例误差和提高保持故障精度。
电子调整器电路装置方法

[发明专利]光盘装置-CN95105786.3无效
发明人：熊谷英治 -专利权人：索尼公司
申请日： 1995-04-28 - 公布日： 2002-03-06 - 主分类号： G11B7/00 文献下载
摘要：一种光盘装置，通过一个简单的结构，它能够扩大PLL频率牵引的范围，并且缩短开始PLL频率牵引所需要的时间。从线速度检测装置１１发送的线速度检测信号Ve2，在加法装置10处，被加入到控制电压Ve1上，并且，发送到PLL电路6的电压控制振荡器9上。$#!
光盘装置

[发明专利]用于解调的解调器、方法和接收机-CN200810088481.0无效
发明人： G·斯帕林克;B·艾特尔 -专利权人：索尼德国有限责任公司
申请日： 2008-03-31 - 公布日： 2008-10-01 - 主分类号： H04N5/44 文献下载
摘要：一种用于对输入信号进行解调的解调器，包括：复数值均衡器，其被配置成对所述输入信号中的复数值回波进行均衡，其中所述复数值均衡器输出复数值均衡信号；以及包括PLL子单元(340)的PLL电路(209)，其中将所述复数值均衡信号(336)或其衍生信号用作所述PLL子单元(340)的输入信号。
用于解调解调器方法接收机

[发明专利]超宽带CMOS收发器-CN200580041620.9有效
发明人： B·拉扎维;康汉昌;T·艾图尔;严然 -专利权人：伟俄内克斯研究公司
申请日： 2005-11-03 - 公布日： 2009-05-20 - 主分类号： H04B1/38 文献下载
摘要：一种直接转换超宽带收发器，其采用三相锁相环(119a-119c)，该三相锁相环能在不同频率连续运行，其选定的频率是由选择三个PLL中的一个PLL的输出确定的。三个PLL的使用适合用于在三个频带或子频带上跳频的通信系统中。
宽带 cmos 收发

[发明专利]扩频时钟产生装置-CN200880113691.9无效
发明人：山本道代;江渕刚志;村田健治 -专利权人：松下电器产业株式会社
申请日： 2008-10-28 - 公布日： 2010-09-22 - 主分类号： H03L7/18 文献下载
摘要：扩频控制部(20)对PLL(10)进行控制，输出扩频时钟信号。环路带宽控制部(30)在扩频控制部(20)的操作过程中，控制PLL(10)中的相位比较器(11)、环路滤波器(12)、电压控制振荡器(13)以及分频器(14)中的至少一个，从而改变PLL(10)的环路带宽
时钟产生装置

[发明专利]电子电路、雷达设备和对雷达设备执行自诊断的方法-CN201410044168.2有效
发明人：松村宏志 -专利权人：富士通株式会社
申请日： 2014-01-30 - 公布日： 2014-09-03 - 主分类号： G01S7/40 文献下载
摘要：该电子电路包括：第一PLL电路，包括分频比被可变地控制的第一分频器；第二分频器，用于对输入到第一分频器的信号的频率进行分频；延迟电路，用于延迟第二分频器的输出信号；第二PLL电路，用于接收延迟电路的输出信号作为参考信号；以及混频器电路，用于接收第一PLL电路的振荡信号和第二PLL电路的振荡信号作为输入。
电子电路雷达设备执行诊断方法

[发明专利]用于锁相回路的片上测量-CN201710930619.6有效
发明人： V·K·西拉拉;P·C·达托;D·M·道尔顿 -专利权人：亚德诺半导体国际无限责任公司
申请日： 2017-10-09 - 公布日： 2021-06-25 - 主分类号： H03L7/08 文献下载
摘要：芯片包括锁相回路(PLL)和测试控制器。PLL包括振荡器和相位检测器。在正常模式中，第一反馈回路包括相位检测器和基于频率输入信号产生输出的振荡器。在测试模式下，PLL被重新配置。在该测试模式构造中，PLL可以测量振荡器的频率。
用于回路测量

[发明专利]个人手提电话系统的多合成器控制系统和控制方法-CN99106721.5无效
发明人：石田隆康 -专利权人：日本电气株式会社
申请日： 1999-05-14 - 公布日： 2004-01-21 - 主分类号： H03L7/183 文献下载
摘要：调制解调器IC控制锁存使能端LE1和LE2，PLL频率合成器IC1和IC2借此控制频率设置数据的写入，使两PLL频率合成器IC之间的写入时序彼此不同，以便允许通过一条控制线把频率设置数据写入两个PLL频率合成器IC，利用反相器和“与非”电路，由另一个控制信号产生对锁存使能端LE2的控制信号，后者控制频率设置数据向PLL频率合成器IC2的写入。
个人手提电话系统合成器控制系统控制方法

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