专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]硬化的可编器件-CN201180048329.X有效
  • A·L·李;J·T·瓦特 - 阿尔特拉公司
  • 2011-08-02 - 2013-06-12 - H03K19/173
  • 硬化可编逻辑器件被提供有可编电路可编电路可以被硬连接以实现定制逻辑电路。通用制造掩模可以被用来形成可编电路,并且可以被用在硬化可编逻辑器件的产品系列的生产中,硬化可编逻辑器件中的每一个可以实现不同的定制逻辑电路。定制制造掩模可以被用来硬连接可编电路,以实现专用的定制逻辑电路可编电路可以被硬连接,从而使得实现定制逻辑电路的硬化可编逻辑器件的信号时序特性可以匹配使用配置数据实现相同定制逻辑电路可编逻辑器件的信号时序特性。
  • 硬化可编程器件
  • [发明专利]逻辑电路装置-CN200510072637.2无效
  • 大根田拓;菅野伸一;樽家昌也;宮本幸昌;小川陆 - 株式会社东芝
  • 2005-05-17 - 2005-11-23 - H03K19/173
  • 可编逻辑电路是基于电路数据的可变电路组件。电路数据存储器存储多个电路数据和性能要求。特性数据存储器存储每个可编逻辑电路的特性数据。控制单元计算多个可编逻辑电路的最小电压以执行基于性能要求的多个电路数据,并有选择地将多个电路数据分配给多个可编逻辑电路以便使分配给每个可编逻辑电路电路数据的性能要求落在最小电压下可编逻辑电路的工作范围之内提供单元为多个可编逻辑电路提供最小电压。
  • 逻辑电路装置
  • [发明专利]可编逻辑电路中硬件加速器镜像的测试与修复-CN201380073319.0在审
  • E·克鲁格里克 - 英派尔科技开发有限公司
  • 2013-02-19 - 2015-10-28 - G05B19/05
  • 本文中描述的技术一般包括用于可编逻辑电路中的硬件加速器镜像的测试和修复的方法。在包括多个可编逻辑电路的处理器芯片中,通过用复制的硬件加速器镜像对测试电路编程以及使测试电路处于与第一可编逻辑电路相同的逻辑状态,来测试被编程到第一可编逻辑电路中的硬件加速器镜像。将来自第一可编逻辑电路的输出和来自测试电路的输出进行比较表明被编程到第一可编逻辑电路中的硬件加速器镜像的精度。测试电路可以取代第一可编逻辑电路,或者测试电路可被重新编程,用来测试被编程到处理器芯片的其他可编逻辑电路中的其他硬件加速器镜像。
  • 可编程逻辑电路硬件加速器测试修复
  • [发明专利]网络中继装置-CN201210528108.9有效
  • 田村和之;加藤刚 - 阿拉克斯拉网络株式会社
  • 2012-12-10 - 2013-09-11 - H04L12/937
  • 本发明提供了一种网络中继装置,在搭载了可编逻辑电路的网络中继装置中,能够避免可编逻辑电路的配置时的通信停止,而不采用双重可编逻辑电路。网络接口部具有多个线路接口部,分别连接有物理线路;数据存储部,存储电路数据;可编逻辑电路,实现具有规定功能的逻辑电路;设定电路,使用电路数据,针对可编逻辑电路构成逻辑电路;以及状态控制部,设置在可编逻辑电路以外的电路
  • 网络中继装置
  • [实用新型]一种普适型接收机降功耗的实现电路-CN202221393114.3有效
  • 尚润平;彭真 - 成都云智北斗科技有限公司
  • 2022-06-06 - 2022-09-13 - G05B19/042
  • 本实用新型提出了一种普适型接收机降功耗的实现电路,涉及接收机领域。其包括主控电路及分别与主控电路相连的通讯电路可编逻辑电路、串口电路、连接器电路、数字收发器电路、SD卡连接器电路和传感器电路,还包括电源电路,主控电路、通讯电路可编逻辑电路、串口电路、连接器电路、数字收发器电路、SD卡连接器电路和传感器电路均与电源电路相连,通讯电路还分别与可编逻辑电路和数字收发器电路相连,可编逻辑电路与数字收发器电路相连,串口电路还分别与可编逻辑电路和连接器电路相连,连接器电路还与数字收发器电路相连通过优化电路结构,能够有效的降低接收机的功耗。
  • 一种普适型接收机降功耗实现电路
  • [发明专利]可编逻辑器件分组方法和装置-CN202011513510.0有效
  • 李伟;张吉锋;林铠鹏;邵中尉 - 上海国微思尔芯技术股份有限公司
  • 2020-12-21 - 2021-03-05 - G06F30/367
  • 本发明提供了一种可编逻辑器件分组方法和装置,属于集成电路芯片设计领域,具体包括获取可编逻辑器件之间的物理电路连接关系以及逻辑电路图;对逻辑电路图中的逻辑电路实例进行聚类得到多个子集合;将所有子集合根据物理电路连接关系分配到可编逻辑器件上;对分配给可编逻辑器件的子集合进行优化调整,得到理论集合分配方案以及违规连接列表;针对违规连接列表中的各逻辑电路实例构建多级跳点路径;根据多级跳点路径对逻辑电路连接关系进行修改,输出与物理电路连接关系对应的实际设计文件通过本申请的处理方案,分割互联最小、速度更快,处理数据规模更大的可编逻辑器件分组结果,从而提高了芯片处理效率。
  • 可编程逻辑器件分组方法装置

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