[发明专利]一种顶层选择栅切线的刻蚀工艺方法有效
申请号: | 201710733247.8 | 申请日: | 2017-08-24 |
公开(公告)号: | CN107731832B | 公开(公告)日: | 2019-03-19 |
发明(设计)人: | 何佳;洪培真;华文宇;刘藩东;杨要华;夏志良;霍宗亮 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11529 | 分类号: | H01L27/11529;H01L27/11551;H01L27/11573;H01L21/308 |
代理公司: | 北京辰权知识产权代理有限公司 11619 | 代理人: | 董李欣 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: |
本发明提供了一种顶层选择栅切线的刻蚀工艺方法,通过将顶层选择栅切线刻蚀工艺步骤前置,设置在ON堆叠结构形成之后、台阶结构形成之前,而由于ON堆叠结构刚形成之后核心存储区域较为平坦,核心存储区与边缘区、晶圆中心和边缘之间厚度的差距< |
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搜索关键词: | 一种 顶层 选择 切线 刻蚀 工艺 方法 | ||
【主权项】:
1.一种顶层选择栅切线的刻蚀工艺方法,其特征在于,依次包括以下步骤:形成多层堆叠结构,具体为,提供衬底并在所述衬底表面形成多层交错堆叠的层间介质层及牺牲介质层,所述牺牲介质层形成于相邻的层间介质层之间;为形成顶层选择栅切线(Top Select Gate Cut)进行光刻;为形成顶层选择栅切线(Top Select Gate Cut)进行刻蚀以形成顶层选择栅切线(Top Select Gate Cut)沟道;对顶层选择栅切线(Top Select Gate Cut)沟道进行氧化物填充;对多余的顶层选择栅切线(Top Select Gate Cut)沟道填充氧化物的去除;形成堆叠结构的台阶结构。
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H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
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