[发明专利]P型LDMOS表面沟道器件提高面内均匀性的制造方法有效
申请号: | 201210305990.0 | 申请日: | 2012-08-24 |
公开(公告)号: | CN103632974A | 公开(公告)日: | 2014-03-12 |
发明(设计)人: | 周正良;遇寒;马彪 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 丁纪铁 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 发明公开了一种P型LDMOS表面沟道器件提高面内均匀性的制造方法,以多晶硅和金属硅化物作为栅极,采用沟道注入、长时间高温推进、N型重掺杂的多晶硅电连接下沉工艺、多晶硅栅极硼离子掺杂的工艺次序,在栅极形成时没有掺杂硼,这样就可以进行长时间高温推进以形成足够宽的沟道,避免了短沟道效应造成的器件穿透或漏电;形成低掺杂的漏端漂移区后,淀积氧化硅并进行N型重掺杂的多晶硅电连接下沉工艺,再形成栅极多晶硅侧墙,并对多晶硅栅极进行硼注入,由于硼注入后没有长时间高温推进工艺,因此避免了硼穿透栅氧化层,也避免了重掺杂的多晶硅电连接下沉通道中N型杂质外扩到沟道或其它区域,这样形成的器件性能稳定,而工艺流程也简单易于实施。 | ||
搜索关键词: | ldmos 表面 沟道 器件 提高 均匀 制造 方法 | ||
【主权项】:
一种P型LDMOS表面沟道器件提高面内均匀性的制造方法,其特征是,包括以下步骤:步骤1,在N型衬底(1)上生长N型外延区(2),N型外延区(2)上方生长栅氧化层(3),栅氧化层(3)上方淀积一层非掺杂的多晶硅;步骤2,光刻和干刻非掺杂的多晶硅形成多晶硅栅极(4),利用光刻胶遮挡后续形成漏区的区域以及靠近该区域的部分多晶硅栅极并进行N型离子注入,离子注入能量未穿透多晶硅栅极;步骤3,去除光刻胶并进行第一次P型离子注入,进行高温推进形成N型沟道(5)和第一轻掺杂漏扩散漂移区(6);步骤4,进行第二次P型离子注入,形成第二轻掺杂漏扩散漂移区(7);步骤5,淀积一层氧化硅,通过光刻和干刻打开N型沟道(5)远离多晶硅栅极(4)一侧的氧化硅,在打开区域刻蚀N型外延区(2)形成深沟槽,所述深沟槽的底部位于N型衬底(1)中;步骤6,在深沟槽内和氧化硅上淀积N型重掺杂多晶硅,所述N型重掺杂多晶硅填充满深沟槽形成多晶硅电连接下沉通道(9);步骤7,回刻N型重掺杂多晶硅并停止在氧化硅上;步骤8,淀积一层有机介质(20),回刻有机介质(20)和氧化硅,去除多晶硅栅极(4)顶部的有机介质(20)和氧化硅,并在多晶硅栅极(4)侧面形成氧化硅侧墙(8),其余区域保留部分有机介质和全部氧化硅;步骤9,对多晶硅栅极(4)进行P型离子注入,注入能量未穿透剩余的部分有机介质和氧化硅;步骤10,去除有机介质(20),光刻定义源漏区,湿法去除部分氧化硅,进行源漏区离子注入并快速退火,在氧化硅去除部分下方形成源极(11)和漏极(10);步骤11,打开源漏区需要金属硅化的区域,进行金属硅化工艺,在多晶硅栅极(4)和源极(11)、漏极(10)上形成金属硅化物(12)。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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