[发明专利]半导体存储器、存储器系统和存储器系统的操作方法有效
申请号: | 200610098454.2 | 申请日: | 2006-07-07 |
公开(公告)号: | CN101038783A | 公开(公告)日: | 2007-09-19 |
发明(设计)人: | 内田敏也 | 申请(专利权)人: | 富士通株式会社 |
主分类号: | G11C8/16 | 分类号: | G11C8/16;G11C11/40 |
代理公司: | 北京东方亿思知识产权代理有限责任公司 | 代理人: | 宋鹤 |
地址: | 日本神*** | 国省代码: | 日本;JP |
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摘要: | 本发明提供了一种存储器系统,其包括具有多个存储体的半导体存储器和访问该半导体存储器的控制器。存储体的数目大于被同时访问的存储体的数目。当接收到针对当前正在执行访问操作的存储体的访问命令时,半导体存储器激活忙信号,并使忙信号保持活动,直到当前执行的访问操作完成为止。控制器在接收到激活的忙信号时停止输出下一访问命令。基于接收到的忙信号,控制器判断下一访问命令是否应该被输出到半导体存储器。因此,可以容易地在具有多个存储体的半导体存储器中执行随机访问,而不会给系统侧带来任何负担,这可以提高在随机访问时的数据传输速率。 | ||
搜索关键词: | 半导体 存储器 系统 操作方法 | ||
【主权项】:
1.一种半导体存储器,包括:多个存储体,其中每个存储体具有存储单元并可彼此独立地操作;存储体控制单元,其控制对所述存储体的访问操作;地址保存单元,其保存指示当前处在访问操作中的存储体的存储体地址;地址比较单元,其将由所述地址保存单元保存的存储体地址与包括在与来自外部的访问请求一起提供的外部地址中的存储体地址相比较;以及比较结果输出单元,其在所述地址比较单元的比较结果指示相符时使忙信号保持激活,其中所述存储体的数目大于可由所述存储体控制单元同时访问的存储体的数目。
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