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农业化学；冶金建筑机械工程区域搜索

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B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]具有用于电信号的再驱动单元的半导体存储芯片-CN200610153967.9无效
发明人： H·鲁克鲍尔;P·格雷戈里乌斯 -专利权人：奇梦达股份公司
申请日： 2006-09-15 - 公布日： 2007-08-01 - 主分类号： G11C5/06 文献下载
摘要：半导体存储芯片包括再驱动单元，其用于再驱动电信号至与其连接的至少一个半导体存储芯片。该再驱动单元包括在两个连接节点之间的直接线连接，即半导体存储芯片的一个输入端子和一个输出端子。
具有用于电信号驱动单元半导体存储芯片

[发明专利]用于点对点数据交换的半导体存储器模块单元-CN200610071156.4无效
发明人： H·鲁克鲍尔 -专利权人：英飞凌科技股份公司
申请日： 2006-03-16 - 公布日： 2007-02-21 - 主分类号： G11C5/06 文献下载
摘要：本发明描述了用于与存储器控制器进行点对点数据交换的半导体存储器模块单元(1)。可在半导体存储器模块单元(1)上以这样一种方式布置具有不同数据带宽的存储器芯片(4，4’，4”)，即通过从节点状存储器芯片(4’)到多个下游的存储器芯片(4”)的信号数据传输得到树状分流，同时保持数据带宽。
用于点对点数据交换半导体存储器模块单元

[发明专利]存储系统和对存储系统的存储芯片进行存取的方法-CN200610082692.4无效
发明人： P·瓦尔纳;R·施勒兹;P·格雷戈里乌斯;H·鲁克鲍尔 -专利权人：英飞凌科技股份公司
申请日： 2006-05-12 - 公布日： 2007-01-10 - 主分类号： G11C11/34 文献下载
摘要：公开了一种存储系统和方法。在一个实施方案中，该存储系统包括存储控制器和至少一个存储模块，在该存储模块上以分别所规定的拓扑布置有一定数量的半导体存储芯片和连接线。所述连接线包括第一连接线，其中所述第一连接线形成传输信道，用于将基于协议的数据和命令信号流分别从所述存储控制器传输给所述存储模块上的存储芯片中的至少一个以及从那里传输给所述存储控制器。第二连接线单独地从所述存储控制器被直接路由到所述存储模块上的存储芯片中的至少一个，用于将选择信息与所述数据和命令信号流分开地传输给所述至少一个存储芯片。
存储系统存储芯片进行存取方法

[发明专利]存储器件-CN200610093675.0无效
发明人： C·魏斯;S·卡尔姆斯;H·鲁克鲍尔 -专利权人：英飞凌科技股份公司
申请日： 2006-06-14 - 公布日： 2006-12-20 - 主分类号： G11C29/48 文献下载
摘要：一种存储器件包括至少两个DRAM存储模块、至少一个外部ECC模块、和存储控制器。外部ECC模块为存储模块提供ECC功能性。每个存储模块通过相应的存储通道连接到存储控制器。外部ECC模块通过公共ECC通道连接到存储控制器。每个外部ECC模块被分配给存储模块组。一组存储模块以及相应的ECC模块被存储控制器同步操作。
存储器件

[发明专利]用于在存储模块中设置行列地址的方法-CN200610081888.1无效
发明人： P·厄沙伊;H·鲁克鲍尔 -专利权人：英飞凌科技股份公司
申请日： 2006-05-17 - 公布日： 2006-11-22 - 主分类号： G11C8/12 文献下载
摘要：一种用于在具有多个沿字节通道分布的存储芯片的存储模块中设置行列地址的方法包括：将字节通道的第一存储芯片设置成具有第一行列地址，在第一存储芯片中根据所述第一行列地址生成第二行列地址并将该第二行列地址传送到所述存储芯片中的第二存储芯片。替代地，可以将第一行列地址传送到第二存储芯片，然后在该第二存储芯片中生成第二行列地址。另外，响应于传送第二/第一行列地址的所述替代步骤而将第二存储芯片设置成具有第二行列地址。在电压供应之后的上电序列、或通过串行管理总线或命令地址总线所发送的命令信号可被用于启动行列的设置。行列地址通过沿字节通道的DQ线被再传送到相邻的存储芯片。
用于存储模块设置行列地址方法

[发明专利]电路系统-CN200480028406.5无效
发明人： M·库茨门卡;S·穆夫;H·鲁克鲍尔 -专利权人：英飞凌科技股份公司
申请日： 2004-08-12 - 公布日： 2006-11-08 - 主分类号： H03K19/003 文献下载
摘要：一种电路系统，包括利用差分控制信号控制第一和第二存储单元的装置(102)。差分控制信号包括第一控制信号和与第一控制信号反向的第二控制信号。电路系统还包括一条差分控制信号线(120)，它包括提供第一控制信号的第一信号线(122)和提供第二控制信号的第二信号线(124)。第一电路单元(104)通过第一信号线(122)而第二电路单元(106)通过第二信号线(124)连接到控制装置(102)。
电路系统

[发明专利]集成存储装置和存储模块-CN200510023036.2无效
发明人： C·西歇尔特;H·鲁克鲍尔;D·萨维纳克;P·格雷戈里乌斯;P·瓦尔纳 -专利权人：因芬尼昂技术股份公司
申请日： 2005-11-24 - 公布日： 2006-09-13 - 主分类号： G11C7/00 文献下载
摘要：本发明涉及一种集成存储装置，包括：排列在字线和位线处的存储单元，其中存储单元可以2ⁿ位组寻址，其中n是整数；预取读出单元，并行地从被寻址的存储区域预取被寻址的2ⁿ数据位组；缓冲存储器，缓冲该数量的预取数据位；m个输出端口，输出在缓冲存储器里缓冲的数据位；输出控制器，控制在缓冲存储器里缓冲的数据位以m位组在一个或多个连续的周期输出到m个输出端口，其特征在于输出端口数m和可寻址存储单元组的任何可能数目2ⁿ都不同。
集成存储装置模块

[发明专利]半导体存储系统和在其中传输写入和读取数据信号的方法-CN200510138043.7无效
发明人： H·鲁克鲍尔;C·西歇尔特;D·萨维纳克;P·格雷戈里乌斯;P·瓦尔纳 -专利权人：因芬尼昂技术股份公司
申请日： 2005-11-15 - 公布日： 2006-08-30 - 主分类号： G11C7/00 文献下载
摘要：用于在接口电路之间传输写入和读取数据信号的半导体存储系统包括：至少一个存储器件、存储控制器单元和可选的半导体存储系统的寄存器单元，其中数据信号每个都以具有特定脉冲串长度的信号脉冲串传输。该系统的特征在于至少与每第n信号脉冲一起传输扩展脉冲串长度的若干附加位。
半导体存储系统其中传输写入读取数据信号方法

[发明专利]存储器装置,存储器控制器及其操作方法-CN200510136397.8无效
发明人： H·鲁克鲍尔;C·西歇特;D·萨维纳克 -专利权人：因芬尼昂技术股份公司
申请日： 2005-12-13 - 公布日： 2006-08-30 - 主分类号： G11C5/02 文献下载
摘要：本发明的一个实施例提供包括多个存储体组的存储器装置，其中每个存储体包括存储器阵列并适合于在数据访问中被读出；多条内部数据总线和多条内部命令和地址总线被各自连接到所述多个存储体组，以便于每个存储体组与所述内部数据总线之一和所述内部命令和地址总线之一相关联；从外部接收命令和地址数据的命令和地址端口；以及根据所述地址数据，经由所述相关的命令和地址总线指示所述接收的命令和地址数据到所述存储体组之一的命令和地址单元，以及接收在数据访问中经由各自的内部数据总线从存储体组之一读出的数据并且连续地输出所述接收数据的数据输出单元。
存储器装置控制器及其操作方法

[发明专利]半导体存储器模块-CN200510128956.0无效
发明人： H·鲁克鲍尔;A·巴哈;C·西歇尔特;D·萨维纳克;P·格雷戈里乌斯;P·瓦尔纳 -专利权人：因芬尼昂技术股份公司
申请日： 2005-12-02 - 公布日： 2006-08-09 - 主分类号： H01L25/00 文献下载
摘要：一种半导体存储器模块，包括多个半导体存储器芯片和将输入时钟信号和输入命令和地址信号提供给半导体存储器芯片的汇流信号线。时钟信号再生电路和寄存器电路在半导体存储器模块上布置在连接到汇流信号线的公共芯片封装体内。时钟信号再生电路和寄存器电路分别调节输入时钟信号和临时存储的输入命令和地址信号，分别将被调节的时钟信号和临时存储的命令和地址信号乘以因数1∶X，并分别向半导体存储器芯片提供被调节的时钟信号和临时存储的命令和地址信号。
半导体存储器模块

[发明专利]用于存储模块的存储装置-CN200510127111.X无效
发明人： H·鲁克鲍尔 -专利权人：因芬尼昂技术股份公司
申请日： 2005-11-21 - 公布日： 2006-07-19 - 主分类号： G06F12/00 文献下载
摘要：提供了在存储模块中使用的存储装置和操作存储装置的方法。在一个实施例中，存储装置包括存储器阵列、存储器存取逻辑电路、命令接口、转发器单元，存储器存取逻辑电路用于根据命令数据控制对存储器阵列的存取，命令接口用于建立与存储控制器的点对点互连并包含用于接收指示命令数据的第一和第二命令信号的第一和第二命令端口，转发器单元用于经由第一命令端口接收第一命令信号并将第一命令信号转发到转发端口。
用于存储模块装置

[发明专利]半导体存储器系统及在存储器控制器和半导体存储器之间传输数据的方法-CN200510118525.6无效
发明人： H·鲁克鲍尔 -专利权人：因芬尼昂技术股份公司
申请日： 2005-10-27 - 公布日： 2006-06-07 - 主分类号： G11C7/22 文献下载
摘要：提出一种半导体存储器系统，在其中跟随写/读指令(WRITE)的指令/地址数据(CA)的、一个脉冲串的存储器数据(DQ)的传输用修改后的时钟信号(CLK)来标识。该修改后的时钟信号(CLK)包括具有被屏蔽掉的时钟边沿的标识区域(3，4)，因此存储器数据(DQ)的传输可以用跟随该标识区域(3，4)的时钟边沿来表示。
半导体存储器系统控制器之间传输数据方法

[发明专利]半导体存储芯片和模块、向该芯片发送写数据的方法-CN200510118443.1无效
发明人： H·鲁克鲍尔;D·萨维纳克;P·格雷戈里乌斯;C·西歇尔特;P·瓦尔纳 -专利权人：因芬尼昂技术股份公司
申请日： 2005-10-28 - 公布日： 2006-06-07 - 主分类号： G11C11/4093 文献下载
摘要：本发明涉及半导体存储芯片和模块、向该芯片发送写数据的方法，其中在装有多个半导体存储芯片(11－14)的半导体存储模块(110)中，所述的芯片分别具有一接口电路(1－4)，如果每个接口电路(1－4)检测到写数据中的传输差错，则该接口电路可以经一单独的请求信号路径(5－8)输出一重复请求信号(rReq)，以用于重复传输被检测为错误的写数据。该重复请求信号(rReq)可以单比特信号或以多比特信号、也即串行地作为一专用信号线路被传输给上一级存储器控制器(120)。从而重复请求信号只需要以低速率发送。
半导体存储芯片模块发送数据方法

[发明专利]具有双向时钟线的存储装置、存储控制器和存储系统-CN200510107002.1无效
发明人： H·鲁克鲍尔;C·西歇特;D·萨维纳克;P·格雷戈里乌斯;P·瓦尔纳 -专利权人：因芬尼昂技术股份公司
申请日： 2005-09-30 - 公布日： 2006-05-31 - 主分类号： G11C11/407 文献下载
摘要：本发明的一个实施例提供了一种存储装置，该存储装置适合于接收根据写时钟信号的数据和输出根据读时钟信号的数据，包括时钟端口和串行双向驱动器，配置该时钟端口以输出读时钟信号并接收写时钟信号，配置该串行双向驱动器以经由时钟端口输出读时钟信号并且同时经由时钟端口接收写时钟信号。
具有双向时钟存储装置控制器存储系统

[发明专利]具有两条时钟线和存储装置的存储系统-CN200510106493.8有效
发明人： H·鲁克鲍尔;C·西歇特;D·萨维纳克;P·格雷戈里乌斯;P·瓦尔纳 -专利权人：因芬尼昂技术股份公司
申请日： 2005-09-30 - 公布日： 2006-04-05 - 主分类号： G06F3/06 文献下载
摘要：本发明涉及一种具有两条时钟线的存储装置的存储系统。本发明的一个实施例提供了一种存储系统，包括：至少一个存储装置；控制存储装置操作的存储控制器；第一时钟线，其从存储控制器的写时钟输出延伸到该存储装置的时钟端口，以将时钟信号提供给该存储装置；以及第二时钟线，其从该存储装置的时钟端口延伸到存储控制器的读时钟输入，以将施加到存储装置时钟端口的时钟信号转发回存储控制器的读时钟输入。该存储装置可进一步包括同步电路，其适合于接收来自存储控制器的时钟信号，并提供与所转发的时钟信号同步的输出数据。
具有时钟存储装置存储系统

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