专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体装置的制造方法、工件一体化装置、薄膜层叠体和半导体装置-CN202210963971.0在审
  • 伊关亮;秋月伸也 - 日东电工株式会社
  • 2022-08-11 - 2023-02-28 - H01L21/683
  • 本发明提供半导体装置的制造方法、工件一体化装置、薄膜层叠体和半导体装置,在将半导体元件安装于基板来制造半导体装置时能在避免基板损伤的同时防止基板产生翘曲并能提高半导体装置的制造效率。具有安装于工件的半导体元件(7)被密封材料(9)密封的构造的半导体装置(11)的制造方法具备:工件载置过程,在该过程中,将工件载置于在承载件(1)上层叠用于保持工件的保持薄膜而成的薄膜层叠体的保持薄膜侧;元件安装过程,在该过程中,在被载置于薄膜层叠体的工件上安装半导体元件;密封过程,在该过程中,利用密封材料将安装于工件的半导体元件密封;以及脱离过程,在该过程中,使工件和被密封材料密封的半导体元件脱离薄膜层叠体。
  • 半导体装置制造方法工件一体化薄膜层叠
  • [发明专利]半导体元件的制造方法-CN201310499119.3在审
  • 秋月伸也;福原淳仁;杉村敏正;高桥智一;水野浩二 - 日东电工株式会社
  • 2013-10-22 - 2014-05-07 - H01L27/146
  • 本发明提供一种半导体元件的制造方法,其能够以优异的生产效率制造具有贯通导电路径的半导体元件。本发明的制造方法包括:[工序A],准备半导体晶圆,所述半导体晶圆具有形成有多个半导体元件的有源面、在与该有源面相反侧的面上形成的规定的图案的导电层、以及连接该有源面和其相反侧的面的贯通导电路径;[工序B],在该导电层上形成焊料凸块;以及[工序C],切割该半导体晶圆,其中,该[工序A]包括在具有形成有多个半导体元件的有源面的半导体晶圆的该有源面侧贴附有保护带的状态下,对与该有源面相反侧的面进行磨削的步骤,从该磨削起至[工序C]的切割为止在贴附该保护带的状态下进行。
  • 半导体元件制造方法
  • [发明专利]半导体元件的制造方法-CN201310247086.3在审
  • 秋月伸也;杉村敏正;宇圆田大介;松村健 - 日东电工株式会社
  • 2013-06-20 - 2014-01-15 - H01L21/683
  • 本发明提供能够实现生产效率进一步提高的半导体元件的制造方法。本发明的半导体元件的制造方法,具有以下工序:将转印用基板和形成于功能层形成用基板上的功能层借助临时固定层进行贴合的工序;除去功能层形成用基板而使功能层露出的工序;在露出的功能层上贴合最终基板的工序;和将临时固定层和转印用基板从功能层分离的工序,其中,对于临时固定层而言,(A)在200℃保持1分钟后在该温度下对硅晶片的剪切粘接力为0.25kg/5×5mm以上,并且在大于200℃且500℃以下的温度区域中的任意温度下保持3分钟后在该温度下对硅晶片的剪切粘接力小于0.25kg/5×5mm;或者(B)在50℃的N-甲基-2-吡咯烷酮中浸渍60秒钟并且在150℃下干燥30分钟后的重量减少率为1.0重量%以上。
  • 半导体元件制造方法
  • [发明专利]半导体装置的制造方法-CN201210543925.1无效
  • 清水祐作;秋月伸也;小田高司;丰田英志;松村健 - 日东电工株式会社
  • 2012-12-14 - 2013-06-19 - H01L21/56
  • 本发明提供半导体芯片的污染少且生产效率高的半导体装置的制造方法。本发明的半导体装置的制造方法,其特征在于,其是具备半导体芯片的半导体装置的制造方法,该制造方法具备以下工序:工序A,准备半导体芯片;工序B,准备具有热固化型树脂层的树脂片;工序C,在热固化型树脂层上配置多个半导体芯片;和工序D,在多个半导体芯片上配置保护膜,并通过隔着配置的保护膜而施加的压力,将多个半导体芯片埋入热固化型树脂层;其中,保护膜对水的接触角为90°以下。
  • 半导体装置制造方法

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