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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]去耦电容器电路系统-CN201210228934.1有效
发明人： C·H·库尔 -专利权人： 阿尔特拉公司
申请日： 2012-06-29 - 公布日： 2013-03-27 - 主分类号： H01L27/06 文献下载
摘要：本公开的实施例涉及去耦电容器电路系统。提供了具有去耦电容器电路系统的集成电路。该去耦电容器电路系统可以包括符合密度准则的结构。符合密度准则的结构可以被联接至由电源线驱动的金属路径。以此方式联接符合密度准则的虚设结构可以增加去耦电容器电路系统的每单位面积的电容。以此方式联接符合密度准则的虚设结构可以屏蔽去耦电容器以免受附近噪声信号源的影响。
电容器电路系统

[发明专利]具有双边沿时钟的集成电路-CN201180028776.9有效
发明人： A·K·拉威;D·刘易斯 -专利权人： 阿尔特拉公司
申请日： 2011-06-10 - 公布日： 2013-03-27 - 主分类号： H03K5/15 文献下载
摘要：本发明提供了支持双边沿时钟的集成电路，所述集成电路可以包括锁相环，所述锁相环生成方波时钟信号。所述时钟信号可以由芯片外外装置经过输入输出引脚提供。所述时钟信号可以通过时钟分布网络路由以提供本地时钟信号给脉冲发生器，所述脉冲发生器在上升和下降时钟边沿生成时钟脉冲。所述脉冲发生器可以生成时钟脉冲，这些时钟脉冲由所述上升和下降时钟边沿触发并且具有用于最优性能的公共脉冲宽度。可以为了最优性能最小化由所述时钟网络引入的占空比失真。自适应占空比失真电路可以用来控制时钟缓冲器的上拉/下拉驱动强度，以便本地时钟信号的高时钟相位近似为半个时钟周期。
具有双边时钟集成电路

[发明专利]数控振荡器-CN201210480741.5无效
发明人： M·芒萨维;W·W·贝雷扎 -专利权人： 阿尔特拉公司
申请日： 2009-06-29 - 公布日： 2013-03-20 - 主分类号： H03L7/099 文献下载
摘要：本申请涉及数控振荡器。提供一种基于倒相器环的振荡器电路。该倒相器环可以是单端倒相器或者差分倒相器。可以在倒相器输出处提供数控可调节负载电容器，以调谐振荡器电路。每个数控可调节负载电容器可以由多个并行连接的变容二极管构成。每个变容二极管可以具有接收数控信号的控制输入。给定振荡器中的数控可调节负载电容器可以联合调节，以产生用于每个电容器的相同电容值，或者可以独立调节，从而使其产生不同的电容值。倒相器可以包括共模增益降低特征，诸如串行连接的电流源、串行连接的电阻器、以及交叉耦合的负反馈晶体管。
数控振荡器

[发明专利]用于提高电子电路可靠性的装置和相关方法-CN201210231836.3在审
发明人： B·B·佩德森;I·拉希姆 -专利权人： 阿尔特拉公司
申请日： 2012-07-02 - 公布日： 2013-03-13 - 主分类号： H03K19/003 文献下载
摘要：本发明涉及用于提高电子电路可靠性的装置和相关方法。在示范性实施例中，一种装置包括第一组电路元件和第二组电路元件。第一组电路元件用于所述装置的第一配置，以及第二组电路元件用于所述装置的第二配置。将所述装置的第一配置切换至所述装置的第二配置以便提高所述装置的可靠性。
用于提高电子电路可靠性装置相关方法

[发明专利]用于周期性信号的输入/输出接口-CN201180026384.9有效
发明人： A·阮 -专利权人： 阿尔特拉公司
申请日： 2011-05-20 - 公布日： 2013-03-13 - 主分类号： H03K19/0175 文献下载
摘要：第一周期性信号生成电路生成第一周期性输出信号。第二周期性信号生成电路生成第二周期性输出信号。第一复用器电路接收第一和第二周期性输出信号。耦合到外部引脚的接口电路基于由第一复用器电路选择的周期性信号来生成第三周期性输出信号。第二复用器电路在输入处接收第三周期性信号。提供到第一周期性信号生成电路的第一周期性反馈信号基于由第二复用器电路选择的信号。第三复用器电路在输入处接收第三周期性输出信号。提供到第二周期性信号生成电路的第二周期性反馈信号基于由第三复用器电路选择的信号。
用于周期性信号输入输出接口

[发明专利]用于提高现场可编程门阵列的性能的装置和关联方法-CN201210299454.4在审
发明人： I·拉希姆;J·T·瓦特;R·G·克利夫;A·L·李;P-C·刘 -专利权人： 阿尔特拉公司
申请日： 2012-08-20 - 公布日： 2013-03-06 - 主分类号： G06F15/76 文献下载
摘要：一种现场可编程门阵列(FPGA)包括：一组监视电路，适于提供FPGA中的至少一个电路的工艺、电压和温度指示；以及控制器，适于根据用于至少一个电路的工艺、电压和温度指示来推导用于至少一个电路的体偏置值范围。FPGA还包括：体偏置生成器，适于向至少一个电路中的至少一个晶体管提供体偏置信号。体偏置信号具有在体偏置值范围内的值。
用于提高现场可编程门阵列性能装置关联方法

[发明专利]缓冲型finFET器件-CN201210306226.5有效
发明人： I·拉希姆;J·T·瓦特;徐彦忠;刘令时 -专利权人： 阿尔特拉公司
申请日： 2012-08-17 - 公布日： 2013-03-06 - 主分类号： H01L29/423 文献下载
摘要：一个实施例涉及一种缓冲型finFET器件。该器件包括形成于半导体衬底中的缓冲型竖直鳍形结构。竖直鳍形结构至少包括上半导体层、缓冲区域和阱区域的至少部分。缓冲区域具有第一掺杂极性，并且阱区域具有与第一掺杂极性相反的第二掺杂极性。至少一个p-n结形成于缓冲与阱区域之间，该p-n结至少部分地覆盖竖直鳍形结构的水平横截面。也公开了其它实施例、方面和特征。
缓冲 finfet 器件

[发明专利]用于集成电路设备中的三角函数的计算-CN201180031374.4有效
发明人： M·兰厄姆默 -专利权人： 阿尔特拉公司
申请日： 2011-06-21 - 公布日： 2013-03-06 - 主分类号： G06F7/548 文献下载
摘要：一种用于计算输入的三角函数的电路，其包括：用于将输入与另一个值关联以生成中间值的电路；用于选择该输入和该中间值中的一个作为三角输入值的电路；用于确定用于该三角输入值的多个三角函数各自的初始值的电路；以及用于至少部分地基于三角恒等式，从该多个三角函数各自的初始值得出第一三角函数的最终值的电路。该三角函数可以是任何正弦、余弦和正切和它们的反函数。所使用的三角恒等式允许将三角函数的计算分解成更易于执行或者能够被更准确地执行的片。
用于集成电路设备中的三角函数计算

[发明专利]高效处理器装置和关联方法-CN201180013328.1有效
发明人： S·佩里 -专利权人： 阿尔特拉公司
申请日： 2011-01-31 - 公布日： 2013-02-27 - 主分类号： G06F13/16 文献下载
摘要：一种装置包括处理器。处理器包括两个存储器。第一存储器存储指令集。第二存储器存储比第一存储器中的指令集更长的另一指令集。第一存储器中的指令集中的指令用作指向第二存储器中的指令集中的对应指令的指针。
高效处理器装置关联方法

[发明专利]具有软错误翻转免疫性的存储器元件-CN201180026921.X无效
发明人： T·H·怀特 -专利权人： 阿尔特拉公司
申请日： 2011-03-29 - 公布日： 2013-02-06 - 主分类号： G11C7/10 文献下载
摘要：本发明提供了带有存储器单元的集成电路。存储器单元可以具有连接成环形配置的四个类似反相器电路和四个相应的存储节点。四个类似反相器电路可以形成该存储器单元的存储部分。在上拉和下拉路径中，某些类似反相器电路可以具有三态晶体管。该三态晶体管可以由地址信号控制。地址和存取晶体管可以耦合在某些存储节点和数据线之间。该地址和存取晶体管可以用来读取和写入存储器单元。在写操作期间，可以使地址信号有效以关断三态晶体管和消除单元的竞争电流。在读和正常操作期间，可以使该地址信号无效以允许该类似反相器电路保持所述单元的当前状态同时提供软错误翻转免疫性。
具有错误翻转免疫性存储器元件

[发明专利]用于实现非阻塞式基于优先级流控的方法和装置-CN201180024325.8有效
发明人： A·迪贝 -专利权人： 阿尔特拉公司
申请日： 2011-05-16 - 公布日： 2013-01-23 - 主分类号： H04L12/801 文献下载
摘要：提供了一种包括链路控制器以及和链路控制器通信的多个队列控制器的集成电路。多个队列控制器的每个队列控制器可操作用于耦合到集成电路外部的远程数据发送器的专用缓冲器。多个队列控制器可操作用于监控专用缓冲器的缓冲器充满水平，并且多个队列控制器的每个队列控制器可操作用于发送指示缓冲器充满水平的信号给链路控制器。链路控制器可用于向远程发送器发送优先级流控信号，其中，从发送指示缓冲器充满水平的信号到检测到缓冲器充满水平的时间段对于每个专用缓冲器是一致的。
用于实现阻塞基于优先级方法装置

[发明专利]用于在综合期间执行异步和同步复位去除的方法以及设备-CN201180023477.6有效
发明人： V·玛诺哈拉拉雅 -专利权人： 阿尔特拉公司
申请日： 2011-05-09 - 公布日： 2013-01-23 - 主分类号： G06F17/50 文献下载
摘要：公开了一种用于在目标装置上设计系统的方法。通过将系统的高层次描述转换为门、寄存器和复位电路来综合系统。执行分析以标识并去除冗余复位电路。在已去除冗余复位电路之后优化系统。也公开了其它一些实施例。
用于综合期间执行异步同步复位去除方法以及设备

[发明专利]用于可编程逻辑器件的宽范围可编程能力的异构收发器体系结构-CN201210397425.1有效
发明人： S·舒马拉耶夫;B·W·贝芮扎;C·H·李;R·H·帕特尔;W·王 -专利权人： 阿尔特拉公司
申请日： 2007-01-15 - 公布日： 2013-01-16 - 主分类号： H03K19/177 文献下载
摘要：可编程逻辑器件（PLD）上的高速串行数据收发器电路系统，其包括：一些能以高达第一较低最大数据率的数据率工作的信道，和其他能以高达第二较高最大数据率的数据率工作的信道。速度较低的信道是由速度较低的锁相环（PLL）电路系统提供，并且具有处理以较低数据率发射的数据所需的其他电路组件。速度较高的信道是由速度较高的PLL提供的，并且具有处理以较高数据率发射的数据所需的其他电路组件。
用于可编程逻辑器件范围能力收发体系结构

[发明专利]在集成电路器件中求解线性矩阵-CN201180022672.7有效
发明人： M·兰厄默;K·达哈诺亚 -专利权人： 阿尔特拉公司
申请日： 2011-03-22 - 公布日： 2013-01-16 - 主分类号： G06F17/16 文献下载
摘要：一种用于求解线性矩阵方程的电路，这些线性矩阵方程涉及结式矩阵、未知矩阵和乘积矩阵，该乘积矩阵是结式矩阵与未知矩阵的乘积，该电路包括：矩阵分解电路，用于三角化输入矩阵以创建结式矩阵，该结式矩阵在对角线上具有多个结式矩阵矩阵元并且具有在对角线上的结式矩阵矩阵元以下的列中布置的另外的多个结式矩阵矩阵元。矩阵分解电路包括计算结式矩阵的对角线矩阵元的平方根倒数乘法路径，该平方根倒数乘法路径具有平方根倒数模块，并且所述平方根倒数模块计算对角线矩阵元的倒数用于在取代与对角线矩阵元相除的乘法中使用。可以通过在多个矩阵的任何第(n+1)行之前对每个第n行运算来隐藏延时。
集成电路器件求解线性矩阵

[发明专利]用于高速通信链路的仿真工具-CN201180020060.4有效
发明人： P·李;M·斯玛瑙茨;T·M·灿;S·舒马拉耶夫 -专利权人： 阿尔特拉公司
申请日： 2011-04-19 - 公布日： 2013-01-09 - 主分类号： G06F9/455 文献下载
摘要：提供了一种用于仿真高速通信链路系统的链路仿真工具。通信链路可以包括链路子系统例如传输（TX）电路、接收（TX）电路、提供参考时钟信号到TX和RX电路的振荡器电路、以及将该TX和RX电路链接的信道。该链路仿真工具使用行为模型可以将该子系统的每个建模。该行为模型可以包括特征函数例如传递函数、概率密度函数和眼特征。该链路仿真工具可以具有链路分析引擎，该链路分析引擎能够执行二维（二变量）卷积运算，并在由行为模型提供的特征函数上应用双域（频率-时间）变换，以便仿真在该链路系统的性能。该链路仿真工具可以具有允许用户指定所希望的链路参数的输入屏幕和显示仿真结果的数据显示屏幕。
用于高速通信仿真工具

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