专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种eFuse改写方法、装置、计算机设备及存储介质-CN202310877461.6在审
  • 刘晓露 - 杭州万高科技股份有限公司
  • 2023-07-17 - 2023-10-13 - G11C17/16
  • 本发明实施例公开了一种eFuse改写方法、装置、计算机设备及存储介质。方法包括:获取数据修改请求;确定当前数据值;根据数据修改请求内的待写数据值确定待写入比特位置;判断待写入比特位置的数值是否是零;若否,当数据修改请求是针对多个比特数据的操作时,将待写入比特位置所在的字节地址加一,以更新待写入比特位置,当数据修改请求是针对单个比特数据的操作时,将待写入比特位置所在的比特地址加一,以更新待写入比特位置,并执行判断待写入比特位置的数值是否是零;若是,则将待写入比特位置的数值改写为一。通过实施本发明实施例的方法可实现eFuse的数据每个比特位能被多次修改,且修改数据的单个比特位时无需修改整个字节的数据,节省eFuse空间。
  • 一种efuse改写方法装置计算机设备存储介质
  • [发明专利]Efuse控制器、Efuse系统及Efuse烧写方法-CN201810814382.X有效
  • 蒋松鹰;姚炜 - 上海艾为电子技术股份有限公司
  • 2018-07-23 - 2023-09-29 - G11C17/16
  • 本发明公开了一种Efuse控制器、Efuse系统及Efuse烧写方法,该Efuse控制器,包括:数据整形模块,第一输入端用于接收时钟输入信号,第二输入端用于接收数据输入信号,数据整形模块的输出端输出根据时钟输入信号对数据输入信号整形,生成整形输出信号;计数器,输入端用于接收时钟输入信号,输出端用于输出对时钟输入信号的计数结果;逻辑与门电路,两个输入端中的一个用于接收时钟输入信号,另一个输入端用于接收整形输出信号;逻辑与门电路的输出端用于连接Efuse模块的STROBE信号输入端;译码电路,两个输入端中的一个用于接收计数结果,另一个输入端用于接收整形输出信号;译码电路的输出端用于连接Efuse模块的数据信号输入端。实施本发明能实现简单有效地进行Efuse烧录。
  • efuse控制器系统方法
  • [发明专利]一种芯片及其电子设备-CN202310438775.6在审
  • 汪秀红;张研;蔡景宜;吴建国 - 上海艾为电子技术股份有限公司
  • 2023-04-21 - 2023-09-22 - G11C17/16
  • 本申请涉及集成电路设计领域,涉及一种芯片及其电子设备,芯片包括熔丝修整电路,其特征在于,熔丝修整电路可以包括:反相延时单元、熔丝读取单元,熔丝烧录单元,以及锁存单元。芯片上电过程中,熔丝读取单元读取熔丝电阻的烧录状态,读取结果通过锁存单元锁存,芯片正常工作后,反相延时单元发出使能信号关闭熔丝读取单元,熔丝读取通路不会再有电流经过,不会产生功耗,能够减小整个集成电路的功耗。熔丝修整电路还包括共栅放大器,将参考电阻和熔丝电阻比较的结果进行放大,用于判断熔丝是否已熔断,可自己设定烧断阈值。
  • 一种芯片及其电子设备
  • [发明专利]熔丝烧录方法、装置及电子设备-CN202310776139.4在审
  • 范芳 - 长鑫存储技术有限公司
  • 2023-06-27 - 2023-09-15 - G11C17/16
  • 本申请实施例提供一种熔丝烧录方法、装置及电子设备,针对eFuse产品烧录的应用场景,该方法包括:基于烧录地址,对低位熔丝单元进行多次烧录,并多次读取烧录后的低位熔丝单元的熔丝状态,得到多个低位状态值;基于多个低位状态值确定低位烧录结果;若低位烧录结果指示烧录成功,则基于烧录地址,对高位熔丝单元进行多次烧录,并多次读取经过多次烧录后的高位熔丝单元的熔丝状态,得到多个高位状态值;基于多个高位状态值确定高位烧录结果;若高位烧录结果指示烧录成功,则烧录完成。通过多次烧录和多次读取,以及结合低位和高位的烧录结果进行烧录判断,显著提高了烧录的成功率和可靠性,提高了产品良率。
  • 熔丝烧录方法装置电子设备
  • [发明专利]熔丝装置及其操作方法-CN202210567670.6在审
  • 姜朝畬;陈智轩 - 南亚科技股份有限公司
  • 2022-05-24 - 2023-09-12 - G11C17/16
  • 本发明提供一种熔丝装置及其操作方法。熔丝装置包括多个熔丝电路、一个广域闩锁电路以及多个局域闩锁电路。广域闩锁电路耦接至这些熔丝电路。广域闩锁电路用以在不同时间感测这些熔丝电路的刻录态,以在所述不同时间输出这些熔丝电路的熔丝信息。这些局域闩锁电路耦接至广域闩锁电路。这些局域闩锁电路的每一个在所述不同时间闩锁广域闩锁电路所输出的熔丝信息。
  • 装置及其操作方法
  • [发明专利]具有冗余字线的半导体装置-CN202310217014.8在审
  • 荒井実成 - 美光科技公司
  • 2023-03-07 - 2023-09-12 - G11C17/16
  • 本申请涉及一种具有冗余字线的半导体装置。本文公开了一种设备,其包含被配置成存储第一地址的第一寄存器电路和被配置成将所述第一地址与第二地址进行比较的比较电路。所述比较电路包含第一和第二电路部分。在第一操作模式中,所述比较电路被配置成在所述第一电路部分检测到所述第一地址的第一位组与所述第二地址的第三位组匹配并且所述第二电路部分检测到所述第一地址的第二位组与所述第二地址的第四位组匹配时激活匹配信号。在第二操作模式中,所述比较电路被配置成在所述第一电路部分检测到所述第一位组与所述第三位组匹配而无论所述第二和第四位组如何时激活所述匹配信号。
  • 具有冗余半导体装置
  • [发明专利]存储器电路及其方法-CN202110247150.2有效
  • 刘智民 - 台湾积体电路制造股份有限公司
  • 2021-03-05 - 2023-09-12 - G11C17/16
  • 一种存储器电路,包括OTP单元、NVM单元以及耦合至OTP单元、NVM单元及放大器的第一输入端子的位线。放大器被配置为基于位线上的信号产生输出电压;ADC被配置为基于输出电压产生数字输出信号;比较器包括耦合至ADC的输出端口的第一输入端口,比较器被配置为响应于数字输出信号与在第二输入端口处接收的阈值电平的比较而输出数据位。本发明的实施例还涉及存储器电路上执行读取操作的方法以及配置存储器电路的方法。
  • 存储器电路及其方法
  • [发明专利]具有反熔丝组的半导体存储装置及其重复编程方法-CN202210798525.9在审
  • 请求不公布姓名 - 提米芯创(上海)科技有限公司
  • 2022-07-08 - 2023-09-08 - G11C17/16
  • 本申请提供了一种具有反熔丝组的半导体存储装置及其重复编程方法。所述装置包括:多个反熔丝组,每一所述反熔丝组包括多个冗余反熔丝单元,一目标冗余反熔丝单元响应于一反熔丝组选择信号被选中;多个驱动器组,每一所述驱动器组连接至一所述反熔丝组,且所述驱动器组中的每一驱动器连接一所述冗余反熔丝单元;以及一驱动器选择模块,响应于所述反熔丝组选择信号选择与所述目标冗余反熔丝单元连接的目标驱动器,以对所述目标冗余反熔丝单元进行编程;当对所述目标冗余反熔丝单元编程失败时,选择所述目标驱动器所对应的目标驱动器组中的下一驱动器,以对所述下一驱动器所对应的冗余反熔丝单元进行编程。以实现对所述装置进行多次编程。
  • 具有反熔丝组半导体存储装置及其重复编程方法
  • [发明专利]缩短击穿程序时间的存储设备及其方法-CN202211562781.4在审
  • 请求不公布姓名 - 提米芯创(上海)科技有限公司
  • 2022-12-07 - 2023-09-08 - G11C17/16
  • 本申请提供了一种缩短击穿程序时间的存储设备及缩短存储设备击穿程序时间的方法。所述存储设备包括:具有多个存储单元的存储单元阵列;还包括:地址寄存器、控制模块及地址计数器,所述地址寄存器用于存储所述存储单元的待编程位信息;当从所述地址寄存器读取的待编程位信息为第一值时,所述控制模块根据所述地址计数器的计数值对应的地址位信息对目标存储单元执行击穿程序,并控制所述地址计数器更新计数值;当从所述地址寄存器读取的待编程位信息为第二值时,所述控制模块直接控制所述地址计数器更新计数值。上述技术方案对于从地址寄存器读取的不同待编程位信息设置了不同的执行方式,减少不必要的程序时间消耗。
  • 缩短击穿程序时间存储设备及其方法
  • [发明专利]熔丝状态感测电路、装置和方法-CN201780064978.6有效
  • 颜燕;崔允荣;J·李 - 天工方案公司
  • 2017-08-28 - 2023-09-01 - G11C17/16
  • 熔丝状态感测电路、装置和方法。在一些实施例中,熔丝状态感测电路可包括使能块,其被配置成在基本上与施加电源电压的同时接收到使能信号时,使能由电源电压导致的熔丝电流到熔丝元件的流动。熔丝状态感测电路可进一步包括被适配成控制熔丝电流的量的电流控制块。熔丝状态感测电路可进一步包括判决块,其实施成基于熔丝电流来产生表示熔丝元件的状态的输出,所述输出在电源电压的施加的斜升部分期间产生。
  • 丝状态感测电路装置方法
  • [发明专利]熔丝单元电路及模数转换器-CN202310754107.4在审
  • 胡永菲;雷郎成;詹勇;金森磊;万俊珺;廉鹏飞 - 重庆吉芯科技有限公司
  • 2023-06-25 - 2023-08-29 - G11C17/16
  • 本发明提供一种熔丝单元电路及模数转换器,所述熔丝单元电路包括熔丝、熔断模块、熔丝状态读取模块及输入输出逻辑模块;在本发明中,基于“熔丝+熔断模块+熔丝状态读取模块+输入输出逻辑模块”设计熔丝单元电路,在输入输出逻辑模块内部,将数据信号的读写通路与熔丝状态信号的输出通路相分离,电路结构简单,对应控制逻辑简单;基于数据信号的读写可进行预修调,通过预修调找到最好的修调方案之后,再进行真实修调熔断,有利于减小熔丝单元电路的应用复杂度,提高了修调的灵活性和可靠性,降低了修调成本;修调完成后,可进行熔丝状态信号的输出,便于熔丝实际状态与理想状态的对比验证,进一步提高了修调的可靠性。
  • 单元电路转换器
  • [发明专利]一种低功耗低开销EFUSE电路-CN202310369175.9在审
  • 张跃军;李洋;张勇 - 宁波大学
  • 2023-04-10 - 2023-08-08 - G11C17/16
  • 本发明公开了一种低功耗低开销EFUSE电路,包括存储模块、地址译码模块、数据译码模块、控制模块、电源管理模块、升压模块和输出模块,EFUSE电路在进入工作状态后,具有四种工作模式:休眠模式、待机模式、写数据模式和读数据模式;在休眠状态下,EFUSE电路不与外界交互,静态功耗最小;在待机模式下,EFUSE电路的地址译码模块、存储模块、输出模块和数据译码模块的输出端均输出低电平,此时EFUSE电路处于读写功能切换之间;EFUSE电路结束先从待机模式进入写数据模式,写数据模式结束后,再次进入待机模式,最后再进入读数据模式,读数据模式结束后,EFUSE电路再次进入待机模式,然后进入进入休眠模式;优点是面积较小、漏电功耗较小。
  • 一种功耗开销efuse电路
  • [发明专利]反熔丝存储器-CN202210048500.7在审
  • 邱安平 - 长鑫存储技术有限公司
  • 2022-01-17 - 2023-07-25 - G11C17/16
  • 本申请提供一种反熔丝存储器,运算放大器的反向输入端与偏置电压生成模块的反馈端连接,根据反馈端电压可以获得第二输入端电压,第二输入端与运算放大器的输出端电连接,第二输入端电压作为读取电路的偏置电压;第二供电端与反馈端之间的电路等效监测端与第一供电端之间的电路,反馈端与可调电阻之间的电路等效监测端与反熔丝存储单元之间的电路,如此,偏置电压生成模块生成的偏置电压可有效为读取模块提供准确的偏置电压。读取模块接收偏置电压后,若反熔丝存储单元的击穿电阻值等于可调电阻值,监测端具有等于反转电压的临界电压;根据读取模块输出的电平信号的状态可判断监测端电压与反转电压的关系,进而判断反熔丝存储单元是否被有效击穿。
  • 反熔丝存储器

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