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[发明专利]锁相环系统-CN201310258136.8有效
发明人：谭飞鸿;唐伟;邓斌闻 -专利权人：广州思信电子科技有限公司;谭飞鸿
申请日： 2013-06-25 - 公布日： 2013-11-27 - 主分类号： H03L7/18 文献下载
摘要：一种锁相环系统，所述锁相环系统包括：至少两个锁相环电路，所述锁相环电路适于根据基准信号和译码参数产生待检测信号；检测选择单元，适于在检测到至少一个锁相环电路产生的待检测信号的频率为预定频率时选择任一具有所述预定频率的待检测信号作为输出信号本发明技术方案提供的锁相环系统包括多个锁相环电路，当产生的待检测信号作为锁相环系统的输出信号的锁相环电路工作异常时，可以立即从其他工作正常的锁相环电路输出的待检测信号中选择一个信号，作为锁相环系统的输出信号，提高了锁相环系统的可靠性。
锁相环系统

[发明专利]频率校正电路及其频率校正方法-CN201010177968.3无效
发明人：冯向光;陶晶晶;顾奇龙 -专利权人：无锡辐导微电子有限公司
申请日： 2010-05-14 - 公布日： 2010-09-15 - 主分类号： H03L1/02 文献下载
摘要：本发明涉及一种时钟频率校正电路，其包括第一锁相环和第二锁相环，其中每一锁相环包括相互串联的鉴相器、积分器电荷泵、压控振荡器。参考频率输入鉴相器的其中一个输入端，第一锁相环的压控振荡器的输出经过第一分频器反馈给第一锁相环的鉴相器的输入端。第一锁相环的输出经过第二分频器输入第二锁相环的鉴相器的输入端，第二锁相环的压控振荡器的输出经过第三分频器反馈给第二锁相环的鉴相器的输入端，第二锁相环的输出经过第四分频器输出。使用一个双环路锁相环电路，通过改变锁相环的分频器的模改变输出频率的精度。输出频率的长期频率精度以及短期频率精度具有相同的精度，稳定性高；并且输出频率为占空比为50％的脉冲。
频率校正电路及其方法

[实用新型]锁相环系统-CN201320370330.0有效
发明人：谭飞鸿;唐伟;邓斌闻 -专利权人：广州思信电子科技有限公司;谭飞鸿
申请日： 2013-06-25 - 公布日： 2013-12-11 - 主分类号： H03L7/18 文献下载
摘要：一种锁相环系统，所述锁相环系统包括：至少两个适于根据基准信号和译码参数产生待检测信号的锁相环电路；适于在检测到至少一个锁相环电路产生的待检测信号的频率为预定频率时选择任一具有所述预定频率的待检测信号作为输出信号的检测选择单元本实用新型技术方案提供的锁相环系统包括多个锁相环电路，当产生的待检测信号作为锁相环系统的输出信号的锁相环电路工作异常时，可以立即从其他工作正常的锁相环电路输出的待检测信号中选择一个信号，作为锁相环系统的输出信号，提高了锁相环系统的可靠性。
锁相环系统

[发明专利]一种内插混频器的DDS激励PLL的微波频率合成方法及合成器-CN201110088182.9无效
发明人：司朝良;刘清来;初广前 -专利权人：山东交通学院
申请日： 2011-04-09 - 公布日： 2011-07-06 - 主分类号： H03L7/18 文献下载
摘要：本发明的内插混频器的DDS激励PLL的微波频率合成方法，包括a.选用DDS、主锁相环和辅助锁相环；b.把DDS的输出作为主锁相环的参考信号；c.把主锁相环输出信号经N分频后输入混频器，把辅助锁相环输出信号输入混频器；d.把混频器输出信号输入鉴相器；e.设置控制单元。本发明的合成器，包括主锁相环和DDS，特征在于：包括辅助锁相环、混频器和控制单元；DDS输出接到主锁相环，主锁相环的输出经N分频后输入到混频器；辅助锁相环输入到混频器，混频器输出信号输入鉴相器。本发明保证了主锁相环输出的微波信号具有较宽的频率范围和很高的频率分辨率；且实现了输出信号的频率微调和粗调的有效结合，具有输出频带宽、分辨率高和调节方便的优点。
一种内插混频器 dds 激励 pll 微波频率合成方法合成器

[发明专利]一种多锁相环高速跳频本振电路-CN202011188155.4在审
发明人：肖姗姗;苗尧飞;于猛;吴迪;杨博;周扬;巩执欢;莫晓婷;王武志 -专利权人：天津光电通信技术有限公司
申请日： 2020-10-30 - 公布日： 2020-12-29 - 主分类号： H03L7/099 文献下载
摘要：本发明创造提供了一种多锁相环高速跳频本振电路，包括：锁相环单元，所述锁相环单元包括至少两个锁相环，用于读出数据，并分别输出相应的频率；晶振单元，所述晶振单元用于为所述锁相环单元提供时钟；高速开关阵列，所述高速开关阵列用于定时切换所述锁相环单元中的锁相环，并根据所述锁相环输出的频率输出相应的本振频率；电源单元，用于分别为所述锁相环单元、晶振单元和高速开关阵列提供电源；所述晶振单元与所述锁相环单元电连接，所述高速开关阵列与所述锁相环单元电连接，所述电源单元分别与所述锁相环单元可以利用多个锁相环切换来提高跳频速率。
一种多锁相环高速电路

[实用新型]一种多锁相环高速跳频本振电路-CN202022480628.X有效
发明人：肖姗姗;苗尧飞;于猛;吴迪;杨博;周扬;巩执欢;马彤鑫;莫晓婷 -专利权人：天津光电通信技术有限公司
申请日： 2020-10-30 - 公布日： 2021-04-30 - 主分类号： H03L7/099 文献下载
摘要：本实用新型提供了一种多锁相环高速跳频本振电路，包括：锁相环单元，所述锁相环单元包括至少两个锁相环，用于读出数据，并分别输出相应的频率；晶振单元，所述晶振单元用于为所述锁相环单元提供时钟；高速开关阵列，所述高速开关阵列用于定时切换所述锁相环单元中的锁相环，并根据所述锁相环输出的频率输出相应的本振频率；电源单元，用于分别为所述锁相环单元、晶振单元和高速开关阵列提供电源；所述晶振单元与所述锁相环单元电连接，所述高速开关阵列与所述锁相环单元电连接，所述电源单元分别与所述锁相环单元可以利用多个锁相环切换来提高跳频速率。
一种多锁相环高速电路

[发明专利]全数字锁相环系统及全数字锁相环的频率校准方法-CN202110094634.8在审
发明人：黄金煌 -专利权人：北京紫光青藤微系统有限公司
申请日： 2021-01-25 - 公布日： 2021-06-08 - 主分类号： H03L7/099 文献下载
摘要：本发明公开了一种全数字锁相环系统及全数字锁相环的频率校准方法，其中，全数字锁相环系统包括全数字锁相环，用于在校准阶段分别根据载波频率信号和晶体频率信号相应生成对应环路锁定时的第一控制码和第二控制码，以及在正常工作阶段根据晶体频率信号和第二频率放大倍数生成目标输出频率信号；校准单元，用于根据第一控制码和第二控制码对第一频率放大倍数进行校准，生成第二频率放大倍数。该全数字锁相环系统及全数字锁相环的频率校准方法能够跟踪晶体频率，输出符合系统要求的频率信号，降低了在载波受干扰或者无载波时全数字锁相环输出的频率精度下降的风险。
数字锁相环系统频率校准方法

[发明专利]一种锁相频率源-CN202310951142.5在审
发明人：刘福玉;许辉;刘家兵 -专利权人：合肥芯谷微电子股份有限公司
申请日： 2023-07-28 - 公布日： 2023-10-20 - 主分类号： H03L7/089 文献下载
摘要：本发明公开了一种锁相频率源。锁相频率源包括：倍频放大电路、锁相环电路、控制电路和电源电路。倍频放大电路的输入端连接锁相频率源的输入端，锁相频率源的输入端接入第一频率信号，倍频放大电路用于将第一频率信号转换为频率更高的第二频率信号输出；锁相环电路的输入端连接倍频放大电路的输出端，控制端接入频率控制信号，输出端连接锁相频率源的输出端；锁相环电路用于根据第二频率信号以及频率控制信号进行输出；控制电路的第一输出端连接锁相环电路的控制端，控制电路用于输出频率控制信号；电源电路分别连接倍频放大电路的电源端、锁相环电路的电源端和控制电路的电源端本发明实施例可以降低锁相频率源的相噪和鉴相杂散。
一种频率

[发明专利]高鉴相频率捷变频锁相环电路-CN201610965163.2在审
发明人：韩周安;王少奇;张颖 -专利权人：成都爱科特科技发展有限公司
申请日： 2016-11-04 - 公布日： 2017-03-15 - 主分类号： H03L7/085 文献下载
摘要：本发明公开了一种高鉴相频率捷变频锁相环电路，它包括参考电路、DDS小步进电路、锁相环参考源电路和锁相环及输出电路，参考电路产生两路信号，一路供DDS小步进电路输出小步进输出信号，另一路提供锁相环参考源电路的混频信号，锁相环参考源电路将小步进输出信号与混频信号混频后输出锁相环及输出电路的参考信号，锁相环及输出电路对参考信号进行滤波放大后输出最终频率信号。通过DDS小步进改变锁相环参考频率来实现频率捷变的方式，相对传统直接模拟频率合成方式大大简化了方案，克服传统捷变频电路方案复杂，体积大，成本高的缺点，在产品可靠性和稳定性方面有很大的提高。
高鉴相频率变频锁相环电路

[发明专利]锁相环锁定时间的测量方法-CN201510095605.8有效
发明人：余琨;牛勇;张大成;邓维维;郝丹丹;季海英 -专利权人：上海华岭集成电路技术股份有限公司
申请日： 2015-03-04 - 公布日： 2017-10-31 - 主分类号： H03L7/18 文献下载
摘要：本发明提供了一种锁相环锁定时间的测量方法，包括以下步骤将锁相环分别在第一频率和第二频率上锁定，ATE测试设备测量所述锁相环在所述第一频率上的第一输出电压，以及在所述第二频率上的第二输出电压；使得所述锁相环从所述第一频率跳变到所述第二频率，所述ATE测试设备采集并处理所述锁相环在跳变过程中的输出电压；根据所述ATE测试设备对所述输出电压的处理结果计算出所述锁相环的锁定时间。无需外挂分立仪器，直接利用ATE测试设备获取所述锁相环从所述第一频率跳变到所述第二频率过程中的输出电压，以及对所述输出电压的处理结果直接计算出所述锁相环的锁定时间，大大提高了测试效率。
锁相环锁定时间测量方法

[实用新型]频率合成器-CN201120375531.0有效
发明人：杨光;宋烨曦;孙敏 -专利权人：四川九洲电器集团有限责任公司
申请日： 2011-09-28 - 公布日： 2012-07-11 - 主分类号： H03L7/099 文献下载
摘要：本实用新型涉及数字锁相频率合成技术领域，尤其是涉及一种基于双环的X波段低相位噪声频率合成器。本实用新型所要解决的技术问题针对现有技术中的问题，提供一种频率合成器，通过两个相关主锁相环和副锁相环，其中副锁相环路的输出与主锁相环路反馈输出混频器混频，得到一个频率较低的信号反馈到主锁相环路，降低了主锁相环芯片的反馈分频比一种频率合成器，包括晶体振荡器、副锁相环路、主锁相环路，晶体振荡器输出端分别与副锁相环路、主锁相环路连接，副锁相环路输出端与主锁相环路反馈端经过处理后，送入主锁相环路射频输入端，自动调节主锁相环路输出端信号本实用新型主要应用于数字锁相频率合成技术领域。
频率合成器

[实用新型]高纯度频率源-CN201420650422.9有效
发明人：姚宗诚;王清文 -专利权人：成都赛英科技有限公司
申请日： 2014-11-03 - 公布日： 2015-03-04 - 主分类号： H03L7/099 文献下载
摘要：本实用新型公开了一种高纯度频率源，属于无线通信技术领域；它包括参考频率源、单片机、锁相环模块、隔离放大电路，所述锁相环模块包括第一PLL锁相环模块、第二PLL锁相环模块，第一PLL锁相环模块和第二PLL锁相环模块的组成和参数完全相同，第一PLL锁相环模块和第二PLL锁相环模块都由同一单片机控制，第一PLL锁相环模块的输入端和第二PLL锁相环模块的输入端共同连接所述参考频率源的输出端，第一PLL锁相环模块的输出端和第二PLL锁相环模块的输出端共同连接切换开关后最终输出；它能同时实现高杂散抑制度和高速频率切换以及低功耗小体积的要求，为雷达和通信系统提供高质量的信号源，从而提升雷达和通信系统的整体性能。
纯度频率

[发明专利]双锁相环电路及其控制方法-CN200910157826.8有效
发明人：刘永旺;卢文才;史德立 -专利权人：晨星软件研发(深圳)有限公司;晨星半导体股份有限公司
申请日： 2009-07-07 - 公布日： 2011-01-12 - 主分类号： H03L7/08 文献下载
摘要：本发明公开了一种双锁相环电路及其控制方法。所述双锁相环电路包括一相位/频率检测器，一电荷泵，一频率调节电路和一N分频器。所述频率调节电路包括一粗调节电路，用于粗调节锁相环输出信号频率接近于一目标频率；一细调节电路，用于细调节锁相环输出信号频率至此目标频率；及一电流控制振荡器，耦接于此粗调节电路和此细调节电路，用于产生频率为所述目标频率的锁相环输出信号所述双锁相环电路可有效达到在保持锁相环环路带宽较小的情况下扩大频率调节范围的目的，并且可实现片内集成，从而降低了成本和电路设计复杂度。
双锁相环电路及其控制方法

[发明专利]一种光电振荡器的宽带频率扩展装置-CN201711435135.0有效
发明人：阎栋梁;李宏宇 -专利权人：北京无线电计量测试研究所
申请日： 2017-12-26 - 公布日： 2022-03-04 - 主分类号： H03L7/099 文献下载
摘要：本发明公开一种光电振荡器的宽带频率扩展装置，包括：窄带光电振荡器、分频器、第一锁相环、第二锁相环，其中，窄带光电振荡器分别与分频器、第一锁相环的输入端连接；第二锁相环的输入端分别与第一锁相环、分频器的输出端连接；窄带光电振荡器输出的信号分别通过第一锁相环、第二锁相环变频后输出。本发明解决了传统频率合成的参考源相位噪声无法满足量传要求；通过多环频率扩展技术，解决了光电振荡器的输出频率窄，无法满足宽带的校准需求。
一种光电振荡器宽带频率扩展装置

[发明专利]锁相环系统与锁相环的锁相方法-CN200810088647.9无效
发明人：林伟俊 -专利权人：联咏科技股份有限公司
申请日： 2008-04-10 - 公布日： 2009-10-14 - 主分类号： H03L7/06 文献下载
摘要：一种锁相环系统，包括一锁相环与一锁定检测器。锁相环用来输出一锁相时钟。锁定检测器耦接至该锁相环，用来检测该锁相时钟的频率是否落入一预定频率范围、并且检测该锁相时钟是否稳定。若检测到该锁相时钟的频率已经落入该预定频率范围且该锁相时钟已稳定，则锁定检测器输出一锁定信号。
锁相环系统方法

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