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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]高像素高帧率的CMOS图像传感器及图像采集方法-CN201410489838.1有效
发明人：刘云涛;邵雷;高松松 -专利权人：哈尔滨工程大学
申请日： 2014-09-23 - 公布日： 2017-11-21 - 主分类号： H04N5/374 文献下载
摘要：本发明涉及一种高像素高帧率的CMOS图像传感器及图像采集方法，包括依次连接的像素阵列部(101)、增量ΣΔADC阵列部(102)、数字相关双采样部(103)和缓冲存储器部(104)，还包括行译码单元部(105)，行译码单元部(105)的信号输出端接像素阵列部(101)的控制端，还包括列读出控制电路(106)，列读出控制电路(106)的信号输出端接缓冲存储器部的控制端，增量ΣΔADC阵列部(102)接有电压缓冲器(107)和时钟延迟与驱动电路(108)。
像素高帧率 cmos 图像传感器图像采集方法

[发明专利]视频编码装置与方法-CN201810326608.1有效
发明人：周凡迪 -专利权人：联咏科技股份有限公司
申请日： 2018-04-12 - 公布日： 2021-07-27 - 主分类号： H04N19/146 文献下载
摘要：依据播放延迟控制条件与帧间(inter‑frame)相关性条件中的至少一者，控制电路将视频串流中的目前帧动态地设为长期参考帧、短期参考帧与非参考帧其中至少一者。其中，长期参考帧与短期参考帧被用来作为在视频译码操作中的译码参考帧。
视频编码装置方法

[发明专利]一种基于延迟锁相环的时间数字转换器-CN201811126007.2有效
发明人：丁瑞雪;郝康;马瑞;孙德鹏;张玮;朱樟明;杨银堂 -专利权人：西安电子科技大学
申请日： 2018-09-26 - 公布日： 2020-06-19 - 主分类号： G04F10/00 文献下载
摘要：本发明涉及一种基于延迟锁相环的时间数字转换器，包括：延迟锁相环，用于接收参考时钟信号，将参考时钟信号进行延迟生成等间隔同频时钟簇信号，输出参考时钟信号和等间隔同频时钟簇信号；整数时间检测阵列，连接所述延迟锁相环，用于接收参考时钟信号，对参考时钟信号进行计数，输出整数时间数据；分数时间检测阵列，连接所述延迟锁相环，用于接收等间隔同频时钟簇信号、start信号和stop信号，以等间隔同频时钟簇信号为基准对start本发明实施例的时间数字转换器提高了测量的准确性和稳定性，提高了TDC的抗干扰能力，简化了译码电路的复杂程度，减小了TDC的功耗面积。
一种基于延迟锁相环时间数字转换器

[发明专利]一种数据传输方法及发射机-CN200610127278.0无效
发明人：郑德来;吴和兵 -专利权人：华为技术有限公司
申请日： 2006-09-19 - 公布日： 2008-03-26 - 主分类号： H04L1/18 文献下载
摘要：本发明提出发送端在每一次重传数据包时，先调整至少两根发射天线之间的相对传输延迟，改变频域选择性衰落的分布，然后根据调整后的相对传输延迟重传所述数据包，使重传后进行译码的软比特信息具有相同的能量和可靠性的分布其中，调整至少两根发射天线之间的相对传输延迟的方法可以包括调整至少一根发射天线的传输延迟时间；或者交换至少两根发射天线的传输延迟时间。
一种数据传输方法发射机

[发明专利]一种处理器以及指令执行方法-CN201910111338.7在审
发明人：刘畅;刘东启 -专利权人：阿里巴巴集团控股有限公司
申请日： 2019-02-12 - 公布日： 2020-08-18 - 主分类号： G06F9/30 文献下载
摘要：处理器包括：公共资源，在可信执行环境和非可信执行环境下均可被访问；指令处理设备，适于取指令进行译码并执行译码后的指令。该指令处理设备还包括延迟切换单元，适于：在指令译码结果指示指令涉及对公共资源的访问时，判断处理器的当前执行环境与资源状态的一致性，以及判断当前执行环境和资源状态不一致，则将与当前执行环境相对应的内容加载到公共资源中
一种处理器以及指令执行方法

[发明专利]时钟信号的占空比调整电路、芯片以及占空比调整方法-CN202111199605.4在审
发明人：贾雪绒 -专利权人：西安紫光国芯半导体有限公司
申请日： 2021-10-14 - 公布日： 2022-02-15 - 主分类号： G11C11/4076 文献下载
摘要：本发明提供一种时钟信号的占空比调整电路、芯片以及占空比调整方法，电路包括译码模块以及占空比调整模块，译码模块接收配置信号，基于配置信号生成控制信号；占空比调整模块连接译码模块，接收时钟信号，占空比调整模块基于控制信号对接收的时钟信号的上升沿或者下降沿延迟至少一个步进值
时钟信号调整电路芯片以及方法

[发明专利]一种矩阵显式转置消除静态随机存储器及方法-CN202311033097.1在审
发明人：沈立;张敦博;贾朝阳;陈湜;焦晨阳;王瑞丰;刘京雨;王若曦;高振宇 -专利权人：中国人民解放军国防科技大学
申请日： 2023-08-16 - 公布日： 2023-10-24 - 主分类号： G11C11/413 文献下载
摘要：本发明公开了一种矩阵显式转置消除静态随机存储器及方法，该存储器包括：交错矩阵存储单元、译码单元和平移单元；交错矩阵存储单元，与译码单元和平移单元连接，用于存储交错矩阵数据；译码单元，用于对外部输入的定制访存指令进行处理平移量和交错矩阵存储单元的交错访问地址组；平移单元，用于对外部输入的原始矩阵矢量或交错矩阵存储单元输出的交错矩阵矢量进行循环移位操作，得到移位输出矢量；可见，本发明可避免显式矩阵转置操作，有效降低平均内存访问延迟
一种矩阵显式转置消除静态随机存储器方法

[发明专利]译码器、编码器、译码方法、编码方法和存储介质-CN201810340463.0有效
发明人：托马斯·席尔;瓦莱里·乔治;阿纳斯塔西娅·亨克尔;德特勒夫·马佩;卡斯滕·格吕内贝格;罗伯特·斯库平 -专利权人： GE视频压缩有限责任公司
申请日： 2013-04-15 - 公布日： 2021-03-05 - 主分类号： H04N19/70 文献下载
摘要：本发明涉及译码器、编码器、译码方法、编码方法和存储介质。诸如波前并行处理的并行处理概念是通过放弃普通片概念而实现具有减少的端至端延迟，据此，完全独立于在该相应的片的图像外部的区域或者有关的至少独立于在该相应的片外部的远至熵写码的区域而写码/译码片，例如，即有利于不同模式的片
译码器编码器译码方法编码存储介质

[发明专利]一种基四算法下的加比选计算方法和装置-CN201510571691.5有效
发明人：赵旭莹;王晓琴;吴军宁;田燕 -专利权人：北京思朗科技有限责任公司
申请日： 2015-09-09 - 公布日： 2018-11-27 - 主分类号： H03M13/23 文献下载
摘要：本发明能够降低译码单元的关键路径延迟，提高译码速率，进而提升整个系统的译码性能。
一种算法计算方法装置

[发明专利]地址译码方法及使用该方法的半导体存储器件-CN201210075524.8有效
发明人：秋新镐 -专利权人：海力士半导体有限公司
申请日： 2012-03-21 - 公布日： 2013-05-08 - 主分类号： G11C8/04 文献下载
摘要：本发明提供了地址译码方法及使用该方法的半导体存储器件。所述半导体存储器件，包括：选通时钟发生器，所述选通时钟发生器被配置为响应于读取信号或写入信号而产生选通时钟信号，所述选通时钟信号具有根据被选择性使能的多个测试模式信号而受控的延迟时间；内部地址发生器，所述内部地址发生器被配置为响应于所述选通时钟信号的第一电平来锁存地址，并通过响应于所述选通时钟信号的第二电平将所述地址译码米产生内部地址；以及输出使能信号发生器，所述输出使能信号发生器被配置为将所述内部地址译码并产生被选择性使能的输出使能信号。
地址译码方法使用半导体存储器件

[实用新型]一种两步式高分辨率时间-数字转换器电路-CN202022283132.3有效
发明人：尹勇生;庞高远;郭围围;谢熙明 -专利权人：合肥工业大学
申请日： 2020-10-14 - 公布日： 2021-04-13 - 主分类号： H03M1/50 文献下载
摘要：本实用新型公开了一种两步式高分辨率时间‑数字转换器电路，包括环形TDC电路、细量化电路、电压生成电路；该环形TDC电路由四个延迟单元D1‑D4、四个D触发器、计数器和译码器组成；该细量化电路是由四选一数据选择器MUX，六十四个拥有不同数量负载电容的压控延迟单元VD1‑VD64、延迟器DLY以及仲裁器阵列组成；该电压生成电路由方波发生器，第五延迟单元D5，拥有一个负载电容的压控延迟单元VD65，拥有六十四个负载电容的压控延迟单元
一种两步式高分辨率时间数字转换器电路

[发明专利]一种全数字快速仿真方法-CN201410003561.7有效
发明人：任永青;魏明;王金龙 -专利权人：北京神舟航天软件技术有限公司
申请日： 2014-01-03 - 公布日： 2017-03-22 - 主分类号： G06F9/455 文献下载
摘要：本发明公布了一种全数字快速仿真技术，其特征在于包括以下技术部分1）、倒序流水线技术；2）、寄存器备份技术；3）、存储系统写时分配技术；4）、功能部件寄存器缓存延迟技术；5）、指令译码缓冲技术；6）、高速缓存数据仿真与延迟模拟分离技术
一种数字快速仿真方法

[发明专利]码分多址接收方法及码分多址接收机-CN99111696.8无效
发明人：三浦彻也 -专利权人：日本电气株式会社
申请日： 1999-08-24 - 公布日： 2000-04-05 - 主分类号： H04Q7/20 文献下载
摘要：在CDMA接收方法中,根据对接收信号去扩展时所得到的相关分布图,预置多个不同的接收延迟量。根据至少每个预置的接收延迟量,获得多个相关值。根据所得到的相关值,测量多个干扰波电平。对被允许的检测信号进行合成,对已合成的信号进行译码。同时披露了一种CDMA接收机。
码分多址接收方法接收机

[发明专利]一种时钟相位选择电路-CN202110283402.7有效
发明人：黄金煌 -专利权人：北京紫光青藤微系统有限公司
申请日： 2021-03-17 - 公布日： 2021-07-13 - 主分类号： H03L7/06 文献下载
摘要：本发明提供了一种时钟相位选择电路，包括M个数据采集模块、译码器和时钟选择模块。M个数据采集模块分别采集在通讯场时钟的上升沿时刻M路相位依次延迟的候选时钟的瞬时值并传递至译码器。译码器在第i个输入端的数据为0且第i‑1个输入端的数据为1时，将第i‑1个输出端的数据置为1，且将其它各个输出端的数据均置为0。时钟选择模块将与译码器的M个输出端中数据置为1的输出端对应的1路候选时钟作为输出时钟输出。
一种时钟相位选择电路

[发明专利]一种面向极化码快速串行抵消列表译码的高效码本选择方法-CN202210469866.1有效
发明人：赵延龙;尹振东;吴芝路;张睿;刘庆之 -专利权人：哈尔滨工业大学
申请日： 2022-04-30 - 公布日： 2023-02-03 - 主分类号： H03M13/13 文献下载
摘要：一种面向极化码快速串行抵消列表译码的高效码本选择方法，涉及极化码译码技术领域，用以解决现有极化码快速串行抵消列表译码方法运算冗余、译码延迟高的问题。
一种面向极化快速串行抵消列表译码高效选择方法

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