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[发明专利]用于存取通信模块的信息存储器的数据的方法和装置-CN200580026342.X有效
发明人： F·哈特维希;C·霍尔斯特;F·拜勒 -专利权人：罗伯特·博世有限公司
申请日： 2005-06-29 - 公布日： 2007-07-04 - 主分类号： H04L12/56 文献下载
摘要：通过数据输入信息存储器(300)或从信息存储器输出数据存取一个通信模块(100)的信息存储器(300)的数据的方法，其中信息存储器与缓冲存储器布置(201和202)连接，数据沿第一传输方向传输给信息存储器并且沿第二传输方向从信息存储器传出数据，其中缓冲存储器布置沿第一传输方向具有一个输入缓冲存储器(201)并且沿第二传输方向具有一个输出缓冲存储器(202)，输入缓冲存储器和输出缓冲存储器分别被划分为子缓冲存储器(400、701)和针对子缓冲存储器的影子存储器(401、700)，其中在每个传输方向上实施如下步骤：数据输入各自的子缓冲存储器；交换子缓冲存储器和影子存储器的存取；如此后续的数据可以写入影子存储器，同时输入的数据在设置的传输方向上已经从子缓冲存储器输出
用于存取通信模块信息存储器数据方法装置

[发明专利]存储器系统、存储器控制器及其操作方法-CN201810714290.4有效
发明人：金镇佑;文贵妍;李澈 -专利权人：三星电子株式会社
申请日： 2018-07-03 - 公布日： 2023-05-09 - 主分类号： G06F3/06 文献下载
摘要：一种存储器系统包括：非易失性存储器；存储器控制器，被配置为控制所述非易失性存储器，所述存储器控制器包括：第一缓冲存储器，用于临时存储要写入所述非易失性存储器的写入数据；和第二缓冲存储器，具有比所述第一缓冲存储器低的操作速度但高的存储容量所述存储器控制器被配置为将所述写入数据从所述第一缓冲存储器传输到第二缓冲存储器和传输到所述非易失性存储器，并且在将所述写入数据从所述第一缓冲存储器传输到所述第二缓冲存储器和传输到所述非易失性存储器之后释放所述第一缓冲存储器的操作状态在释放所述第一缓冲存储器的操作状态之前禁止向所述第一缓冲存储器写入额外的写入数据，并且在释放所述第一缓冲存储器的操作状态之后允许向所述第一缓冲存储器写入额外的写入数据。
存储器系统控制器及其操作方法

[发明专利]存储器存储装置和电子系统-CN202210369377.9在审
发明人：郑荷娜 -专利权人：三星电子株式会社
申请日： 2022-04-08 - 公布日： 2022-11-01 - 主分类号： G06F13/16 文献下载
摘要：一种存储器存储装置包括：存储器控制器，被配置为从外部装置接收数据；以及非易失性存储器，连接到存储器控制器，其中，存储器控制器包括：第一缓冲存储器，被配置为存储数据；第二缓冲存储器，不同于第一缓冲存储器；以及存储器接口，被配置为向非易失性存储器提供从第一缓冲存储器提供的数据，其中，非易失性存储器被配置为：存储数据，并且在存储数据之后向存储器接口提供写入完成信号，其中，存储器控制器还被配置为：响应于写入完成信号，将存储在第一缓冲存储器中的数据复制到第二缓冲存储器，并且在将存储在第一缓冲存储器中的数据复制到第二缓冲存储器之后移除存储在第一缓冲存储器中的数据。
存储器存储装置电子系统

[发明专利]一种在缓冲存储器中缓存数据的方法-CN201310300872.5有效
发明人：毛力 -专利权人：四川九成信息技术有限公司
申请日： 2013-07-18 - 公布日： 2013-10-09 - 主分类号： G06F3/06 文献下载
摘要：一种在缓冲存储器中缓存数据的方法，所述方法包括以下步骤：接收待缓存数据；比较缓冲存储器中的空闲存储空间的总量与待缓存数据的数据量；如果缓冲存储器中的空闲存储空间的总量小于待缓存数据的数据量，清除缓冲存储器中低权重的缓存数据并释放缓冲存储器中低权重的缓存数据所占用的存储空间；如果缓冲存储器中的空闲存储空间的总量还小于待缓存数据的数据量，则将缓冲存储器中高权重的缓存数据转存至主存中并释放缓冲存储器中高权重的缓存数据所占用的存储空间；向缓冲存储器的空闲存储空间写入待缓存数据。通过本发明的方法提高了缓冲存储器的整体性能。
一种缓冲存储器缓存数据方法

[发明专利]采用双份误差行存储器产生图像网点的方法和装置-CN200610114331.3无效
发明人：陈峰;朱伟;刘志红 -专利权人：北京大学;北京北大方正电子有限公司;北大方正集团有限公司
申请日： 2006-11-07 - 公布日： 2007-05-16 - 主分类号： H04N1/405 文献下载
摘要：本发明涉及一种能够同时读写数据的采用双份误差行存储器产生图像网点的装置及方法。该装置包括缓冲存储器A、缓冲存储器B和存储控制器，其特征在于，所述存储控制器包括缓冲存储器A读写控制电路、缓冲存储器B读写控制电路以及缓冲存储器选择电路；所述缓冲存储器选择电路用于生成对缓冲存储器A和缓冲存储器B的读或写操作的选择信号；所述缓冲存储器A读写控制电路连接至所述缓冲存储器A，用于根据所述读写选择信号对缓冲存储器A进行读和写操作，所述缓冲存储器B读写控制电路连接至所述缓冲存储器B，用于根据所述读写选择信号对缓冲存储器本发明的装置及方法能同时读写存储器中的数据，可以应用于执行误差扩散，使得误差扩散快速执行。
采用双份误差存储器产生图像网点方法装置

[发明专利]数据储存装置与数据处理方法-CN202010547894.1有效
发明人：邱慎廷 -专利权人：慧荣科技股份有限公司
申请日： 2020-06-16 - 公布日： 2023-08-22 - 主分类号： G06F11/10 文献下载
摘要：本发明涉及一种存储器控制器，其耦接一存储器装置与一主机装置，用以控制存储器装置的存取操作，包括一缓冲存储器、一主机接口、一微处理器以及一数据保护引擎。主机接口耦接主机装置，用以将自主机装置接收的数据写入缓冲存储器，并且于数据被写入缓冲存储器后，发出一缓冲存储器写入完成通知。微处理器响应于缓冲存储器写入完成通知触发一数据保护操作。数据保护引擎用以根据储存于缓冲存储器的数据执行数据保护操作以产生对应的保护资讯。微处理器于确认数据被写入缓冲存储器后直接触发数据保护操作。
数据储存装置数据处理方法

[发明专利]集成电路存储器装置及其操作方法-CN201811190300.5在审
发明人：延应准;金范俊 -专利权人：三星电子株式会社
申请日： 2018-10-12 - 公布日： 2019-07-30 - 主分类号： G06F11/07 文献下载
摘要：一种集成电路装置包括非易失性存储器、第一缓冲存储器和第二缓冲存储器以及控制器。第一缓冲存储器和第二缓冲存储器中的每一个被构造为响应于写请求缓冲将被写入非易失性存储器的写数据，并且还响应于读请求缓冲从非易失性存储器接收到的读数据。提供了控制器，其基于与数据准确性有关的至少一个标准评价第一缓冲存储器。所述控制器被构造为：当评价揭示超过标准时，响应于写请求将写数据中的至少一些从第一缓冲存储器重定向至第二缓冲存储器，并且当评价揭示超过标准时，响应于读请求将读数据中的至少一些从第一缓冲存储器重定向至第二缓冲存储器
缓冲存储器控制器非易失性存储器响应标准时读请求读数据写请求写数据重定向缓冲写入非易失性存储器集成电路存储器集成电路装置数据准确性标准评价

[发明专利]USB主机控制器以及用于USB主机控制器的控制方法-CN201010126672.9有效
发明人：近藤邦裕 -专利权人：恩益禧电子股份有限公司
申请日： 2010-02-24 - 公布日： 2010-08-25 - 主分类号： G06F3/06 文献下载
摘要：本发明旨在提供一种能够为存储装置之间的数据传输减少时间的USB主机控制器和用于USB主机控制器的控制方法。根据本发明的USB主机控制器包括：用于USB管道的缓冲存储器，该缓冲存储器具有第一缓冲存储器区域和第二缓冲存储器区域；和缓冲存储器控制器，该缓冲存储器控制器被构造为控制用于USB管道的缓冲存储器与第一和第二装置中的每一个之间的数据传输缓冲存储器控制器将来自于第一装置的数据存储在第一缓冲存储器区域中，对与第一缓冲存储器区域相对应的地址信息和与第二缓冲存储器区域相对应的地址信息进行交换，并且基于在交换之后与第一缓冲存储器区域相对应的地址信息，将被存储在第一缓冲存储器区域中的数据传输到第二装置。
usb 主机控制器以及用于控制方法

[发明专利]电子纸显示装置及其操作方法-CN202110286459.2在审
发明人：程孝龙;刘书呈;田沛霖;褚承鑫;洪集茂 -专利权人：元太科技工业股份有限公司
申请日： 2021-03-17 - 公布日： 2022-09-27 - 主分类号： G09G3/34 文献下载
摘要：电子纸显示装置包括电子纸显示面板及时序控制器。时序控制器包括第一图像缓冲存储器、第二图像缓冲存储器及更新缓冲存储器，并接收触控轨迹数据。第一图像缓冲存储器及第二图像缓冲存储器为往复交换缓冲存储器架构，并交错时序地接收视频串流。当第一图像缓冲存储器接收视频串流，以将当前显示画面数据更新至更新缓冲存储器当中时，第二图像缓冲存储器接收触控轨迹数据，并同步更新更新缓冲存储器所存储的当前显示画面数据。时序控制器依据当前显示画面数据驱动电子纸显示面板。本发明的电子纸显示装置及其操作方法，可提供具有良好使用者体验的手写功能。
电子显示装置及其操作方法

[发明专利]高速缓冲存储器-CN200680011397.8无效
发明人：山本崇夫;田中哲也;中西龙太;中岛雅逸;金子圭介;冈林叶月 -专利权人：松下电器产业株式会社
申请日： 2006-03-17 - 公布日： 2008-04-02 - 主分类号： G06F12/08 文献下载
摘要：本发明的高速缓冲存储器包括：第1高速缓冲存储器；并行工作的第2高速缓冲存储器；判定单元，在第1高速缓冲存储器及第2高速缓冲存储器二者未命中的情况下判定有关属性的真假，该属性是未命中的存储器访问对象数据的属性；以及控制单元，在被判定是真的情况下将存储器数据存储到第2高速缓冲存储器，在被判定是假的情况下将存储器数据存储到第1高速缓冲存储器。
高速缓冲存储器

[发明专利]图像处理装置及图像处理方法-CN02804887.3无效
发明人：山口裕司 -专利权人：索尼公司
申请日： 2002-12-11 - 公布日： 2004-04-21 - 主分类号： G06T1/20 文献下载
摘要：全局模块(12)包括全局高速缓冲存储器(121)。根据来自局部模块的局部高速缓冲存储器填充请求，全局高速缓冲存储器相应于请求将在全局高速缓冲存储器中的数据输出到发送该请求的局部模块。多个局部模块13－0至13－3有存储器模块、局部高速缓冲存储器、和用于根据运行参数和局部高速缓冲存储器的处理数据执行处理的处理单元。当处理所要求的处理数据不在局部高速缓冲存储器时，输出用于请求所需数据的局部高速缓冲存储器填充请求，并用响应所述请求而发送的数据更新局部高速缓冲存储器。
图像处理装置方法

[发明专利]加速服务器与客户端集合之间的数据文件的分配-CN201080052509.0无效
发明人： A·哈里;D·斯蒂尔亚迪斯;A·弗兰希尼;C·塞克哈尔 -专利权人：阿尔卡特朗讯
申请日： 2010-11-19 - 公布日： 2012-10-24 - 主分类号： H04L29/08 文献下载
摘要：加速服务器与客户端集合之间的数据文件的分配。本发明涉及客户端-服务器系统，并且更具体而言涉及客户端-服务器系统中的高速缓冲存储器节点。在客户端-服务器配置中，源系统将数据文件从源系统传输到连接到该源系统的服务器高速缓冲存储器节点。服务器高速缓冲存储器节点向客户端高速缓冲存储器节点发送高速缓冲存储在该服务器高速缓冲存储器节点中的数据文件的列表。该客户端高速缓冲存储器节点基于从该服务器高速缓冲存储器节点接收到的该列表，向该服务器高速缓冲存储器节点发送对于高速缓冲存储在该服务器高速缓冲存储器节点中的新数据文件的请求。该服务器高速缓冲存储器节点向该客户端高速缓冲存储器节点发送所请求的数据文件，并且该客户端高速缓冲存储器节点向目的地系统传输该数据文件。
加速服务器客户端集合之间数据文件分配

[发明专利]用于有效使用高速缓存及存储器的指令辅助高速缓存管理-CN200610064058.8有效
发明人： S·拉克什马纳穆尔蒂;M·罗森布卢思 -专利权人：英特尔公司
申请日： 2006-09-29 - 公布日： 2007-07-04 - 主分类号： G06F12/08 文献下载
摘要：用于有效利用高速缓冲存储器和存储器的指令辅助高速缓冲存储器管理。提示(例如修改符)被添加到读和写存储器存取指令来标识该存储器存取是针对临时数据的。通过这样的提示，执行交替的高速缓冲存储器策略和分配策略来最小化高速缓冲存储器和存储器存取。在一个策略下，写高速缓存未命中会导致将数据写到高速缓冲存储器线的局部中，而没有存储器读/写周期来填充该线的剩余部分。在另一个策略下，读高速缓存未命中会导致从存储器读，而没有分配或写读取的数据到高速缓冲存储器线。还公开了高速缓冲存储器线软锁机制，其中高速缓冲存储器线可以被选择性地软锁定来指示保持那些高速缓冲存储器线比非锁定高速缓冲存储器线优先。
用于有效使用高速缓存存储器指令辅助管理

[发明专利]用于压缩算法的高速缓冲存储体扩展-CN201580048563.0有效
发明人： G·帕奇拉腊斯;A·E·特纳;B·雷赫利克 -专利权人：高通股份有限公司
申请日： 2015-07-23 - 公布日： 2020-06-23 - 主分类号： G06F12/0846 文献下载
摘要：方面包括用于使用高速缓冲存储体扩展来实现针对压缩数据的高速缓冲存储器访问请求的计算设备、系统和方法。在一个方面中，高速缓冲存储体扩展可以包括：确定该高速缓冲存储器访问的压缩数据是否适合于单个高速缓冲存储体。响应于确定该压缩数据适合于单个高速缓冲存储体，可以计算高速缓冲存储体扩展值来替换/恢复在数据压缩期间可能被清除的用于该高速缓冲存储器访问请求的高速缓冲存储器的物理地址的存储体选择位。高速缓冲存储器的物理空间中的高速缓冲存储体扩展地址可以包括高速缓冲存储器访问请求的物理地址加上所恢复的存储体选择位。可以使用该高速缓冲存储体扩展地址来从高速缓冲存储器设备读取压缩数据，或者向高速缓冲存储器设备写入压缩数据。
用于压缩算法高速缓冲存储扩展

[发明专利]高效存储器层级管理-CN201210297361.8有效
发明人：迈克尔·威廉·莫罗;托马斯·安德鲁·萨托里乌斯 -专利权人：高通股份有限公司
申请日： 2007-01-22 - 公布日： 2013-01-09 - 主分类号： G06F9/38 文献下载
摘要：本发明涉及高效存储器层级管理。在处理器中，在执行程序之前，存在指令和所述程序的一些部分可驻存在数据高速缓冲存储器中的情况。提供硬件和软件技术以在指令高速缓冲存储器中具有未中之后取出所述数据高速缓冲存储器中的指令，从而改进所述处理器的性能。如果指令不存在于所述指令高速缓冲存储器中，那么指令取出地址作为数据取出地址发送到所述数据高速缓冲存储器。如果有效数据存在于所述数据高速缓冲存储器中所述所供应的指令取出地址处，那么所述数据实际上是指令，且取出数据高速缓冲存储器条目，并将其作为指令供应给处理器复合体。指令页表中可包括额外位以在所述指令高速缓冲存储器中出现未中时，指示应针对所述指令检查所述数据高速缓冲存储器。
高效存储器层级管理

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