专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [实用新型]一种基于D触发器和计数器逻辑组合的时钟产生控制电路-CN201220524966.1有效
  • 赵筱琳;石志成;王芸;陆晓峰 - 北京空间机电研究所
  • 2012-10-15 - 2013-05-01 - H03L7/099
  • 一种基于D触发器和计数器逻辑组合的时钟产生控制电路,包括时钟基准电路、锁相电路、时钟启动停止电路以及脉冲计数电路;时钟基准电路输出一定频率的时钟信号至锁相电路;锁相电路对输入的时钟信号进行同步锁相同步锁相后的信号作为时钟产生控制电路的输出信号并同时送至脉冲计数电路;脉冲计数电路对同步锁相后的信号所包含的时钟个数进行计数,计数达到预设值时脉冲计数电路输出信号至时钟启动停止电路;时钟启动停止电路接收脉冲计数电路输出的信号以及外加的启动信号,产生同步锁相启动信号或者同步锁相停止信号送至锁相电路本实用新型基于D触发器、计数器以及各种逻辑组合的硬件电路,通过同步设计实现即定周期的完整时钟信号输出。
  • 一种基于触发器计数器逻辑组合时钟产生控制电路
  • [发明专利]图框基锁相的显示控制器及其方法-CN200610004379.9有效
  • 范姜徐霖;洪瑞鸿;蔡惠民 - 晨星半导体股份有限公司
  • 2006-01-27 - 2006-08-02 - H04N3/27
  • 一种显示系统中图框基锁相的显示控制器及其方法。显示控制器用以显示视频讯号中若干个影像图框,包括图框基锁相回路和同步讯号产生器,图框基锁相回路接收振荡讯号和输入垂直同步讯号,并且利用基于图框的锁相回路产生输出时钟讯号。同步讯号产生器接收输出时钟讯号以产生输出水平同步讯号、输出垂直同步讯号和输出显示致能讯号。图框基锁相回路包括快速相位侦测器、相位频率侦测器和有效像素区域产生器。有效像素区域产生器接收输入垂直同步讯号产生与有效像素区域关联的参考讯号,图框基锁相回路将显示致能讯号图框基锁相至参考讯号。
  • 图框基锁相显示控制器及其方法
  • [发明专利]间歇式锁相环频率综合器-CN201610594381.X有效
  • 阴亚东;施隆照 - 福州大学
  • 2016-07-27 - 2019-03-12 - H03L7/10
  • 本发明涉及一种间歇式锁相环频率综合器,包括时钟同步单元、锁相环单元以及模式控制单元;时钟同步单元分别与模式控制单元以及锁相环单元相连;模式控制单元与所相环单元相连;时钟同步单元以及模式控制单元作为输入端,分别接收参考时钟信号以及模式控制信号;模式控制单元接收时钟同步单元发送的同步时钟信号;锁相环单元接收模式控制信号发送的第一复位信号以及第二复位信号,接收时钟同步单元发送的同步时钟信号,并分别发送反馈时钟信号至时钟同步单元以及模式控制单元;锁相环单元作为输出端,输出一高频时钟信号。本发明所提出的一种间歇式锁相环频率综合器,其能够工作在开启时间短于锁相环锁定时间的间歇工作模式。
  • 间歇式锁相环频率综合
  • [发明专利]同步可集成从时钟锁相-CN02115742.1无效
  • 陈为怀;樊少杰;李兆训 - 陈为怀;樊少杰;李兆训
  • 2002-04-19 - 2003-10-29 - H03L7/08
  • 本发明涉及一种用于SDH传送网各级同步单元、CDMA基站时间频率同步设备、数字同步网及程控交换机各级从时钟中的网同步可集成从时钟锁相环。该从时钟锁相环为由一个松耦合全数字锁相环和一个窄带模拟锁相环交叉连接组成的双环从时钟锁相环,输入基准信号加到全数字锁相环的输入端,全数字锁相环的输出信号用作模拟锁相环输入,模拟锁相环输出作为从时钟锁相环的输出,两个锁相环共用一个高稳恒温压控晶体振荡器VCXO,全数字锁相环用模拟锁相环中的高稳恒温压控晶体振荡器VCXO作频率源分别加到脉冲加减电路、K计数电路和数据采集处理电路作内部时钟。
  • 同步集成时钟锁相环
  • [实用新型]三相电网信号采样的锁相同步电路-CN201320686833.9有效
  • 吴海强;李开信;李花;吴东梅 - 珠海中慧微电子有限公司
  • 2013-11-01 - 2014-06-11 - H03L7/18
  • 本实用新型涉及一种三相电网信号采样的锁相同步电路,该电路包括过零比较电路、选相电路和锁相倍频电路。所述过零比较电路的输入端作为锁相同步电路的输入端连接至三相电网,过零比较电路的输出端连接至选相电路的输入端,选相电路的输出端连接至锁相倍频电路的输入端,锁相倍频电路的输出端则作为锁相同步电路的输出端。通过设置过零比较电路、选相电路和锁相倍频电路,并使从过零比较电路输入的三相电网信号通过选相电路的选相后,从锁相倍频电路输出与电压信号源同步的2n次分频采样信号,以此实现对三相电网信号的频率跟踪,从而保证了锁相同步电路为后续电力系统的监控提供及时准确的信号参数依据。
  • 三相电网信号采样相同电路
  • [发明专利]同步锁相环路抖动装置的相位误差补偿装置及使用方法-CN03115167.1无效
  • 朴廷培 - 上海乐金广电电子有限公司
  • 2003-01-27 - 2004-08-18 - H03L7/085
  • 本发明是关于抖动相位同步锁相环路的相位误差补偿装置及使用方法,抖动相位同步锁相环路主要是在从模拟转化为数字A/D的抖动信号在正与负零交叉点PZCP上检波相位误差后,在上述交叉点上利用单独的相位误差补偿器上述抖动相位同步锁相环路的作用主要有通过滤波器特性、切平、抖动信号的形状等改变抖动信号负荷比来防止出现抖动相位同步锁相环路的定时抖动逐步失效,同时,还可以瞬时同步的生成并输出PLL脉冲波。另外,在一定时间内无法读出抖动信号而终止抖动相位同步锁相环路动作的状态下突然读出抖动信号时也能对抖动信号迅速形成抖动相位同步锁相环路动作。
  • 同步环路抖动装置相位误差补偿使用方法
  • [发明专利]一种同步时钟产生电路模块、功能芯片和多片同步装置-CN202210841135.5在审
  • 石超然;武锦 - 苏州迅芯微电子有限公司
  • 2022-07-18 - 2022-09-30 - H03L7/18
  • 本发明公开了一种同步时钟产生电路模块、功能芯片和多片同步装置。其中,该电路模块包括:锁相环电路和时钟产生电路;锁相环电路与时钟产生电路电连接,锁相环电路接收时钟源产生的主时钟输入信号和同步时钟输入信号,锁相环电路将主时钟输入信号倍频为高频主时钟信号以及基于高频主时钟信号将同步时钟输入信号触发为中途同步时钟信号;时钟产生电路接收高频主时钟信号和中途同步时钟信号,时钟产生电路将高频主时钟信号分频为分频时钟信号以及基于分频时钟信号将中途同步时钟信号触发为同步时钟信号,其中,同步时钟信号与分配时钟信号频率一致。本发明实施例,通过锁相环电路与时钟产生电路的结合,实现多芯片信号同步,提高时钟信号处理速度。
  • 一种同步时钟产生电路模块功能芯片装置
  • [发明专利]一种提高基准钟性能的方法及系统-CN200710123829.0有效
  • 张庆 - 华为技术有限公司
  • 2007-10-11 - 2008-03-19 - H04J3/06
  • 本发明涉及通信领域,公开了一种提高基准钟性能的方法及系统,本方法将原子钟信号和GPS信号通过锁相处理后的锁相信号、GPS信号以及原子钟信号依次作为BITS的最高、次高以及第三优先级别外部时钟同步信号。BITS受控于最高优先级别的信号,若最高优先级别的外部时钟同步信号异常,BITS受控于次高优先级别的外部时钟同步信号,依此类推;本系统包括输入模块、锁相模块和BITS模块:输入模块向锁相模块提供输入信号;锁相模块处理输入模块提供的信号,并向BITS模块提供锁相信号作为最高优先级别的外部时钟同步信号;BITS模块受控于所述最高优先级别的外部时钟同步信号。
  • 一种提高基准性能方法系统
  • [发明专利]一种同步通信系统时钟再生方法及系统-CN200610011361.1无效
  • 罗军;顾玉辉;马俊峰 - 中兴通讯股份有限公司
  • 2006-02-23 - 2007-08-29 - H04L7/033
  • 本发明公开了一种同步通信系统中时钟再生的方法,包括:步骤1,利用锁相环将所述位时钟转化为锁相时钟;步骤2,利用逻辑器件产生采样时钟,以供所述锁相环工作时使用;步骤3,所述逻辑器件接收所述步骤1中产生的锁相时钟以及所述帧同步时钟,并生成所述再生位时钟和所述再生帧同步时钟。同时,本发明还公开了一种同步通信系统中的时钟再生系统,包括:锁相环和逻辑器件。利用本发明的方法和系统,可高质量地再生不规则的帧同步时钟,并可获得与再生帧同步时钟完全同步的再生位时钟。
  • 一种同步通信系统时钟再生方法

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