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- [发明专利]间歇式锁相环频率综合器-CN201610594381.X有效
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阴亚东;施隆照
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福州大学
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2016-07-27
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2019-03-12
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H03L7/10
- 本发明涉及一种间歇式锁相环频率综合器,包括时钟同步单元、锁相环单元以及模式控制单元;时钟同步单元分别与模式控制单元以及锁相环单元相连;模式控制单元与所相环单元相连;时钟同步单元以及模式控制单元作为输入端,分别接收参考时钟信号以及模式控制信号;模式控制单元接收时钟同步单元发送的同步时钟信号;锁相环单元接收模式控制信号发送的第一复位信号以及第二复位信号,接收时钟同步单元发送的同步时钟信号,并分别发送反馈时钟信号至时钟同步单元以及模式控制单元;锁相环单元作为输出端,输出一高频时钟信号。本发明所提出的一种间歇式锁相环频率综合器,其能够工作在开启时间短于锁相环锁定时间的间歇工作模式。
- 间歇式锁相环频率综合
- [发明专利]网同步可集成从时钟锁相环-CN02115742.1无效
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陈为怀;樊少杰;李兆训
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陈为怀;樊少杰;李兆训
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2002-04-19
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2003-10-29
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H03L7/08
- 本发明涉及一种用于SDH传送网各级同步单元、CDMA基站时间频率同步设备、数字同步网及程控交换机各级从时钟中的网同步可集成从时钟锁相环。该从时钟锁相环为由一个松耦合全数字锁相环和一个窄带模拟锁相环交叉连接组成的双环从时钟锁相环,输入基准信号加到全数字锁相环的输入端,全数字锁相环的输出信号用作模拟锁相环输入,模拟锁相环输出作为从时钟锁相环的输出,两个锁相环共用一个高稳恒温压控晶体振荡器VCXO,全数字锁相环用模拟锁相环中的高稳恒温压控晶体振荡器VCXO作频率源分别加到脉冲加减电路、K计数电路和数据采集处理电路作内部时钟。
- 同步集成时钟锁相环
- [发明专利]一种提高基准钟性能的方法及系统-CN200710123829.0有效
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张庆
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华为技术有限公司
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2007-10-11
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2008-03-19
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H04J3/06
- 本发明涉及通信领域,公开了一种提高基准钟性能的方法及系统,本方法将原子钟信号和GPS信号通过锁相处理后的锁相信号、GPS信号以及原子钟信号依次作为BITS的最高、次高以及第三优先级别外部时钟同步信号。BITS受控于最高优先级别的信号,若最高优先级别的外部时钟同步信号异常,BITS受控于次高优先级别的外部时钟同步信号,依此类推;本系统包括输入模块、锁相模块和BITS模块:输入模块向锁相模块提供输入信号;锁相模块处理输入模块提供的信号,并向BITS模块提供锁相信号作为最高优先级别的外部时钟同步信号;BITS模块受控于所述最高优先级别的外部时钟同步信号。
- 一种提高基准性能方法系统
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