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[发明专利]泛编辑平台云盘文件和媒资系统智能同步的方法-CN201210243684.9有效
发明人：周熙;冯良怀;王兰图 -专利权人：成都东方盛行电子有限责任公司
申请日： 2012-07-13 - 公布日： 2012-11-14 - 主分类号： H04N5/222 文献下载
摘要：本发明公开了一种泛编辑平台云盘文件和媒资系统智能同步的方法，它包括以下步骤：查看“当前打开的句柄数”、“锁定标识”及“归档处理标识”；句柄数归零时，通过数据库触发器检测当前文件是否被归档处理过；如果没有归档处理过，锁定标识位置位；通知服务器端的同步归档的进程“有一文件需要进行同步处理”；同步归档进程收到同步请求后，将该同步请求放入等待队列，等候处理；异步工作线程取出该请求并进行归档处理；将数据库的处理完毕标识位置位本发明合理利用媒资资源，降低了系统设备的成本；支持多类型云盘文件与媒资系统之间的同步；按照同步器优先级的大小进行调用，同步器的调用有序、高效。
编辑平台文件系统智能同步方法

[发明专利]一种基准站网中数据的处理、监测方法及装置-CN202110161839.3有效
发明人：高星伟 -专利权人：腾讯科技（深圳）有限公司
申请日： 2021-02-05 - 公布日： 2022-04-08 - 主分类号： G06F16/27 文献下载
摘要：本申请实施例公开了一种基准站网中数据的处理、监测方法及装置，其中该处理方法包括：在同步处理启动时，确定已接收到的基准站数据对应的观测时刻点及同步处理启动时的本地时刻点；根据目标观测时刻点及本地时刻点确定本地的同步等待时刻点，以在同步等待时刻点之前，接收观测于目标观测时刻点的目标基准站数据；在同步等待时刻点到达时，对接收到的目标基准站数据进行数据处理；根据同步等待时刻点之后接收到的其他基准站数据，循环更新目标观测时刻点及同步等待时刻点，执行对其他基准站数据的同步处理。本申请的实施例提高基准站网中数据的处理效果，兼顾高精度数据同步匹配的同时有效避免数据积压。
一种基准站网中数据处理监测方法装置

[实用新型]利用通用微处理器实现同步通信数据收发的装置-CN200520036472.9无效
发明人：刘正熙;黄戈;李新胜 -专利权人：四川川大智胜软件股份有限公司;四川大学
申请日： 2005-12-13 - 公布日： 2006-12-20 - 主分类号： G06F13/38 文献下载
摘要：一种利用通用微处理器实现同步通信数据收发的装置，属同步串行通信接口装置。同步通信的联络、控制信号输入至微处理器，同步数据输入RxD经微处理器的1位I/O输入，同步数据输出TxD通过微处理器的1位I/O在本次时钟周期内输出至D触发器的D端，并在下一个时钟周期由其Q端与微处理器内部时钟同步输出；微处理器的输出时钟送至D触发器的CP端、作为CP时钟源；上述所有输入和输出信号均分别经电平转换电路完成从RS－232电平到TTL电平和从TTL电平到RS－233电平的转换。本实用新型使用通用微处理器替代同步串行通信芯片，完成同步串行通信功能，实现非标准同步串行通信数据的收发。
利用通用微处理器实现同步通信数据收发装置

[发明专利]利用奇偶场同步数据产生抵消结果的信号处理方法及装置-CN200810176821.5有效
发明人：李宜霖;黄正壹 -专利权人：瑞昱半导体股份有限公司
申请日： 2008-11-25 - 公布日： 2010-06-16 - 主分类号： H04N5/40 文献下载
摘要：利用奇偶场同步数据产生抵消结果的信号处理方法及装置。该信号处理方法包含：接收奇数场的奇数场同步数据以及偶数场的偶数场同步数据，其中奇数场同步数据在一特定数据区段相异于偶数场同步数据；将奇数场同步数据与偶数场同步数据相结合，以产生具有抵消结果的奇偶数场相结合后同步数据；以及依据奇偶数场相结合后同步数据来执行一预定信号处理。
利用奇偶同步数据产生抵消结果信号处理方法装置

[发明专利]用于处理监视器同步信号的装置和方法-CN00121585.X无效
发明人：宋明准 -专利权人： LG电子株式会社
申请日： 2000-08-14 - 公布日： 2004-08-25 - 主分类号： H04N5/04 文献下载
摘要：用于处理监视器同步信号的装置和方法，用这种装置和方法检测异常同步信号以避免在进行到DPM模式时出现劣质图象质量和差错。用于处理监视器同步信号的装置包括：同步信号处理器，用于从SOG信号中分离同步信号；检测器，用于检测从同步信号处理器输出的同步信号宽度和水平线宽度；微机，用于通过使用检测的同步信号宽度与水平线宽度的相对比率确定同步信号是否异常
用于处理监视器同步信号装置方法

[发明专利]一种综合式处理单元-CN201910044969.1在审
发明人：张鼎衢;宋强;林国营;党三磊;孟庆亮;潘峰 -专利权人：广东电网有限责任公司;广东电网有限责任公司计量中心
申请日： 2019-01-17 - 公布日： 2019-03-22 - 主分类号： G05B19/042 文献下载
摘要：本发明提供了一种综合式处理单元，包括：DSP处理器、嵌入式工控机、通信拓展模块和时钟同步与授时模块；DSP处理器与嵌入式工控机通信连接；通信拓展模块与嵌入式工控机通信连接；时钟同步与授时模块与DSP处理器的定时器接口连接，时钟同步与授时模块用于对DSP处理器以及与DSP处理器连接的外部设备进行时钟同步，通过DSP处理器对时钟同步与授时模块发送的同步信号进行处理，能够实现DSP处理器的时钟同步，还可以通过时钟同步与授时模块实现与DSP处理器连接的外部设备的时钟同步，同时可通过嵌入式工控机外接各种设备实现数据的显示和数据的上传等，解决了由于目前的集中器的功能性不足，无法满足关口电能计量装置在线监测与校验配置的需求的技术问题。
时钟同步授时模块嵌入式工控机外部设备处理单元通信连接综合式电能计量装置定时器接口设备实现同步信号在线监测校验集中器配置的上传外接通信拓展关口发送

[实用新型]一种综合式处理单元-CN201920078630.9有效
发明人：张鼎衢;宋强;林国营;党三磊;孟庆亮;潘峰 -专利权人：广东电网有限责任公司;广东电网有限责任公司计量中心
申请日： 2019-01-17 - 公布日： 2019-06-28 - 主分类号： G05B19/042 文献下载
摘要：本实用新型提供了一种综合式处理单元，包括：DSP处理器、嵌入式工控机、通信拓展模块和时钟同步与授时模块；DSP处理器与嵌入式工控机通信连接；通信拓展模块与嵌入式工控机通信连接；时钟同步与授时模块与DSP处理器的定时器接口连接，时钟同步与授时模块用于对DSP处理器以及与DSP处理器连接的外部设备进行时钟同步，通过DSP处理器对时钟同步与授时模块发送的同步信号进行处理，能够实现DSP处理器的时钟同步，还可以通过时钟同步与授时模块实现与DSP处理器连接的外部设备的时钟同步，同时可通过嵌入式工控机外接各种设备实现数据的显示和数据的上传等，解决了由于目前的集中器的功能性不足，无法满足关口电能计量装置在线监测与校验配置的需求的技术问题。
时钟同步授时模块嵌入式工控机外部设备处理单元通信连接综合式电能计量装置本实用新型定时器接口设备实现同步信号在线监测校验集中器配置的上传外接通信拓展关口发送

[发明专利]同步请求转异步处理的方法、系统、终端设备及存储介质-CN202210099998.X在审
发明人：阳鹤松;杨兢 -专利权人：深圳金融电子结算中心有限公司
申请日： 2022-01-27 - 公布日： 2022-05-27 - 主分类号： H04L67/1095 文献下载
摘要：本发明公开了一种同步请求转异步处理的方法、系统、终端设备及存储介质。该方法包括：接收同步请求，并对所述同步请求申请闭锁；通过所述同步请求的内容，发起异步请求；根据所述闭锁，挂起所述同步请求；对所述异步请求进行异步处理，得到异步结果；基于所述异步结果、闭锁，唤醒所述异步结果对应的同步请求；基于所述异步结果对应的同步请求，得到同步结果，并返回所述同步结果。本发明提高了同步请求转换为异步处理的效率，提高了请求响应速度。
同步请求异步处理方法系统终端设备存储介质

[发明专利]时间同步装置及同步方法-CN202110583559.1在审
发明人：王梓龙;高述辕;李为;毕立颖;吕栋 -专利权人：山东中瑞电气有限公司
申请日： 2021-05-27 - 公布日： 2021-09-07 - 主分类号： G06F1/12 文献下载
摘要：本发明涉及时间同步控制技术领域，具体涉及一种时间同步装置及同步方法。该时间同步装置包括数据包处理模块，数据包处理模块连接有中央处理器及时间计数模块，时间计数模块连接中央处理器及锁相回路模块，锁相回路模块连接中央处理器，数据包处理模块连接有运行装置；数据包处理模块包括通讯单元、时间计数器及信号同步单元，时间计数器分别连接通讯单元及信号同步单元，通讯单元连接运行装置；时间计数模块包括当日时间计数器，当日时间计数器连接第一存储单元及第二存储单元，当日时间计数器连接信号同步单元，提供一种能得到瞬时值，与主钟进行准确同步的时间同步装置及同步方法。
时间同步装置方法

[发明专利]用于电阻精密检测的同源双路同步采样电路及其方法-CN202111585388.2在审
发明人：余莉;孔祥苓;马骥;王洋;冯涌泉;俞波;王志高;马子懿;李超;郭双红 -专利权人：航天科工惯性技术有限公司
申请日： 2021-12-22 - 公布日： 2023-06-27 - 主分类号： G01R27/02 文献下载
摘要：本发明一种应用于电阻精密检测的同源双路同步采样方法，对电路中的两个电压信号进行同步采样和数据处理，实现基于基准测量的双通道同步采集。本发明还提供同源双路同步采样电路，包括同源双路检测电路，同步A/D采样电路和数据处理电路；同源双路检测电路输出两路电压进入同步A/D采样电路，数据处理电路产生一组控制信号控制同步A/D采样电路，同步A/D采样电路得到的两路同步A/D转换数据在数据处理电路进行处理，处理后的数据再与上位机进行交互；数据处理电路根据同步A/D采样电路对VN1和VN2转换得到数字量和同源双路检测电路的拓扑结构形式反算出待测电阻
用于电阻精密检测同源同步采样电路及其方法

[发明专利]差转型同步控制器-CN201010102361.9无效
发明人：陈伟 -专利权人：陈伟
申请日： 2010-01-28 - 公布日： 2010-07-28 - 主分类号： G08G1/07 文献下载
摘要：本发明公开了一种差转型同步控制器，它由差转主控制器和同步接收模块两部分组成；差转主控制器包括同步源信号接收模块、主控制器微处理器和主控制器数字无线收发模块，同步源信号接收模块和主控制器微处理器相连接，主控制器数字无线收发模块和主控制器微处理器相连接，主控制器微处理器的输出连接本地负载；同步接收模块包括同步接收数字无线收发模块和接收模块微处理器，同步接收数字无线收发模块与主控制器数字无线收发模块相对应，同步接收数字无线收发模块和接收模块微处理器相连接，接收模块微处理器的输出连接本地负载。本发明结构合理，可转发同步控制信号，具有较高的同步控制可靠性和较低的应用成本，适用范围较广等优点。
转型同步控制器

[实用新型]一种视频处理系统-CN201621328150.6有效
发明人：吴剑锋;马驰飞;张鑫锋 -专利权人：杭州海康威视数字技术股份有限公司
申请日： 2016-12-06 - 公布日： 2017-06-23 - 主分类号： H04N5/06 文献下载
摘要：本实用新型实施例提供了一种视频处理系统，包括至少两个视频处理设备，还包括同步时钟源，每个视频处理设备包括主控板和至少一个X86业务板，至少一个X86业务板分别通过同步时钟源与主控板电连接，且至少一个X86业务板分别与主控板电连接；同步时钟源在第一主控板控制下产生同步时钟信号，并传输至其它主控板以及每个X86业务板，每个X86业务板在同步时钟信号以及对应主控板的控制下同步输出视频数据。本实用新型实施例中，视频处理系统中设置有同步时钟源，通过各个视频处理设备中的各个X86业务板与同步时钟源连接的方式，使各个视频处理设备内部的时钟信号同步，进一步使得各个视频处理设备输出的视频数据同步。
一种视频处理系统

[发明专利]数据处理系统-CN02824932.1无效
发明人： J·T·J·范埃德霍文;E·J·波;M·J·鲁特坦;O·P·冈瓦 -专利权人：皇家飞利浦电子股份有限公司
申请日： 2002-12-05 - 公布日： 2005-04-06 - 主分类号： G06F9/46 文献下载
摘要：要求一种数据处理系统的权利，该系统包括多个处理器(12a，12b，12c)，它们通过共享的存储器(10)彼此交换数据流。该数据处理系统包括处理器同步装置(18)，用于当传送数据流时使处理器(12a－c)同步。为此目的，处理器能够给同步装置(18)发布同步命令(Ca－c)。至少一个处理器12a包括超高速缓冲存储器(184a)，和同步单元(18)响应同步命令(Ca)而起动超高速缓冲存储器操作(Cca)。
数据处理系统

[发明专利]一种Redis缓存跨中心数据处理方法-CN202111574196.1在审
发明人：林钰;秦俊峰 -专利权人：北京冠群信息技术股份有限公司
申请日： 2021-12-21 - 公布日： 2022-03-29 - 主分类号： G06F16/27 文献下载
摘要：本发明属于数据处理技术领域，提供了一种Redis缓存跨中心数据处理方法，包括：设置复制模式；同步服务A与Redis服务节点A建立连接，同步服务B与Redis服务节点B建立连接；同步服务A向Redis服务节点A发送同步命令；Redis服务节点A接收到同步命令后，向同步服务A发送同步数据；同步服务A实时监听同步数据并向同步服务B发送同步数据；同步服务B实时监听同步数据并将同步数据写入Redis服务节点B中。本发明的一种Redis缓存跨中心数据处理方法，可根据使用场景调整复制模式，具有灵活性强的特点。
一种 redis 缓存中心数据处理方法

[发明专利]一种多节点时钟同步方法和时钟同步模块-CN202110796792.8有效
发明人：周宇恒;张立鹏;蒋建金;陈宜航;王建涛;张辉;夏伟;华晴 -专利权人：卡斯柯信号有限公司
申请日： 2021-07-14 - 公布日： 2022-07-26 - 主分类号： H04J3/06 文献下载
摘要：一种多节点时钟同步方法和时钟同步模块，列车运行控制系统中所有逻辑处理通道中的独立时钟源分别生成本通道的时钟同步信号，每个逻辑处理通道向内部总线上广播本通道的时钟同步信号并从内部总线接收其它通道的时钟同步信号，每个逻辑处理通道根据所有通道的时钟同步信号计算统一的同步时钟，利用统一的同步时钟调整本通道的时钟。本发明适用于具有任意数量逻辑处理通道的安全控制系统，通用性强，可配置性强，便于移植。
一种节点时钟同步方法模块

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