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[发明专利]用于在处理浮点值时实现功率节省技术的装置与方法-CN201580064719.4有效
发明人： Y·M·金;S·P·朴 -专利权人：英特尔公司
申请日： 2015-11-23 - 公布日： 2021-07-20 - 主分类号： G06T1/20 文献下载
摘要：例如，装置的一个实施例包括：图形处理单元(GPU)，其用于处理包括浮点数据的图形数据；一组寄存器，该组中的寄存器中的至少一个寄存器被划分用于存储浮点数据；以及编码/解码逻辑，其用于通过使浮点数据内的指定一组的比特位置被读出为
用于处理浮点实现功率节省技术装置方法

[发明专利]数据库记录调序系统及方法-CN200610007245.2无效
发明人：谢理智;刘冬;吴星 -专利权人：北京北大方正电子有限公司;北京大学
申请日： 2006-02-15 - 公布日： 2007-08-22 - 主分类号： G06F17/30 文献下载
摘要：本发明涉及一种数据库记录调序方法，包括以下步骤：接收由交互界面传递的移动数据库记录至指定位置的指令；读取指定位置的相关位置的浮点数；根据相关位置的浮点数以及数据库中原数据库记录排列顺序确定指定位置的浮点数
数据库记录系统方法

[发明专利]影像浮点数据转换运算方法-CN200310102771.3无效
发明人：王志铭 -专利权人：无敌科技股份有限公司
申请日： 2003-10-21 - 公布日： 2005-04-27 - 主分类号： G06F7/00 文献下载
摘要：本发明提供了一种影像浮点数据转换运算方法，应用于影像压缩/解压缩过程中，将色彩模式转换的转换矩阵中具有浮点数的部分整数化后，以整数进行累加、累乘…等运算，最后再还原为原本的值域范围，以提升整体运算效率。
影像浮点数据转换运算方法

[发明专利]包括浮点加法器的芯片、设备及浮点运算的控制方法-CN202011004685.9在审
发明人：李嘉昕 -专利权人：腾讯科技（深圳）有限公司
申请日： 2020-09-22 - 公布日： 2020-12-25 - 主分类号： G06F7/487 文献下载
摘要：本申请公开了一种包括浮点加法器的芯片、设备及浮点运算的控制方法，涉及芯片技术领域。浮点加法器包括：合并单元用于对输入的n个操作数的尾数部分分别添加有效数，得到n个操作数分别对应的合并数据，n为大于等于3的正整数；可变移位单元用于对n个操作数分别对应的合并数据，分别进行可变移位操作，得到定点数格式的n个更新操作数；可配置加法单元用于对n个更新操作数进行加法运算得到运算结果；转换输出单元用于将运算结果转换为浮点数格式，并输出浮点数格式的运算结果。本申请能够实现一个浮点加法器支持对3个或者3个以上的浮点数进行加法运算，提升了浮点加法器的处理性能，为云技术、人工智能技术等提供更高性能的算力支持。
包括浮点加法器芯片设备运算控制方法

[发明专利]用于将浮点值从半精度转换为单精度的装置和方法-CN201811258512.2在审
发明人： R·凡伦天;M·查尼;R·萨德;E·乌尔德-阿迈德-瓦尔;J·科巴尔 -专利权人：英特尔公司
申请日： 2018-10-26 - 公布日： 2019-06-04 - 主分类号： G06F7/483 文献下载
摘要：本申请公开了用于将浮点值从半精度转换为单精度的装置和方法。本发明的实施例是处理器，包括执行电路，用于：响应于经解码的指令，将半精度浮点值转换为单精度浮点值，并且将单精度浮点值存储在目的地寄存器的多个元素位置中的每一个中。处理器还包括解码器和目的地寄存器。
浮点解码器解码精度转换寄存器处理器指令元素位置指令解码电路存储响应转换申请

[发明专利]浮点数除运算执行控制器-CN201310681170.6有效
发明人：蔡启仲;柯宝中;李克俭;李刚;王鸣桃 -专利权人：广西科技大学
申请日： 2013-12-13 - 公布日： 2014-03-19 - 主分类号： G06F7/57 文献下载
摘要：一种浮点数除运算执行控制器，包括浮点操作数配置控制模块、浮点数除运算器、脉冲发生分配控制器、结果输出控制模块；该执行控制器应用FPGA设计硬连接控制电路，在脉冲发生分配控制器产生的时序脉冲控制下自主完成参与运算的两个操作数的选择配置该执行控制器能够实现除运算的四种处理方式，执行两个操作数都来自系统数据总线的运算，也能够执行一个操作数是上次运算的结果，避免每条指令运算结束都需要将运算结果写回的过程，并且在浮点数除法运算的过程中，系统能够并行从执行控制器读出上次运算的结果，提高了系统执行浮点数除法运算指令序列的速度。
浮点运算执行控制器

[发明专利]浮点数加/减运算执行控制器-CN201310681509.2有效
发明人：蔡启仲;余玲;李克俭;张玲玲;王鸣桃 -专利权人：广西科技大学
申请日： 2013-12-13 - 公布日： 2014-03-19 - 主分类号： G06F7/575 文献下载
摘要：一种浮点数加/减运算执行控制器，包括浮点操作数配置控制模块、浮点数加/减运算器、脉冲分配器、结果输出控制模块；该执行控制器应用FPGA设计硬连接控制电路，执行控制器被系统选中，启动脉冲分配器，在内部脉冲分配器的时序脉冲控制下自主完成参与运算的该执行控制器能够执行2个操作数都来自系统数据总线的运算，也能够执行1个操作数是上次运算的结果，避免每条指令运算结束都需要将运算结果写回的过程，并且在浮点数加/减法运算的过程中，系统能够并行从执行控制器读出上次运算的结果，提高了系统执行浮点数加/减运算指令序列的速度。
浮点运算执行控制器

[实用新型]浮点数加/减运算执行控制器-CN201320822620.4有效
发明人：蔡启仲;余玲;李克俭;张玲玲;王鸣桃 -专利权人：广西科技大学
申请日： 2013-12-13 - 公布日： 2014-07-30 - 主分类号： G06F7/575 文献下载
摘要：一种浮点数加/减运算执行控制器，包括浮点操作数配置控制模块、浮点数加/减运算器、脉冲分配器、结果输出控制模块；该执行控制器应用FPGA设计硬连接控制电路，执行控制器被系统选中，启动脉冲分配器，在内部脉冲分配器的时序脉冲控制下自主完成参与运算的该执行控制器能够执行2个操作数都来自系统数据总线的运算，也能够执行1个操作数是上次运算的结果，避免每条指令运算结束都需要将运算结果写回的过程，并且在浮点数加/减法运算的过程中，系统能够并行从执行控制器读出上次运算的结果，提高了系统执行浮点数加/减运算指令序列的速度。
浮点运算执行控制器

[发明专利]用于定点到浮点的转换的装置和方法及2的负幂检测器-CN201710696272.3有效
发明人：大卫·雷蒙德·鲁茨 -专利权人： ARM 有限公司;安谋科技（中国）有限公司
申请日： 2017-08-15 - 公布日： 2023-06-23 - 主分类号： H03M7/24 文献下载
摘要：本公开提供用于定点到浮点的转换的装置和方法及2的负幂检测器。数据处理系统(2)支持定点数到浮点数的转换。得到的浮点数可以为次正规的。第一移位器(28)将表示定点数的输入信号移位第一移位量，第一移位量取决于定点数的后跟小数部分的整数部分内的前导零的计数。第二移位器(30)将输入信号移位第二移位量，第二移位量取决于定点数内的可变点位置。次正规结果检测器(34)根据对与具有次正规值的浮点数相对应的可变点位置和前导零的计数的组合的检测来生成选择信号。
用于定点浮点转换装置方法检测器

[发明专利]面向集成电路的超低延时的整数次幂计算电路的优化方法-CN202010920109.2有效
发明人：吕飞;郑焯文;罗元勇 -专利权人：金陵科技学院
申请日： 2020-09-04 - 公布日： 2023-05-16 - 主分类号： G06F17/17 文献下载
摘要：本发明适用于单精度及尾数位宽8‑16的浮点数，大的尾数位宽可以提高运算精度；与现有基于坐标旋转数字计算方法的架构相比，该发明在最大相对误差降低57.30％的基础上，分别节约面积、功耗、延时91.60％、
面向集成电路延时整数计算电路优化方法

[发明专利]一种高频模型预测控制用数据处理系统-CN201910594938.3在审
发明人：王泽群 -专利权人：王泽群
申请日： 2019-07-03 - 公布日： 2019-08-20 - 主分类号： G05B19/042 文献下载
摘要：本发明公开一种高频模型预测控制用数据处理系统，包括预存有采样数据处理程序的浮点数字信号处理器、用于暂存采样数据的外部存储器、用于对处理后的采样数据进行评估的优化引擎、用于采集采样数据的信息采集单元、用于对处理后的采样数据进行计算的FPGA和预存有用以对处理后的采样数据进行计算的程序的FLASH芯片，所述信息采集单元信息输出端与所述浮点数字信号处理器信息输入端通信连接，所述浮点数字信号处理器与所述FPGA通信连接，所述FPGA与所述FLASH芯片通信连接；所述浮点数字信号处理器分别与所述外部存储器和所述优化引擎通信连接。
采样数据浮点数字信号处理器通信连接数据处理系统信息采集单元外部存储器高频模型预测控制引擎采样数据处理模型预测控制高频变换器信息输出端信息输入端模型控制暂存优化应用采集评估

[发明专利]浮点数处理方法、设备和可移动平台-CN201980033559.5在审
发明人：徐功林;刘子男;韩彬 -专利权人：深圳市大疆创新科技有限公司
申请日： 2019-09-29 - 公布日： 2021-01-05 - 主分类号： G06F7/487 文献下载
摘要：一种浮点数处理方法、设备和可移动平台，该方法包括：获取浮点数的处理指令(S201)；在尾数数据段的存储地址，分别读取尾数数据段的高位子数据段和低位子数据段(S202)；根据高位子数据段的数值，在对应计算模式的预设数值表中查找得到第一值将高位子数据段的数值和低位子数据段的数值输入加法运算单元，使加法运算单元根据对应计算模式的加法运算公式执行运算，得到第二值(S204)；将第一值和第二值输入第一乘法器，得到第一乘积结果(S205)；根据第一乘积结果，获得浮点数在计算模式下的运算结果的尾数数据段的数值并存入对应浮点数在计算模式下的运算结果的尾数数据段地址
浮点处理方法设备移动平台

[发明专利]一种摄像头缺陷自动化检测方法-CN201911093667.X在审
发明人：王勃;李汝鹏 -专利权人：北京转转精神科技有限责任公司
申请日： 2019-11-08 - 公布日： 2020-03-06 - 主分类号： H04N17/00 文献下载
摘要：其中每一台手机均拍摄一张白屏照片和一张黑屏照片作为测试样图；判断算法训练库中的每张测试样图有无缺陷，并且标注出测试样图的缺陷类型；使待检测摄像头拍摄一张白屏照片和一张黑屏照片作为测试照片；将测试照片的图片数据以浮点数矩阵形式输入到深度卷积模型；深度卷积模型根据测试照片进行计算，得到一个二维浮点数向量，其中二维浮点数向量的两维参数分别代表了图片无斑点的概率和图片有斑点的概率，而且两维参数的和为1；根据二维浮点数向量的两维参数判断待检测摄像头是否有斑点缺陷
一种摄像头缺陷自动化检测方法

[发明专利]存算一体芯片及数据处理方法-CN202310744910.X在审
发明人：刘亮;莫柯凡;张喆;潘彪;孙玉峰;周佳慧;赵豪;李仙琴 -专利权人：北京智芯微电子科技有限公司;北京航空航天大学
申请日： 2023-06-21 - 公布日： 2023-09-05 - 主分类号： G06F7/523 文献下载
摘要：存算一体芯片中的预处理装置能够将输入的浮点数的尾数划分为多个第一尾数组，存算一体阵列继而能够直接确定各个第一尾数组与多个第二尾数组中每个第二尾数组的初始乘积。然后，求和装置能够对多个初始乘积进行对齐处理得到多个目标乘积，并确定多个目标乘积的和值，从而得到浮点数的尾数的乘积。由此可见，本申请提供的存算一体芯片能够直接确定第一尾数组与第二尾数组的初始乘积，继而将对齐后的多个初始乘积(即目标乘积)累加，得到浮点数的尾数的乘积，因此该存算一体芯片确定浮点数的尾数的乘积的效率较高。
一体芯片数据处理方法

[发明专利]一种闪变实时计算方法-CN201210363581.6有效
发明人：刘爱民;郑有余;肖碧涛;郑龙文 -专利权人：国电南京自动化股份有限公司
申请日： 2012-09-26 - 公布日： 2013-01-16 - 主分类号： G01R31/00 文献下载
摘要：本发明公开了一种闪变实时计算方法，用于电能质量在线监测装置的闪变测量计算中，包括以下步骤：测量闪变瞬时视感度数据，将这些数据设为大于零的浮点数，称为被测数据浮点数集；将该被测数据浮点数集中的每个浮点数乘以一个系数
一种实时计算方法