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- [发明专利]存储器系统-CN201910738964.9在审
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小泉慎哉;渡边幸治
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东芝存储器株式会社
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2019-08-12
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2020-07-28
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G06F13/16
- 实施方式提供一种能够抑制处理能力降低的存储器系统。实施方式的存储器系统具备第1存储器芯片及连接着第1存储器芯片的控制器。控制器包含：第1电路，发行指令；第2电路，基于从第1电路接收的指令对第1存储器芯片进行控制；及第3电路，管理第1差量电力消耗值，该第1差量电力消耗值为第1电力消耗值与第2电力消耗值的差，该第1电力消耗值为与执行第1动作时第1存储器芯片所消耗的第1电力相关，该第2电力消耗值为与于中断第1动作的情况下第1存储器芯片所消耗的第2电力相关，并基于第1差量电力消耗值，判定是否能够使第1存储器芯片中断第1动作而使第1存储器芯片执行第
- 存储器系统
- [发明专利]存储器系统-CN201810021540.6有效
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菅野伸一
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铠侠股份有限公司
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2018-01-10
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2023-05-16
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G06F12/02
- 本发明实现能够经由其他区域的逻辑地址来利用某区域所保存的数据的存储器系统。实施方式的存储器系统将与非易失性存储器的第1区域对应的第1逻辑物理地址变换表的内容复制到与非易失性存储器的第2区域对应的第2逻辑物理地址变换表。存储器系统根据指定第2区域的逻辑地址的读取请求，基于第2逻辑物理地址变换表，将第1数据的一部分从第1区域读出并返回给主机计算机。存储器系统从分配给第1区域的所述非易失性存储器的第1区块群中检测满足刷新条件的区块，对所检测出的区块内的数据的错误进行纠正，将错误已被纠正的数据回写到与所述检测出的区块相同的区块。
- 存储器系统
- [发明专利]存储器系统-CN200980000142.5有效
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长富靖;高岛大三郎;初田幸辅
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株式会社东芝
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2009-03-03
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2010-03-24
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G06F12/02
- 公开了一种存储器系统(10)，其包含：具有多个存储器基元的闪速EEPROM非易失性存储器(11)，所述存储器基元具有浮栅极且数据项可在其中电擦除以及写入；缓冲存储器(13)，其临时存储闪速EERPOM非易失性存储器(11)的数据；控制电路(12，14)，其控制闪速EEPROM非易失性存储器(11)和缓冲存储器(13)；接口电路(16)，其与主机通信，其中，控制电路用于从闪速EEPROM非易失性存储器的将被确定的希望目标区域读取数据
- 存储器系统
- [发明专利]存储器系统-CN202110801110.8在审
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刘馨硕
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爱思开海力士有限公司
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2021-07-15
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2022-05-27
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G11C16/14
- 本公开涉及一种存储器系统。该存储器系统可以包括：存储器装置，包括存储块和外围电路；以及存储器控制器，被配置为向该存储器装置传输基于单层单元方案的编程命令，以便在对该存储块已执行擦除操作之后增加该存储块中包括的选择晶体管的阈值电压，并且被配置为向该存储器装置传输读取命令以执行检查操作，其中该检查操作使用第一读取电压和高于该第一读取电压的第二读取电压，并且该检查操作包括检查阈值电压是否落在第一读取电压和第二读取电压之间的范围内，或者检查阈值电压是低于第一读取电压还是高于第二读取电压
- 存储器系统
- [发明专利]存储器系统-CN201610411040.4有效
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李宗珉
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爱思开海力士有限公司
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2016-06-13
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2020-04-03
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G06F3/06
- 本发明涉及一种用于处理存储器装置中的数据的存储器系统及其操作方法。存储器系统可以包括：存储器装置，其包括各包括多个页面的一个或多个封闭的存储块；和控制器，其适于：在至少两个不同的时间点产生用于每个封闭的存储块的有效页面计数(VPC)；在至少两个不同的时间点之间产生用于每个封闭的存储块的VPC偏移；根据所产生的VPC偏移在封闭的存储块中选择源存储块；以及对所选择的源存储块执行垃圾收集操作。
- 存储器系统
- [发明专利]存储器系统-CN201910729681.8在审
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神户友树
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东芝存储器株式会社
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2019-08-08
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2020-07-31
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G06F21/79
- 本发明提供一种能够强化对于向存储设备的访问的安全的存储器系统。根据实施方式，存储器系统具备非易失性存储器以及与上述非易失性存储器电连接的控制器。上述控制器从第1主机受理认证请求命令，在使用上述认证请求命令中包含的认证信息的上述第1主机的认证成功的情况下，向上述第1主机发送第1认证符。上述控制器构成为，在从第2主机受理了用来向上述非易失性存储器访问的访问命令的情况下，如果上述访问命令中包含的第2认证符与上述第1认证符一致，则许可向与上述访问命令对应的上述非易失性存储器的访问，如果上述第2认证符与上述第1认证符不一致，则禁止向与上述访问命令对应的上述非易失性存储器的访问。
- 存储器系统
- [发明专利]存储器系统-CN202210120634.5在审
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佐藤贵彦
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华邦电子股份有限公司
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2022-02-09
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2023-08-18
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G06F11/07
- 本发明公开了一种存储器系统。存储器系统包括存储器控制器及半导体存储装置。存储器控制器将指令及地址，以及第一检查数据传送到半导体存储装置；半导体存储装置接收显示没有检测到错误的第一回应信息时，与半导体存储装置之间传送或接收读取或写入的数据。半导体存储装置接收指令及地址，以及第一检查数据时，利用第一检查数据进行指令及地址的错误检测，在没有检测到错误时传送第一回应信息；在指令及地址没有检测到错误时，与存储器控制器之间传送或接收读取或写入的数据本发明可以对半导体存储装置适当地存取。
- 存储器系统
- [发明专利]存储器系统-CN202010905654.4有效
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金到训
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爱思开海力士有限公司
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2020-09-01
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2023-08-11
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G06F3/06
- 本公开涉及一种存储器系统。该存储器系统包括：存储器装置，包括多个段；处理器，被配置成针对与多个段之中的目标段对应的目标段地址生成读取‑修改‑写入(RMW)命令；调度器，被配置成从处理器接收RMW命令并调度RMW命令；以及RMW单元，被配置成根据调度器的控制对存储器装置执行RMW命令，其中当从处理器接收到的多个RMW命令未决时，调度器比较多个RMW命令的目标段地址以对多个RMW命令进行重新排序。
- 存储器系统
- [发明专利]存储器系统-CN201910847002.7有效
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芳贺琢哉;渡边秀一
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铠侠股份有限公司
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2019-09-09
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2023-08-22
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G06F3/06
- 实施方式使存储器系统的动作高速化。实施方式的存储器系统包括半导体存储装置和存储器控制器。存储器控制器具有命令缓冲器和描述符缓冲器。存储器控制器将从外部接收到的第一命令存储在命令缓冲器中，根据所存储的第一命令从主机设备获取第一描述符，将所获取的第一描述符存储在描述符缓冲器中，将从外部接收到的第二命令存储在命令缓冲器中，将未使用的第一描述符的一部分从描述符缓冲器中废弃，根据所存储的第二命令从主机设备获取第二描述符，在存储有所废弃的第一描述符的一部分的地址存储所获取的第二描述符。
- 存储器系统
- [发明专利]存储器系统-CN201910604144.0有效
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崔海起
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爱思开海力士有限公司
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2019-07-05
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2023-08-01
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G06F3/06
- 本发明涉及一种存储器系统，该存储器系统可包括：非易失性存储器装置；易失性存储器，临时存储写入数据；以及控制器，适于：当输入正常写入数据时，在易失性存储器中分配正常写入缓冲器；当输入被分组到第一事务中的第一写入数据和与第一事务的总大小有关的第一总大小信息时，在易失性存储器中分配第一写入缓冲器；当输入被分组到第二事务中的第二写入数据和与第二事务的总大小有关的第二总大小信息时，在易失性存储器中分配第二写入缓冲器；对第一和第二写入缓冲器的大小进行管理以分别响应于第一和第二总大小信息来改变第一和第二写入缓冲器的大小，并且对正常写入缓冲器的大小进行管理以将正常写入缓冲器的大小固定为设定大小。
- 存储器系统
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