[发明专利]半导体集成电路无效
| 申请号: | 89109119.X | 申请日: | 1989-12-08 |
| 公开(公告)号: | CN1022077C | 公开(公告)日: | 1993-09-08 |
| 发明(设计)人: | 理查德·朱利·克立弗;肯尼思·奥斯汀 | 申请(专利权)人: | 皮金顿微电子有限公司 |
| 主分类号: | H03K19/00 | 分类号: | H03K19/00;H03K17/56 |
| 代理公司: | 中国国际贸易促进委员会专利代理部 | 代理人: | 杨晓光 |
| 地址: | 英国默*** | 国省代码: | 暂无信息 |
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| 摘要: | 本发明涉及GBB-2180382中所公开的可构成逻辑电路阵列的半导体集成电路。这种阵列编程可以在其中构成的多个“与非”门(G1)来完成各种不同的逻辑功能。本发明特别涉及在各单元处提供一个可由控制装置(GCS)控制的附加逻辑电路(C),以使逻辑电路和附加逻辑电路(C)完成简单“与非”逻辑功能或简单锁存逻辑功能。 | ||
| 搜索关键词: | 半导体 集成电路 | ||
【主权项】:
1.一种半导体集成电路包括一个形成在所述集成电路的一个区域上的可构成逻辑阵列,该阵列包括:多个分立单元;多个第一逻辑电路分别形成于各分立单元处,每个第一逻辑电路只能完成一个简单逻辑功能;其中,所述多个第一逻辑电路被分成多个不同的组,每个第一逻辑电路有一个在其输入端和另一不同的组的输出端之间延伸的导通通路,以及一个在所述输出端和另一个不同组的输入端之间延伸的导通通路,可以选择各逻辑电路的导通通路的导通状态以构成一个有限的信号传送系统;其特征在于:所述逻辑阵列在各分立单元处包括一个附加逻辑电路,该附加逻辑电路与所述第一逻辑电路以这样一种方式相连,在设置在各单元处的选择装置的控制下,使所述第一逻辑电路单独作用,完成所述第一简单逻辑功能,或与附加逻辑电路一起作用,完成一第二简单逻辑功能。
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