[发明专利]提供时钟给通信实体层中的解串转换器的电路在审
| 申请号： | 202110313682.1 | 申请日： | 2021-03-24 |
| 公开（公告）号： | CN114759915A | 公开（公告）日： | 2022-07-15 |
| 发明（设计）人： | 汪鼎豪;卓廷缙;杨惠婷;方勇胜;毅格艾尔卡诺维奇;阿姆农帕纳斯;林琼麒;蔡明甫 | 申请（专利权）人： | 创意电子股份有限公司;台湾积体电路制造股份有限公司 |
| 主分类号： | H03L7/06 | 分类号： | H03L7/06;H03L7/08 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 宋兴;臧建明 |
| 地址： | 中国台湾新竹市*** | 国省代码： | 台湾;71 |
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| 摘要： | 本公开提供一种提供时钟给通信实体层中的解串转换器的电路。电路包含从属延迟锁相回路(DLL)，以接收输入时钟并向解串转换器提供取样时钟。此外，电路还包含主控延迟锁相回路，以接收输入时钟并将控制信号输出到所述从属延迟锁相回路以调整所述从属延迟锁相回路的取样时钟的延迟量。所述主控延迟锁相回路复制从属延迟锁相回路的电路以及回路检测，以决定要输出的控制信号。 | ||
| 搜索关键词： | 提供 时钟 通信 实体 中的 转换器 电路 | ||
【主权项】：
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