[发明专利]绝缘体上半导体(SOI)衬底及其形成方法、集成电路在审

专利信息
申请号: 202011055346.3 申请日: 2020-09-29
公开(公告)号: CN112582429A 公开(公告)日: 2021-03-30
发明(设计)人: 吴政达;谢佳达;巫国维;张煜群;曾映绫 申请(专利权)人: 台湾积体电路制造股份有限公司
主分类号: H01L27/12 分类号: H01L27/12;H01L23/26;H01L21/84
代理公司: 北京德恒律治知识产权代理有限公司 11409 代理人: 章社杲;李伟
地址: 中国台*** 国省代码: 台湾;71
权利要求书: 暂无信息 说明书: 暂无信息
摘要: 本申请的各个实施例针对一种用于形成具有厚器件层和厚绝缘体层的绝缘体上半导体(SOI)衬底的方法。在一些实施例中,该方法包括形成覆盖处理衬底的绝缘体层,以及在牺牲衬底上外延形成器件层。将牺牲衬底接合到处理衬底,使得器件层和绝缘体层位于牺牲衬底和处理衬底之间,并且去除牺牲衬底。去除包括对牺牲衬底执行蚀刻,直到到达器件层。因为器件层是通过外延形成的并且转移到处理衬底,所以器件层可以形成为具有较大的厚度。此外,因为外延不受绝缘体层的厚度的影响,所以绝缘体层可以形成为具有较大的厚度。本发明的实施例还涉及绝缘体上半导体(SOI)衬底及其形成方法、集成电路。
搜索关键词: 绝缘体 上半 导体 soi 衬底 及其 形成 方法 集成电路
【主权项】:
暂无信息
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