[实用新型]集成电路和包括存储器设备的系统有效
申请号: | 201820412467.0 | 申请日: | 2018-03-26 |
公开(公告)号: | CN208421811U | 公开(公告)日: | 2019-01-22 |
发明(设计)人: | F·塔耶特;M·巴蒂斯塔 | 申请(专利权)人: | 意法半导体(鲁塞)公司 |
主分类号: | G06F13/16 | 分类号: | G06F13/16;G06F12/02 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华;李春辉 |
地址: | 法国*** | 国省代码: | 法国;FR |
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摘要: | 本公开提供集成电路和包括存储器设备的系统。集成电路包括被配置为被连接到I2C总线的电可擦除可编程的非易失性存储器。存储器包括J个硬件标识引脚,其中,J是处于1与3之间的整数,J个硬件标识引脚被配置为接收电压以形成第一代码。集成电路被配置为在寻址存储器平面的第一模式与第二模式之间进行选择,其中,当第一代码等于参考代码时选择第一模式,并且当第一代码不同于参考代码时选择第二模式。在第一模式中,非易失性存储器的存储器平面通过包含于从地址的最后低阶位中和接收的头N个字节中的存储器地址来寻址。在第二模式中,存储器平面通过包含于接收的头N+1个字节中的存储器地址来寻址。 | ||
搜索关键词: | 集成电路 非易失性存储器 存储器地址 存储器平面 存储器设备 参考代码 硬件标识 寻址 引脚 配置 寻址存储器 存储器 电可擦除 接收电压 低阶位 可编程 平面的 中和 | ||
【主权项】:
1.一种集成电路,其特征在于,包括被配置为被连接到I2C总线的电可擦除可编程的非易失性存储器,所述非易失性存储器包括存储器平面和J个硬件标识引脚,其中,J是1与3之间的正整数,所述J个硬件标识引脚被配置为接收电压以形成第一代码,其中,所述集成电路被配置为:接收在所述I2C总线上发送的从地址;在接收所述从地址之后,接收在所述I2C总线上发送的数据字节;以及在寻址所述存储器平面的第一模式与第二模式之间进行选择,其中,当所述第一代码等于参考代码时选择所述第一模式,并且当所述第一代码不同于所述参考代码时选择所述第二模式,其中,所述存储器平面能由n位寻址,n=8*N+M,N为非零正整数,并且M为1与3之间的正整数,并且其中,寻址所述存储器平面的所述第一模式包括通过包含于所述从地址的最后M个低阶位中和接收的头N个数据字节中的存储器地址来寻址所述非易失性存储器的所述存储器平面,并且寻址所述存储器平面的所述第二模式包括通过包含于接收的头N+1个数据字节中的存储器地址来寻址所述非易失性存储器的所述存储器平面。
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