[发明专利]用于高性能标准单元的多过孔结构有效
申请号: | 201780075100.2 | 申请日: | 2017-12-08 |
公开(公告)号: | CN110036477B | 公开(公告)日: | 2020-10-13 |
发明(设计)人: | S·萨哈;X·陈;V·宝娜帕里;H·利姆;M·马拉布里;M·古普塔 | 申请(专利权)人: | 高通股份有限公司 |
主分类号: | H01L27/02 | 分类号: | H01L27/02;H01L23/528;H01L27/118 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华;吕世磊 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: |
一种IC的MOS器件,包括pMOS和nMOS晶体管。MOS器件进一步包括:第一M |
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搜索关键词: | 用于 性能 标准 单元 结构 | ||
【主权项】:
1.一种集成电路(IC)的金属氧化物半导体(MOS)器件,包括:多个p型MOS(pMOS)晶体管,每个pMOS晶体管具有pMOS晶体管栅极、pMOS晶体管漏极和pMOS晶体管源极,每个pMOS晶体管栅极沿第一方向延伸;多个n型MOS(nMOS)晶体管,每个nMOS晶体管具有nMOS晶体管栅极、nMOS晶体管漏极和nMOS晶体管源极,每个nMOS晶体管栅极沿所述第一方向延伸,每个nMOS晶体管栅极与对应的pMOS晶体管栅极通过沿所述第一方向延伸的相同栅极互连形成;第一金属x(Mx)层互连,沿所述第一方向延伸,并且将所述pMOS晶体管漏极耦合到所述nMOS晶体管漏极;第二Mx层互连,沿所述第一方向延伸,并且将所述pMOS晶体管漏极耦合到所述nMOS晶体管漏极,所述第二Mx层互连与所述第一Mx层互连平行;第一金属x+1(Mx+1)层互连,沿与所述第一方向正交的第二方向延伸,所述第一Mx+1层互连被耦合到所述第一Mx层互连和所述第二Mx层互连;以及第二Mx+1层互连,沿所述第二方向延伸,所述第二Mx+1层互连被耦合到所述第一Mx层互连和所述第二Mx层互连,所述第二Mx+1层互连与所述第一Mx+1层互连平行,所述第一Mx+1层互连和所述第二Mx+1层互连是所述MOS器件的输出。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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