[发明专利]半导体器件制备方法有效
| 申请号： | 201710318784.6 | 申请日： | 2017-05-08 |
| 公开（公告）号： | CN107068764B | 公开（公告）日： | 2020-02-18 |
| 发明（设计）人： | 黄秋铭 | 申请（专利权）人： | 上海华力微电子有限公司 |
| 主分类号： | H01L29/78 | 分类号： | H01L29/78;H01L21/28;H01L21/336 |
| 代理公司： | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人： | 智云 |
| 地址： | 201203 上海市*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供一种半导体器件制备方法，利用鳍形沟道结构中掺杂层和非掺杂层的湿法蚀刻速度的差异，蚀刻去除栅极底部结构形成悬空于半导体衬底上方的沟道，形成全包围的栅极结构，在以鳍式场效应晶体管为半导体基体的结构中有效地抑制了短沟道效应、漏场和穿通的问题，提高了半导体器件的性能。 | ||
| 搜索关键词： | 半导体器件 制备 方法 | ||
【主权项】：
一种半导体器件制备方法，所述半导体器件为鳍式场效应晶体管结构，其特征在于，包括以下步骤：步骤一：提供一以鳍式场效应晶体管为半导体基体的半导体衬底，所述半导体衬底上方形成有漏区、源区以及位于所述源区和漏区之间的鳍形沟道区，所述源区、所述漏区和所述鳍形沟道区上表面覆盖掩膜层；步骤二：对步骤一所述的结构进行氧化物层沉积，直至将所述半导体衬底覆盖，使得所述氧化物层上表面与所述掩膜层上表面齐平，去除部分所述氧化物层，被去除的氧化物层的深度大于所述掩膜层的高度；步骤三：对步骤二中暴露出的位于所述掩膜层下方的所述鳍形沟道区进行掺杂外延层的生长，所述掺杂外延层向所述鳍形沟道区两侧水平向生长，接着将所述掩膜层去除，继续去除部分所述氧化物层，被去除的氧化物层的深度小于所述掺杂外延层与半导体衬底之间的高度；步骤四：刻蚀位于两侧掺杂外延层之间的所述鳍形沟道区，直至所述鳍形沟道区的顶部与剩余的所述氧化物层齐平，对所述掺杂外延层沉积导电材料层形成全包围栅极。
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