[发明专利]具有多个CPU模块的PLC系统及其控制方法有效
| 申请号： | 201510277850.0 | 申请日： | 2015-04-14 |
| 公开（公告）号： | CN105022333B | 公开（公告）日： | 2018-01-16 |
| 发明（设计）人： | 李寿康;权大贤 | 申请（专利权）人： | LS产电株式会社 |
| 主分类号： | G05B19/05 | 分类号： | G05B19/05 |
| 代理公司： | 北京金信知识产权代理有限公司11225 | 代理人： | 黄威,董领逊 |
| 地址： | 韩国*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明公开了具有多个CPU模块的PLC系统及其控制方法，其中该方法包括当计数是对应于由主CPU模块分配的时隙的计数时，查明时钟信号，通过访问底板来产生时钟信号，并且在访问底板结束时的时间点结束时钟信号的产生。 | ||
| 搜索关键词： | 具有 cpu 模块 plc 系统 及其 控制 方法 | ||
【主权项】：
PLC系统，包括：第一CPU模块，其被配置为确定被分配以用于指示能访问底板的计数的时隙，并且在分配的时隙访问所述底板；和多个第二CPU模块，其分别在由所述第一CPU模块分配的时隙访问所述底板，其中当访问所述底板时，所述第一CPU模块和所述多个第二CPU模块产生时钟信号，并且所述第一CPU模块和所述多个第二CPU模块中的每一个均包括检测器，所述检测器被配置为检测由访问所述底板的所述第一CPU模块和所述多个第二CPU模块产生的时钟信号，并且其中试图访问所述底板的所述第一CPU模块和所述多个第二CPU模块查明当前计数是否是对应于分配的时隙的计数；当所述当前计数是不对应于所述分配的时隙的计数时，等待预定的时间至对应于所述分配的时隙的时间；当所述当前计数是对应于所述分配的时隙的计数时，查明时钟信号是否存在于所述PLC系统中；当所述当前计数是对应于所述分配的时隙的计数并且所述时钟信号存在于所述PLC系统中时，判定在所述当前计数访问所述底板是不可能的并且等待预定的时间至对应于下一个分配的时隙的时间。
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