[发明专利]具有相干性的芯片堆叠高速缓存扩展有效

专利信息
申请号: 201410498522.9 申请日: 2014-09-25
公开(公告)号: CN104572570B 公开(公告)日: 2017-10-24
发明(设计)人: E·R·科德罗;A·哈里达斯;S·K·潘达;S·赛瑟拉曼;D·B·C·维德亚普尔纳查里 申请(专利权)人: 国际商业机器公司
主分类号: G06F15/167 分类号: G06F15/167
代理公司: 北京市金杜律师事务所11256 代理人: 酆迅
地址: 美国纽*** 国省代码: 暂无信息
权利要求书: 查看更多 说明书: 查看更多
摘要: 发明特别地涉及在处理器芯片的堆叠中的裸片之间高速缓存联合的连接和逻辑使能管理。通过在堆叠中布置裸片以使得故障核心与相邻的良好核心对准,可以在良好核心与故障核心的高速缓存之间实施快速连接。可以根据指派至每个良好核心的优先级由请求的核心与可用高速缓存之间的延迟和/或由核心上负荷来分配高速缓存。
搜索关键词: 具有 相干性 芯片 堆叠 高速缓存 扩展
【主权项】:
一种用于至少两个裸片的半导体器件堆叠的高速缓存管理方法,每个裸片包括至少两个计算装置,每个计算装置包括至少一个核心,每个核心包括本地高速缓存,并且每个裸片包括连接至相应裸片的至少一个核心的至少一个共享高速缓存,所述方法包括:测试每个核心;响应于核心未通过所述测试,将所述核心标识为故障核心;响应于核心通过所述测试,将所述核心标识为良好核心;堆叠所述至少两个裸片,以使得第一裸片的良好核心与至少一个相邻裸片的故障核心对准;以及将每个故障核心的故障核心本地高速缓存连接到至少第一对准的良好核心,以用于主要由所述至少第一对准的良好核心使用。
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