[发明专利]静态存储单元的形成方法有效

专利信息
申请号: 201410172511.1 申请日: 2014-04-25
公开(公告)号: CN105097701B 公开(公告)日: 2017-11-03
发明(设计)人: 三重野文健 申请(专利权)人: 中芯国际集成电路制造(上海)有限公司
主分类号: H01L21/8244 分类号: H01L21/8244
代理公司: 北京集佳知识产权代理有限公司11227 代理人: 应战,骆苏华
地址: 201203 *** 国省代码: 上海;31
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摘要: 一种静态存储单元的形成方法,包括提供半导体衬底,半导体衬底的第一区域上有第一鳍部;在半导体衬底上形成隔离层,隔离层的表面低于第一鳍部的顶部表面;形成第一伪栅结构和第一侧墙;形成介质层,介质层与第一伪栅结构的表面齐平;在介质层和第一伪栅结构表面形成具有第一开口的掩膜层;沿第一开口去除第一伪栅结构,形成第一凹槽,暴露出第一鳍部的部分表面以及位于第一鳍部两侧的隔离层的表面;沿第一开口去除第一凹槽下方的部分厚度的隔离层,形成第二凹槽,暴露出低于隔离层表面的第一鳍部的部分侧壁;形成填充满第一凹槽和第二凹槽的第一栅极结构。上述方法在不增加晶体管面积的前提下提高晶体管的驱动电流。
搜索关键词: 静态 存储 单元 形成 方法
【主权项】:
一种静态存储单元的形成方法,其特征在于,包括:提供半导体衬底,所述半导体衬底包括第一区域,所述第一区域上形成有第一鳍部;在所述半导体衬底上形成隔离层,所述隔离层的表面低于第一鳍部的顶部表面,并且覆盖部分第一鳍部的侧壁表面;在所述隔离层上形成横跨所述第一鳍部的第一伪栅结构以及位于所述第一伪栅结构侧壁表面的第一侧墙;在所述隔离层表面形成介质层,所述介质层与第一伪栅结构的表面齐平;在所述介质层和第一伪栅结构表面形成具有第一开口的掩膜层,所述第一开口暴露出第一伪栅结构的顶部表面;沿所述第一开口去除第一伪栅结构,形成第一凹槽,所述第一凹槽暴露出第一鳍部的部分表面以及位于所述第一鳍部两侧的隔离层的表面;沿所述第一开口去除所述第一凹槽下方的部分厚度的隔离层,形成第二凹槽,所述第二凹槽暴露出低于隔离层表面的第一鳍部的部分侧壁;形成填充满所述第一凹槽和第二凹槽的第一栅极结构。
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