[发明专利]电子电路以及裁定方法无效
| 申请号: | 201310053611.8 | 申请日: | 2013-02-19 |
| 公开(公告)号: | CN103324590A | 公开(公告)日: | 2013-09-25 |
| 发明(设计)人: | 彦野厚志 | 申请(专利权)人: | 株式会社PFU |
| 主分类号: | G06F13/18 | 分类号: | G06F13/18 |
| 代理公司: | 上海市华诚律师事务所 31210 | 代理人: | 徐晓静 |
| 地址: | 日本*** | 国省代码: | 日本;JP |
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| 摘要: | 本发明提高了给予对存储器的访问形式不同的多个存储器主控设备的访问许可的均衡。电子电路(2)包括对存储器(3)访问的存储器主控设备(10)~(13)和裁定存储器主控设备(10)~(13)对存储器(3)的访问的裁定电路(14)。裁定电路(14)进行如下处理:在存储器主控设备(10)~(13)中任一个存储器主控设备对存储器(3)的访问已成功的情况下,降低该存储器主控设备的优先度,并提高其它存储器主控设备的优先度的处理为每个存储器主控设备(10)~(13)根据在过去的规定期间内各自已经进行的对存储器(3)的访问次数来确定优先度的校正量的处理;许可按照加上了校正量的优先度选择到的存储器主控设备对存储器(3)的访问的处理。 | ||
| 搜索关键词: | 电子电路 以及 裁定 方法 | ||
【主权项】:
一种电子电路,其特征在于,具有:多个存储器主控设备,其访问存储器;裁定电路,其裁定所述多个存储器主控设备对所述存储器的访问,所述裁定电路进行如下处理:在所述多个存储器主控设备中任一个存储器主控设备对所述存储器的访问已成功的情况下,降低该任一个存储器主控设备的优先度,并提高其它存储器主控设备的优先度的处理;对每个所述多个存储器主控设备,根据在过去的规定期间内对所述存储器的访问次数来确定所述优先度的校正量的处理;许可按照加上了所述校正量的所述优先度选择到的存储器主控设备对所述存储器的访问的处理。
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