[发明专利]金属互连结构及其制作方法有效
申请号: | 201210477288.2 | 申请日: | 2012-11-21 |
公开(公告)号: | CN103839874A | 公开(公告)日: | 2014-06-04 |
发明(设计)人: | 张城龙;周俊卿;张海洋 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L23/528 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 骆苏华 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种金属互连结构及其制作方法。制作方法包括:提供具有目标电连接区域的半导体衬底;在该半导体衬底自下而上依次形成刻蚀终止层、介电层、Cu3N硬掩膜层;在Cu3N硬掩膜层上定义出用以形成沟槽的条状区域;定义出用以形成通孔的图形化光刻胶;以该图形化光刻胶为掩膜刻蚀介电层以形成通孔;以条状区域的硬掩膜层为掩膜刻蚀介电层以形成沟槽,此时通孔底部的刻蚀终止层暴露;对Cu3N硬掩膜层进行处理形成Cu硬掩膜层,并湿法去除;进行干法去除通孔底部的刻蚀终止层以使半导体衬底的目标电连接区域暴露,并将沟槽开口处的尺寸进行扩大;在通孔及沟槽内填充导电材质。本发明的技术方案,提供了一种无空洞、电连接性能佳的金属互连结构。 | ||
搜索关键词: | 金属 互连 结构 及其 制作方法 | ||
【主权项】:
一种金属互连结构的制作方法,其特征在于,包括:提供具有目标电连接区域的半导体衬底;在所述半导体衬底上形成刻蚀终止层;在所述刻蚀终止层上形成介电层;在所述介电层上形成Cu3N硬掩膜层;在所述Cu3N硬掩膜层上定义出用以形成沟槽的条状区域,去除所述条状区域外的Cu3N硬掩膜层;利用光刻工艺在保留的Cu3N硬掩膜层上定义出用以形成通孔的图形化光刻胶,定义的所述通孔位于所述保留的Cu3N硬掩膜层的相邻条状区域之间;以所述图形化光刻胶为掩膜刻蚀所述介电层以形成通孔;以所述条状区域的Cu3N硬掩膜层为掩膜刻蚀所述介电层以形成沟槽,所述通孔底部的刻蚀终止层暴露;对所述Cu3N硬掩膜层进行处理形成Cu硬掩膜层,并湿法去除;干法去除所述通孔底部的刻蚀终止层以使半导体衬底的目标电连接区域暴露,并将所述沟槽开口处的尺寸进行扩大;在所述通孔及所述沟槽内填充导电材质。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造