[发明专利]可编程控制器的CPU单元以及可编程控制器的CPU单元执行的方法有效

专利信息
申请号: 201180068878.3 申请日: 2011-03-22
公开(公告)号: CN103430109B 公开(公告)日: 2016-10-12
发明(设计)人: 西山佳秀;滨崎治;江口重行 申请(专利权)人: 欧姆龙株式会社
主分类号: G05B19/05 分类号: G05B19/05;G06F13/38
代理公司: 北京市柳沈律师事务所 11105 代理人: 胡金珑
地址: 日本*** 国省代码: 日本;JP
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摘要: 一种微处理器,控制第1通信电路以及第2通信电路之中的至少一方,以便并行执行以下处理:第1输入输出处理,包含将输出数据从第1转发缓冲器经过第1通信电路输出至PLC系统总线上的第1设备的处理、和将输入数据从第1设备经过第1通信电路输入至第1转发缓冲器的处理;以及第2输入输出处理,包含将输出数据从第2转发缓冲器经过第2通信电路输出至现场网络上的第2设备的处理、和将输入数据从第2设备经过第2通信电路输入至第2转发缓冲器的处理。
搜索关键词: 可编程控制器 cpu 单元 以及 执行 方法
【主权项】:
一种对控制对象进行控制的PLC的CPU单元,具备:微处理器;存储部件,包含所述微处理器的主存储器;第1通信电路,通过PLC系统总线进行第1输出数据的发送以及第1输入数据的接收;以及第2通信电路,通过现场网络进行第2输出数据的发送以及第2输入数据的接收,所述PLC的CPU单元通过重复所述第1输出数据以及所述第2输出数据的发送、所述第1输入数据以及所述第2输入数据的接收、以及使用所述第1输入数据以及所述第2输入数据而生成所述第1输出数据以及所述第2输出数据的控制模块的执行对所述控制对象进行控制,所述存储部件用于所述控制模块、系统模块的存储,所述微处理器执行存储于所述存储部件的所述系统模块以及所述控制模块,所述系统模块执行在所述主存储器上生成以下缓冲器的步骤:运算缓冲器,伴随所述控制模块的执行读出所述第1输入数据以及所述第2输入数据,同时写入所述第1输出数据以及所述第2输出数据;第1转发缓冲器,存储通过所述PLC系统总线被发送的第1输出数据以及被接收的第1输入数据;以及第2转发缓冲器,存储通过所述现场网络被发送的第2输出数据以及被接收的第2输入数据,所述系统模块进一步执行以下步骤:控制所述控制模块的执行的步骤;以及控制所述第1输入数据、所述第2输入数据、所述第1输出数据以及所述第2输出数据的输入输出的步骤,所述微处理器通过执行所述系统模块控制以下处理的执行:输出复制处理,将所述第1输出数据从所述运算缓冲器复制至所述第1转发缓冲器,同时将所述第2输出数据从所述运算缓冲器复制至所述第2转发缓冲器;以及输入复制处理,将所述第1输入数据从所述第1转发缓冲器复制至所述运算缓冲器,同时将所述第2输入数据从所述第2转发缓冲器复制至所述运算缓冲器,所述微处理器通过执行所述系统模块,控制所述第1通信电路以及所述第2通信电路之中的至少一方,以便以下处理并行执行:第1输入输出处理,包含将所述第1输出数据从所述第1转发缓冲器经过所述第1通信电路输出至所述PLC系统总线上的第1设备的处理、和将所述第1输入数据从所述第1设备经过所述第1通信电路输入至所述第1转发缓冲器的处理;以及第2输入输出处理,包含将所述第2输出数据从所述第2转发缓冲器经过所述第2通信电路输出至所述现场网络上的第2设备的处理、和将所述第2输入数据从所述第2设备经过所述第2通信电路输入至所述第2转发缓冲器的处理。
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