[发明专利]自对准分裂栅非易失存储器结构及其制造方法无效
申请号: | 200510065634.6 | 申请日: | 2005-02-04 |
公开(公告)号: | CN1661784A | 公开(公告)日: | 2005-08-31 |
发明(设计)人: | 田喜锡;尹胜范;金龙泰 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/8234;H01L21/8239;H01L29/788;H01L27/10 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 陶凤波;侯宇 |
地址: | 韩国*** | 国省代码: | 韩国;KR |
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摘要: | 提供了具有自对准的浮栅和控制栅结构的非易失分裂栅存储器单元和用于制造该存储器单元的示例性工艺,其对于分裂栅元件的相对长度和间隔提供了改善的尺寸控制。每个控制栅包括在相关浮栅的至少一部分的上方延伸的突出部分,该突出部分的尺寸由第一牺牲多晶硅间隙壁确定,当其被除去时,在中间绝缘结构中产生凹陷区域。然后形成控制栅以作为与中间绝缘结构相邻的多晶硅间隙壁,延伸到凹陷区域中的间隙壁部分决定了突出部分的尺寸和间隔以及将分裂栅电极的上部隔开的多晶硅间氧化物的厚度,由此提供改善的性能和可制造性。 | ||
搜索关键词: | 对准 分裂 栅非易失 存储器 结构 及其 制造 方法 | ||
【主权项】:
1.一种形成分裂栅晶体管的方法,包括依次的以下步骤:a)形成绝缘结构,该绝缘结构具有带有凹陷区域和突出区域的侧壁表面,所述突出区域位于所述凹陷区域的下面;b)使用所述绝缘结构的突出区域作为蚀刻掩模,蚀刻半导体层以形成浮栅结构;c)在所述浮栅结构上形成绝缘层以形成包括所述浮栅结构并具有侧表面的中间绝缘结构,该侧表面包括凹陷区域;以及d)形成与所述中间绝缘结构相邻的控制栅结构,其中所述控制栅结构与所述侧表面相符并包括在所述浮栅结构的一部分的上方延伸的突出部分。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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