[发明专利]利用算术处理器的数字基本增强器无效
| 申请号： | 02102053.1 | 申请日： | 2002-01-18 |
| 公开（公告）号： | CN1366383A | 公开（公告）日： | 2002-08-28 |
| 发明（设计）人： | 廉旺燮 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | H03L7/00 | 分类号： | H03L7/00 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 马莹,邵亚丽 |
| 地址： | 韩国*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明提供了一种利用算术处理器减少硬件的数字基本增强器(DBB)。不是利用具有包括数个分积木式模块的级联结构的传统IIR滤波器,利用算术处理器的数字基本增强器包括第一内部数据、输入部分、数据指定器、算术部分和输出数据存储器件。第一内部数据是算术部分的输出数据。输入部分包括数个多位寄存器,从而存储输入数据和第一内部数据,并以预定信号的形式输出存储的数据。数据指定器从输入部分的数组输出数据中选择一组输出数据。算术部分对数据指定器的输出数据和存储在算术部分中的数据进行算术运算,补偿和存储算术运算得出的数据的舍入误差,并输出第一内部数据;输出数据存储器件存储和输出在算术部分中处理过的数据。 | ||
| 搜索关键词： | 利用 算术 处理器 数字 基本 增强 | ||
【主权项】：
1.一数字基本增强器(DBB)，包括：输入部分，包括对输入数据和第一内部数据作出响应的数个多位寄存器；数据指定器，用于从输入部分的数组输出数据中选择一组输出数据；算术部分，用于对数据指定器的输出数据和存储在算术部分中的数据进行算术运算，补偿算术运算得出的数据的舍入误差，存储补偿结果和输出第一内部数据；和输出数据存储器件，用于存储在算术部分中处理的数据。
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