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专利名称

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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]用于提高指令执行的效率的方法、处理器和存储介质-CN201410094185.7有效
发明人：王前;R·苏德哈喀 -专利权人： MIPS技术公司
申请日： 2014-03-14 - 公布日： 2019-03-26 - 主分类号： G06F9/30 文献下载
摘要：本公开涉及一种超级前送处理器。所公开的方法和系统使得处理器能够有效果且有效率地减少或消除与将一个寄存器的值复制到另一个寄存器的指令有关的等待时间。处理器包括超级前送表、超级前送逻辑块和计算引擎。超级前送表存储条目，其中条目具有有效位、键字段和前送字段。超级前送逻辑块确定哪个寄存器含有指令所需的信息。计算引擎执行指令。
超级处理器

[发明专利]具有高效返回预测能力的分支目标缓冲器-CN201410069516.1有效
发明人： P·博塔;S·帕塔尔 -专利权人： MIPS技术公司
申请日： 2014-02-28 - 公布日： 2018-06-15 - 主分类号： G06F9/38 文献下载
摘要：提供具有高效返回预测能力的分支目标缓冲器，并提供改善的分支目标缓冲器（BTB）和在具有流水线的微处理器中处理数据的方法。根据各种实施例，提供包含非返回缓冲器、返回缓冲器和多路复用器的BTB。非返回缓冲器被设计为存储多个非返回条目。各非返回条目与非返回型指令对应。返回缓冲器被设计为存储分别与返回型指令对应的多个返回条目。另外，返回缓冲器可产生控制信号。多路复用器也产生控制信号并输出来自非返回缓冲器的数据或者来自返回预测栈（RPS）的数据。多路复用器是从非返回缓冲器还是从RPS返回数据依赖于控制信号。 1
返回缓冲器分支目标缓冲器多路复用器条目产生控制信号预测能力存储指令微处理器处理数据返回数据控制信号流水线与非输出预测

[发明专利]用于存储器操作绑定的装置和方法-CN201410082072.5有效
发明人： R·苏德哈喀 -专利权人： MIPS技术公司
申请日： 2014-03-07 - 公布日： 2018-01-02 - 主分类号： G06F13/16 文献下载
摘要：本发明公开了一种用于存储器操作绑定的装置和方法。处理器被配置为评估存储器操作绑定标准，以选择性地识别存储器访问计划内的存储器操作绑定机会。响应于所述存储器操作绑定机会，存储器操作被合并，以形成具有加速的存储器访问的修改的存储器访问计划。
用于存储器操作绑定装置方法

[发明专利]针对多数据体系结构的精确的异常信号发送-CN201410102598.5在审
发明人： I·盖巴西亚;J·罗宾森 -专利权人： MIPS技术公司
申请日： 2014-02-21 - 公布日： 2014-08-27 - 主分类号： G06F11/00 文献下载
摘要：本申请涉及针对多数据体系结构的精确的异常信号发送。提供了利用多数据处理单元处理器对多个元素执行一个或多个操作的方法和系统。处理器接收包含多个元素的输入矢量。所述处理器判断对第一元素执行第一操作是否会导致异常，如果是，则向输出寄存器中存储的输出矢量的第一部分写入由所述第一操作导致的异常的指示。对第二元素可以执行第二操作，第二操作的结果被写入存储在输出寄存器中的输出矢量的第二部分。
针对多数体系结构精确异常信号发送

[发明专利]用于自动硬件中断处理的系统和方法-CN201110214684.1无效
发明人： E·K·诺登;D·Y-M·拉尤;J·H·罗宾森 -专利权人： MIPS技术公司
申请日： 2011-07-29 - 公布日： 2012-02-08 - 主分类号： G06F9/48 文献下载
摘要：本发明公开了用于自动硬件中断处理的系统和方法。提供了一种处理系统，其包括中断引脚、多个寄存器、堆栈指针和自动中断系统。所述多个寄存器存储多个处理器状态值。当所述系统在所述中断引脚上检测到中断时，所述系统准备进入异常模式，其中自动中断系统使得中断向量被获取，堆栈指针被更新，并且在执行中断服务例程之前，处理器状态值被从寄存器并行地读取并基于更新的堆栈指针存储在存储器位置中。还提供了用于自动硬件中断处理的方法。
用于自动硬件中断处理系统方法

[发明专利]用于改进存储器传输的系统和方法-CN201080005211.4有效
发明人： K·R·基肖雷;K·D·基塞尔;G·Z·贝罗伊夫 -专利权人： MIPS技术公司
申请日： 2010-01-21 - 公布日： 2011-12-28 - 主分类号： G06F9/315 文献下载
摘要：本发明涉及用于执行高带宽的存储器复制的系统和方法。存储器传输指令允许将来自第一存储器位置的数据复制到第二存储器位置而不使用加载和存储字指令，从而实现高带宽复制。在一个实施例中，该方法包括：步骤(1)对来自第一存储器传输指令的目的地地址解码，(2)将目的地地址存储在总线接口单元中的寄存器中，(3)对来自第二存储器传输指令的源地址解码，以及(4)将由源存储器地址指定的存储器位置的内容复制到由寄存器的内容指定的存储器位置。还提出了其他方法和微处理器系统。
用于改进存储器传输系统方法

[发明专利]具有紧凑指令集架构的微处理器-CN201110128200.1无效
发明人： E·K·诺登;J·H·罗宾森;D·Y-M·拉尤 -专利权人： MIPS技术公司
申请日： 2011-03-25 - 公布日： 2011-09-28 - 主分类号： G06F9/30 文献下载
摘要：一种重新编码指令集架构(ISA)，其提供了较小位宽指令或较小或较大位宽指令的组合，以提高指令执行效率并减少代码足印。该ISA可重新编码自一个具有较大位宽指令的传统ISA，并且该重新编码的ISA能够维持与其来自的ISA在汇编级别的兼容性。此外，该重新编码的ISA可具有新的和不同的附加指令类型，包括具有由统计分析确定的编码自变量的指令以及具有指令组合效果的指令。
具有紧凑指令架构微处理器

[发明专利]具有紧凑指令集架构的微处理器-CN200980124104.0无效
发明人： E·K·诺登 -专利权人： MIPS技术公司
申请日： 2009-05-08 - 公布日： 2011-05-25 - 主分类号： G06F15/76 文献下载
摘要：一种重新编码的指令集架构(ISA)提供了较小位宽的指令或者较小和较大位宽的指令的组合，以提高指令执行效率和减小代码足印。该ISA可以从具有较大位宽的指令的传统ISA重新编码而得到，并且可以用于统一一个或更多个ISA扩展(诸如，应用专用ASE)。重新编码的ISA维持与从其得到该重新编码的ISA的ISA的汇编级兼容性。此外，重新编码的ISA可以具有新的和不同类型的另外的指令。
具有紧凑指令架构微处理器

[发明专利]低开销/省电处理器同步机制及其应用-CN200880104604.3无效
发明人： N·J·斯蒂芬斯 -专利权人： MIPS技术公司
申请日： 2008-08-29 - 公布日： 2010-07-28 - 主分类号： G06F7/38 文献下载
摘要：本发明提供了低开销/省电处理器同步机制及其应用。在一个实施例中，本发明提供了一种具有链接加载寄存器的处理器并且执行与链接加载寄存器有关的指令。第一指令使得处理器将由第一指令指定的第一值加载到寄存器文件的第一寄存器内并且将第二值加载到链接加载寄存器内。第二指令使得处理器在链接加载寄存器内的第二值未被改变的情况下暂停与链接加载寄存器关联的指令流的执行，直到链接加载寄存器内的第二值被改变。第三指令使得处理器有条件地将第三值移动到由第三指令指定的存储器位置并且将表示链接加载寄存器的状态的值移动到第三寄存器。
开销处理器同步机制及其应用

[发明专利]数据高速缓存虚拟提示路线预测及其应用-CN200780042526.4有效
发明人：梦冰·于;E·K·南贾;M·尼;V·拉杰戈帕兰 -专利权人： MIPS技术公司
申请日： 2007-09-28 - 公布日： 2009-10-14 - 主分类号： G06F12/00 文献下载
摘要：本发明提供一种基于数据高速缓存路线预测方案的虚拟提示及其应用。在一个实施例中，处理器基于虚拟提示值或混叠路线预测值从数据高速缓存取出数据，并且在用于该数据的物理地址可用之前将该数据转送到相关的指令。在物理地址可用之后，将物理地址与转送的数据的物理地址标记值进行比较，以验证该转送的数据是正确数据。如果该转送的数据是正确数据，则生成命中信号。如果该转送的数据不是正确数据，则生成未中信号。对不正确的数据进行运算的任何指令被无效和/或重放。
数据高速缓存虚拟提示路线预测及其应用

[发明专利]用于多线程处理器中自动低功率模式调用的装置和方法-CN200680016774.7有效
发明人：达伦·M·约纳斯 -专利权人： MIPS技术公司
申请日： 2006-03-28 - 公布日： 2009-09-23 - 主分类号： G06F1/00 文献下载
摘要：一种处理器，包括执行多个线程的处理器内核。分叉的线程调度器包括内部处理器内核部件和外部处理器内核部件。该所述分叉的线程调度器识别何时多个线程的全部被阻断，并在此之后自动进入默认的低功率休眠模式。
用于多线程处理器自动功率模式调用装置方法

[发明专利]用于处理器的加载/存储单元及其应用-CN200780043374.X有效
发明人：梦冰·于;E·K·南贾;M·尼 -专利权人： MIPS技术公司
申请日： 2007-09-28 - 公布日： 2009-09-23 - 主分类号： G06F7/38 文献下载
摘要：用于处理器的加载/存储单元及其应用。在一个实施例中，加载/存储单元包括被配置用于存储与特定类别的指令相关联的信息和数据的加载/存储队列。存储在加载/存储队列中的数据可以被旁路到相关指令。当属于特定类别指令的指令完毕并且该指令与高速缓存未中相关联时，控制逻辑使指针被存储在加载/存储完毕缓存器中，该指针指向与该指令相关联的加载/存储队列中的条目。该加载/存储完毕缓存器确保完毕的指令按程序次序访问加载/存储单元的共享资源。
用于处理器加载存储单元及其应用

[发明专利]两次发布的条件移动指令及其应用-CN200780041776.6无效
发明人： K·R·基肖尔;兴宇·江;V·拉杰戈帕兰;M·尤坎瓦 -专利权人： MIPS技术公司
申请日： 2007-09-28 - 公布日： 2009-09-16 - 主分类号： G06F9/00 文献下载
摘要：公开了一种通过形成并处理两个解码的指令在处理器中实现的条件移动指令及其应用。在一个实施例中，条件移动指令指定第一源操作数、第二源操作数以及既是源又是目的地的第三操作数。如果第二操作数的值与指定值不相等，则第一解码的指令将第三操作数移动到完成缓冲寄存器。如果第二操作数的值与指定值相等，则第二解码的指令将第一操作数的值移动到所述完成缓存器。在执行了该移动的解码的指令完毕时，完成缓冲寄存器的内容被传送到由第三操作数指定的寄存器堆寄存器。
两次发布条件移动指令及其应用

[发明专利]具有减小数据高速缓存访问功率的微标签阵列的处理器及其应用-CN200780036981.3有效
发明人： R·C·金特;M·科诺斯 -专利权人： MIPS技术公司
申请日： 2007-08-15 - 公布日： 2009-09-02 - 主分类号： G06F12/00 文献下载
摘要：一种具有减小数据高速缓存访问功率的微标签阵列的处理器和系统。该处理器和系统包括具有多个dataram、处理器流水线寄存器(402)和微标签阵列(410)。该微标签阵列被耦合到该高速缓存和处理器流水线寄存器。该微标签阵列存储基址数据位或基址寄存器数据位、偏移数据位、进位位以及路选数据位。当取出LOAD或STORE指令时，指令的至少部分基址和至少部分偏移与该微标签阵列中存储的数据比较。如果发生微标签阵列命中，那么该微标签阵列产生高速缓存dataram使能信号。该信号仅仅使能高速缓存的单个dataram。
具有减小数据高速缓存访问功率标签阵列处理器及其应用

[发明专利]利用精简指令状态描述符追踪指令的装置和方法-CN200780035943.6无效
发明人： E·L·埃德加;R·泰卡特 -专利权人： MIPS技术公司
申请日： 2007-09-17 - 公布日： 2009-08-26 - 主分类号： G06F7/38 文献下载
摘要：一种追踪处理器指令的方法，包括依照精简指令状态描述符来表征处理器状态变化。使用处理器指令追踪所述精简指令状态描述符，但并不追踪处理器数据。
利用精简指令状态描述追踪装置方法

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