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[发明专利]用于8位浮点矩阵点积指令的装置、方法和系统-CN202310859375.2在审
发明人： N·梅勒普迪;A·F·海内克;R·凡伦天;M·J·查尼;C·J·休斯;E·吉奥加纳斯;Z·司珀勃;A·格雷德斯廷;S·卢巴诺维奇 -专利权人：英特尔公司
申请日： 2021-12-08 - 公布日： 2023-10-13 - 主分类号： G06F9/38 文献下载
摘要：本申请公开了用于8位浮点矩阵点积指令的装置、方法和系统。描述了涉及8位浮点矩阵点积指令的系统、方法和装置。处理器实施例包括：取出电路，用于取出指令，该指令具有用于指定操作码和具有单精度元素的目的地矩阵的位置、第一源矩阵的位置和第二源矩阵的位置的字段，源矩阵具有各自包括8位浮点值的四元组的元素，该操作码用于指示执行电路用于引起：对于第一源矩阵的每个元素和第二源矩阵的对应元素，将8位浮点值转换为单精度值，将不同对的经转换的单精度值相乘以生成多个结果，并且将结果与目的地矩阵的对应元素的先前内容累加；解码电路，用于对所取出的指令解码；以及执行电路，用于如操作码所指定地对经解码的指令作出响应。
用于浮点矩阵指令装置方法系统

[发明专利]浮点舍入处理器、方法、系统和指令-CN201810527017.0有效
发明人： J·C·三额詹;C·S·安德森;R·凡伦天;B·L·托尔;A·格雷德斯廷;S·卢巴诺维奇;B·艾坦 -专利权人：英特尔公司
申请日： 2011-12-22 - 公布日： 2023-08-22 - 主分类号： G06F9/30 文献下载
摘要：一方面，方法包括接收浮点舍入指令。浮点舍入指令指示一个或多个浮点数据元素的源，指示小数点之后一个或多个浮点数据元素中的每一个被舍入至的分数位的数量，并且指示目的地存储位置。响应于浮点舍入指令，结果被存储在目的地存储位置中。结果包括一个或多个经舍入的结果浮点数据元素。一个或多个经舍入的结果浮点数据元素中的每一个包括源中相应的位置中已经被舍入到所指示数量的分数位的浮点数据元素中的一个。公开了其它方法、装置、系统和指令。
浮点处理器方法系统指令

[发明专利]微操作的自适应动态分派-CN202211603154.0在审
发明人： O·贝特阿哈龙;Z·斯波伯;G·贝格;A·格雷德斯廷;N·哈森 -专利权人：英特尔公司
申请日： 2022-12-13 - 公布日： 2023-06-27 - 主分类号： G06F9/50 文献下载
摘要：公开了用于微操作的自适应动态分派的装置、方法和系统的实施例。在实施例中，装置包括多个冗余执行单元、分派器、控制硬件、第一计数器和第二计数器。分派器用于将微操作分派至多个冗余执行单元中的一个或多个冗余执行单元，该微操作具有多个微操作类型。第一计数器用于在窗口期间生成对具有多个微操作类型中的第一类型的微操作的分派的第一计数。第二计数器用于在该窗口期间生成对具有多个微操作类型中的任何类型的微操作的分派的第二计数。控制硬件用于部分基于第一计数和第二计数来导致第一模式和第二模式之间的切换。在第一模式下，分派器用于将具有第一类型的微操作仅分派至多个冗余执行单元的子集。在第二模式下，分派器用于将具有第一类型的微操作分派至多个冗余执行单元中的所有冗余执行单元。
操作自适应动态分派

[发明专利]用于16比特浮点矩阵点积指令的装置、方法和系统-CN202180052812.9在审
发明人： A·F·海内克;R·凡伦天;M·J·查尼;M·阿德尔曼;C·J·休斯;E·吉奥加纳斯;Z·斯波伯;A·格雷德斯廷;S·卢巴诺维奇 -专利权人：英特尔公司
申请日： 2021-08-26 - 公布日： 2023-05-09 - 主分类号： G06F9/30 文献下载
摘要：描述涉及16比特浮点矩阵点积指令的系统、方法和装置。在一个实施例中，处理器包括：取得电路，取得单个指令，具有指定操作码以及具有单精度元素的M×N的目的地矩阵、M×K的第一源矩阵和K×N的第二源矩阵的位置的字段，源矩阵具有各自包括一对半精度浮点值的元素，操作码指示执行电路：对于第一源矩阵的每个元素和第二源矩阵的对应元素，使半精度浮点值转换为单精度值，使来自对中的第一值的经转换的单精度值一起相乘生成第一结果，使来自对中的第二值的经转换的单精度值一起相乘生成第二结果，以及使第一结果和第二结果与目的地矩阵的对应元素的先前内容累加；解码电路，对取得的指令解码；以及执行电路，如操作码指定地响应经解码的指令。
用于 16 比特浮点矩阵指令装置方法系统

[发明专利]BFLOAT16分类和操纵指令-CN202210906480.2在审
发明人： M·阿德尔曼;A·海内克;R·凡伦天;Z·斯波伯;A·格雷德斯廷;M·查尼;E·吉奥加纳斯;D·卡拉姆卡;C·休斯;C·安德森 -专利权人：英特尔公司
申请日： 2022-07-29 - 公布日： 2023-04-04 - 主分类号： G06F9/30 文献下载
摘要：本申请公开了BFLOAT16分类和操纵指令。描述了用于使用单个指令进行BF16分类或操纵的技术。示例性指令包括用于以下各项的字段：操作码、紧缩数据源操作对象的位置的标识、要执行的一个或多个分类检查的指示、以及紧缩数据目的地操作对象的标识，其中，操作码用于指示出执行电路要进行：针对紧缩数据源操作对象的每个数据元素位置、根据所指示的一个或多个分类检查来执行分类，以及将分类的结果存储在目的地操作对象的对应数据元素位置中。
bfloat16 分类操纵指令

[发明专利]用于16比特浮点矩阵点积指令的装置、方法和系统-CN202211025708.3在审
发明人： M·阿德尔曼;R·凡伦天;D·鲍姆;A·格雷德斯廷;S·卢巴诺维奇;R·舍米;Z·司珀勃;A·海内克;C·休斯;E·吉奥加纳斯;M·查尼;A·纳尔基斯;R·拉波波特;B·济夫;Y·波拉克;N·贾殷;Y·阿克豪里;B·加内什;R·普尔纳查得兰;G·布杜赫 -专利权人：英特尔公司
申请日： 2022-08-25 - 公布日： 2023-03-31 - 主分类号： G06F17/16 文献下载
摘要：本申请公开了用于16比特浮点矩阵点积指令的装置、方法和系统。系统、方法和装置涉及基于稀疏度的FMA。在一些示例中，单个FMA指令的实例具有用于操作码的一个或多个字段、用于标识源/目的地矩阵操作对象的一个或多个字段、用于标识第一多个源矩阵操作对象的一个或多个字段、用于标识第二多个矩阵操作对象的一个或多个字段，其中，操作码用于指示出执行电路要进行：基于来自第二多个矩阵操作对象中的第一矩阵操作对象的稀疏度控制，从第一多个源矩阵操作对象选择数据元素的适当子集；以及执行FMA。
用于 16 比特浮点矩阵指令装置方法系统

[发明专利]针对每个矩阵维度的多个片的矩阵操作-CN202211128959.4在审
发明人： M·阿德尔曼;A·格雷德斯廷;S·卢巴诺维奇 -专利权人：英特尔公司
申请日： 2022-09-16 - 公布日： 2023-03-28 - 主分类号： G06F7/523 文献下载
摘要：公开了针对每个矩阵维度的多个片的矩阵操作。一种装置的实施例包括脉动阵列和电路系统，该脉动阵列用于对两个输入片执行矩阵操作以产生输出片结果，该电路系统耦合到脉动阵列，用于使脉动阵列响应于单个请求而对每个矩阵维度的多于一个的片执行相应的全矩阵操作。公开并要求保护其他实施例。
针对每个矩阵维度多个片操作

[发明专利]BFLOAT16比较指令-CN202210908963.6在审
发明人： A·海内克;M·阿德尔曼;R·凡伦天;Z·斯波伯;A·格雷德斯廷;M·查尼;E·吉奥加纳斯;D·卡拉姆卡;C·休斯;C·安德森 -专利权人：英特尔公司
申请日： 2022-07-29 - 公布日： 2023-03-03 - 主分类号： G06F9/30 文献下载
摘要：本申请公开了BFLOAT16比较指令。描述了用于比较BF16数据元素的技术。示例性BF16指令包括用于以下各项的字段：操作码、第一紧缩数据源操作对象的位置的标识、以及第二紧缩数据源操作对象的位置的标识，其中，操作码用于指示出执行电路要进行：针对紧缩数据源操作对象的特定数据元素位置执行该位置处的数据元素的比较，以及基于该比较来更新标志寄存器。
bfloat16 比较指令

[发明专利]BFLOAT16平方根和/或平方根倒数指令-CN202210908969.3在审
发明人： M·阿德尔曼;A·海内克;R·凡伦天;Z·斯波伯;A·格雷德斯廷;M·查尼;E·吉奥加纳斯;D·卡拉姆卡;C·休斯;C·安德森 -专利权人：英特尔公司
申请日： 2022-07-29 - 公布日： 2023-03-03 - 主分类号： G06F9/30 文献下载
摘要：本申请公开了BFLOAT16平方根和/或平方根倒数指令。描述了用于响应于指令而对BF16数据元素执行平方根或平方根倒数计算的技术。指令的示例是这样的指令：该指令具有用于以下各项的字段：操作码、紧缩数据源操作对象的位置的标识、以及紧缩数据目的地操作对象的标识，其中，操作码用于指示出执行电路要进行：针对紧缩数据源操作对象的每个数据元素位置执行该位置中的BF16数据元素的平方根值的计算，以及将每个平方根的结果存储到紧缩数据目的地操作对象的对应数据元素位置中。
bfloat16 平方根倒数指令

[发明专利]BFLOAT16融合乘法指令-CN202210906473.2在审
发明人： A·海内克;M·阿德尔曼;R·凡伦天;Z·斯波伯;A·格雷德斯廷;M·查尼;E·吉奥加纳斯;D·卡拉姆卡;C·休斯;C·安德森 -专利权人：英特尔公司
申请日： 2022-07-29 - 公布日： 2023-03-03 - 主分类号： G06F9/30 文献下载
摘要：本申请公开了BFLOAT16融合乘法指令。描述了用于响应于指令而执行BF16FMA的技术。在一些示例中，指令包括用于以下各项的字段：操作码、紧缩数据源/目的地操作对象(第一源)的位置的标识、第二紧缩数据源操作对象的位置的标识、第三紧缩数据源操作对象的位置的标识、以及紧缩数据源/目的地操作对象的位置的标识，其中，操作码用于指示出操作对象排序并且指示出执行电路要进行：针对每一数据元素位置使用第一、第二和第三源操作对象执行BF16值融合乘法‑累加操作，以及将结果存储在源/目的地操作对象的对应数据元素位置中。
bfloat16 融合乘法指令

[发明专利]BFLOAT16算术指令-CN202210906476.6在审
发明人： A·海内克;M·阿德尔曼;R·凡伦天;Z·斯波伯;A·格雷德斯廷;M·查尼;E·吉奥加纳斯;D·卡拉姆卡;C·休斯;C·安德森 -专利权人：英特尔公司
申请日： 2022-07-29 - 公布日： 2023-03-03 - 主分类号： G06F9/30 文献下载
摘要：本申请公开了BFLOAT16算术指令。描述了用于对BF16值执行算术操作的技术。示例性指令包括用于以下各项的字段：操作码、第一紧缩数据源操作对象的位置的标识、第二紧缩数据源操作对象的位置的标识、以及紧缩数据目的地操作对象的位置的标识，其中，操作码用于指示出算术操作执行电路要进行：针对所标识的紧缩数据源操作对象的每个数据元素位置、按BF16格式对该数据元素位置中的BF16数据元素执行算术操作，以及将每个算术操作的结果存储到所标识的紧缩数据目的地操作对象的对应数据元素位置中。
bfloat16 算术指令

[发明专利]用于针对矩阵乘法指令的指令的装置、方法和系统-CN202210724294.7在审
发明人： M·阿德尔曼;R·凡伦天;Z·斯波比尔;A·格雷德斯廷;S·卢巴诺维奇;S·梅勒;C·休斯;E·吉奥加纳斯;A·海内克;M·查尼 -专利权人：英特尔公司
申请日： 2022-06-23 - 公布日： 2022-12-27 - 主分类号： G06F9/30 文献下载
摘要：本申请公开了用于针对矩阵乘法指令的指令的装置、方法和系统。描述了用于矩阵乘法的技术。在一些示例中，解码电路用于对单条指令进行解码，该单条指令具有用于以下各项的字段：操作码、第一源操作数的位置的指示、第二源操作数的位置的指示、以及目的地操作数的位置的指示，其中，操作码用于指示执行电路至少用于：将第一和第二源操作数的数据元素从第一浮点表示转换为第二浮点表示，利用经转换的数据元素执行矩阵乘法，以及按第一浮点表示将矩阵乘法的结果累加在目的地操作数中；并且执行电路用于按操作码所指定来执行经解码的指令。
用于针对矩阵乘法指令装置方法系统

[发明专利]浮点缩放处理器、方法、系统和指令-CN201810437268.X有效
发明人： C·S·安德森;A·格雷德斯廷;R·凡伦天;S·卢巴诺维奇;B·艾坦 -专利权人：英特尔公司
申请日： 2011-12-28 - 公布日： 2022-09-13 - 主分类号： G06F9/30 文献下载
摘要：一方面的一种方法包括接收浮点缩放指令。浮点缩放指令指示包括一个或多个浮点数据元素的第一源、包括一个或多个相应浮点数据元素的第二源、以及目的地。响应于浮点缩放指令，将结果存储在目的地中。结果包括一个或多个相应结果浮点数据元素，每个结果浮点数据元素都包括第二源的相应浮点数据元素乘以第一源的一个或多个浮点数据元素的基数的代表第一源的相应浮点数据元素的整数次幂。公开了其它方法、装置、系统和指令。
浮点缩放处理器方法系统指令

[发明专利]用于产生整数序列的处理器、处理器核及系统-CN201810490911.5有效
发明人： S·阿布拉罕;E·乌尔德-阿迈德-瓦尔;R·凡伦天;Z·斯波伯;A·格雷德斯廷 -专利权人：英特尔公司
申请日： 2011-12-22 - 公布日： 2022-08-02 - 主分类号： G06F9/06 文献下载
摘要：本申请涉及用于产生整数序列的处理器、处理器核及系统。根据实施例，一方面的方法包括接收指令。该指令指示整数跨度，指示整数偏移量，并指示目的地存储位置。响应于该指令，结果被存储在目的地存储位置中。该结果包括按照数值顺序的至少四个整数的序列，其中所述至少四个整数中的最小整数从零相差整数偏移量，且在连续位置中的序列的全部整数相差整数跨度。公开了其它方法、装置、系统和指令。
用于产生整数序列处理器系统

[发明专利]用于从通用寄存器向向量寄存器进行广播的装置和方法-CN201810312051.6有效
发明人： E·乌尔德-阿迈德-瓦尔;R·凡伦天;J·考博尔;B·L·托尔;M·J·查尼;Z·斯波伯;A·格雷德斯廷 -专利权人：英特尔公司
申请日： 2011-12-23 - 公布日： 2022-07-12 - 主分类号： G06F9/54 文献下载
摘要：描述了用于从通用源寄存器向向量寄存器进行广播的装置和方法。例如，根据一个实施例的处理器包括：解码电路，用于解码指令，所述指令具有用于标识源操作数的第一字段以及用于标识目的地操作数的第二字段；执行电路，耦合到所述解码电路，其中所述执行电路用于执行经解码的指令以：标识所标识源操作数内要存储在所标识目的地操作数中的数据元素位置；将存储在所标识的数据元素位置中的数据广播到所标识目的地操作数的至少一个数据元素位置。
用于通用寄存器向量进行广播装置方法

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