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[发明专利]人工智能模型的算子调度方法、装置、设备及存储介质-CN202210357812.6有效
发明人： 伍永情;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2022-04-06 - 公布日： 2023-05-02 - 主分类号： G06F9/48 文献下载
摘要：本申请涉及一种人工智能模型的算子调度方法、装置、设备及存储介质。所述方法包括：获取模型对应的每个目标算子的参考运行时长，基于多个算子队列中的算子数量以及算子的预期等待时长，计算每个算子队列的预期排队时间，基于参考运行时长及每个算子队列的预期排队时间，将每个目标算子分别添加至预期排队时间最短的算子队列。本申请可以可以最大限度的均衡各个算子队列中的算子，从而最大限度的均衡各个推理引擎上的推理负载，让各个APP对应的模型推理延迟趋于均衡，有效地避免了按照算子队列中的算子数量进行调度导致的推理延迟扩散问题，减少了每个目标算子的等待时间，提高了整个系统的AI推理效率。
人工智能模型算子调度方法装置设备存储介质

[发明专利]芯片引导程序的分段验证方法、装置、设备及可读介质-CN202211497683.7有效
发明人： 伍永情;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2022-11-28 - 公布日： 2023-02-14 - 主分类号： G06F21/57 文献下载
摘要：本申请涉及一种芯片引导程序的分段验证方法、装置、设备及可读介质。该方法包括：获取第二镜像和处于开发阶段的第一镜像、第三镜像以及第四镜像；基于第一镜像构建第三镜像的代理引导镜像；分别构建包括第一镜像和第二镜像的第一测试链、包括代理引导镜像、第三镜像以及第四镜像的第二测试链；在目标测试平台上分别测试第一测试链和第二测试链，以在第一测试链中对第一镜像进行验证，在第二测试链中对第三镜像和第四镜像进行验证。本申请解决了在前软件组没有验证通过之前在后软件组无法测试、验证导致测试周期长的技术问题。
芯片引导程序分段验证方法装置设备可读介质

[发明专利]一种联合调试方法、装置、设备及介质-CN202211026366.7在审
发明人： 伍永情;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2022-08-25 - 公布日： 2022-12-09 - 主分类号： G06F11/36 文献下载
摘要：本发明涉及一种联合调试方法、装置、设备及介质，涉及信息技术领域，所述SoC芯片包括第一串口以及第二串口，所述SoC芯片配置有固件软件以及内核软件,所述方法包括：将所述第一串口配置为所述固件软件的专用调试串口，以及将所述第二串口配置为所述内核软件的专用调试串口；对所述固件软件进行调试，得到第一调试打印信息，并通过所述第一串口输出所述第一调试打印信息；对所述内核软件进行调试，得到第二调试打印信息，并通过所述第二串口输出所述第二调试打印信息。本发明通过为固件软件增加一个调试串口使固件软件不需和其它软件做任何软件上的同步，且避免出现打印混乱及提高了debug效率。
一种联合调试方法装置设备介质

[发明专利]运行深度学习网络的方法及装置-CN202011303530.5有效
发明人： 伍永情;黄炯凯;蔡权雄;牛昕宇 -专利权人：山东产研鲲云人工智能研究院有限公司
申请日： 2020-11-19 - 公布日： 2022-12-09 - 主分类号： G06N3/04 文献下载
摘要：本申请适用于计算机技术领域，提供了一种运行深度学习网络的方法及装置，其中该方法包括：基于固件准备请求，调用内存空间中的各个空闲空间地址分别生成相应的第一DMA指令固件，所述内存空间包括空闲空间和非空闲空间；当生成各个所述第一DMA指令固件时，获取针对深度学习网络的DMA操作请求；基于所述DMA操作请求为所述深度学习网络分配相应的目标DMA指令固件集，并将所述目标DMA指令固件集发送给处理器，以使得所述处理器基于所述目标DMA指令固件集运行所述深度学习网络。由此，可以提高深度学习网络的加载效率。
运行深度学习网络方法装置

[发明专利]SoC片上SRAM复用方法、电子设备及SoC芯片-CN202211020012.1在审
发明人： 伍永情;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2022-08-24 - 公布日： 2022-11-22 - 主分类号： G06F15/78 文献下载
摘要：本申请涉及SoC芯片技术，提供了SoC片上SRAM复用方法、电子设备及SoC芯片，是系统上电时由CPU从bootrom中获取并运行BootLoader1进行系统初始化，然后从外部存储介质加载BootLoader2至复用SRAM，基于BootLoader2对DDR完成训练，基于BootLoader2从外部存储介质中加载包括BootLoader31的剩余镜像数据至DDR，最后基于BootLoader31启动操作系统后在操作系统上再启动对应的业务软件进行数据处理。实现了复用SRAM既能存储系统初始化用的BootLoader1产生的数据，还能在系统完成对BootLoader1、BootLoader2及BootLoader31的加载后切换至用于存储业务软件的待处理数据，减少了SoC上SRAM的使用量，降低了SoC的成本，还降低了SoC整体复杂度，也减少了SoC芯片总面积。
soc sram 方法电子设备芯片

[发明专利]神经网络数据处理方法、装置、设备及存储介质-CN202010679561.4有效
发明人： 伍永情;黄炯凯;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2020-07-15 - 公布日： 2022-09-09 - 主分类号： G06F13/28 文献下载
摘要：本发明实施例公开了一种神经网络数据处理方法、装置、设备及存储介质，所述方法包括：加载神经网络当前层的第二运算数据；当神经网络当前层的第二运算数据加载完毕，加载神经网络下一层的第一运算数据。本发明实施例使得神经网络计算引擎的运行与DMA的数据读取并行处理，提高了计算引擎与DMA的并行度，从而减少了计算引擎和数据读取的空闲时间，提高了神经网络运算过程中的数据吞吐率，减少了神经网络运算所需的总体耗时。
神经网络数据处理方法装置设备存储介质

[发明专利]一种传送dma控制信息的方法、装置、电子设备和存储介质-CN202210647193.4在审
发明人： 伍永情;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2022-06-08 - 公布日： 2022-09-06 - 主分类号： G06F15/163 文献下载
摘要：本申请提供了一种传送dma控制信息的方法、装置、电子设备和存储介质，属于AI推理技术领域。所述方法包括：获取全版本的dma控制信息，其中，所述全版本的dma控制信息中包括有效dma控制信息和无效dma控制信息；根据所述全版本的dma控制信息确定header中的bit位，其中，所述header中每个bit位指示一个dma控制信息；根据所述header中的bit位，从所述全版本的dma控制信息中选取出目标算子需要的有效dma控制信息；发送数据包至实时cpu对应的TCM，其中，所述数据包中包括所述header和所述有效dma控制信息。本申请通过加速AI推理的dma控制信息压缩技术，降低了对DDR的读带宽需求以及对TCM的写带宽需求，并且节省了数据传输时间以及TCM的空间。
一种传送 dma 控制信息方法装置电子设备存储介质

[发明专利]神经网络数据处理方法、设备及存储介质-CN202210103770.3有效
发明人： 伍永情;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2022-01-28 - 公布日： 2022-05-10 - 主分类号： G06N3/04 文献下载
摘要：本发明公开了一种神经网络数据处理方法、设备及存储介质，应用于神经网络数据处理装置的主控处理器，所述神经网络数据处理装置包括主控处理器和实时处理器，所述实时处理器包括推理运算模块，该方法包括：获取神经网络的多个神经网络算子；根据多个神经网络算子以及预设推理引擎规则依次生成神经网络对应的至少一个元信息；将元信息依次存储在数据缓冲区。本发明通过主控处理器获取神经网络算子并根据神经网络算子生成至少一个元信息，并将元信息存储在数据缓冲区，以供实时处理器可直接根据元信息生成寄存器序列，进而根据寄存器序列进行运算，而无需主控处理器向实时处理器传输寄存器序列，减少了数据传销开销，从而提高了推理运算的效率。
神经网络数据处理方法设备存储介质

[发明专利]本地数据流加速方法、数据流加速系统及计算机设备-CN201980067040.9在审
发明人： 伍永情;姜浩;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2019-10-12 - 公布日： 2021-08-17 - 主分类号： G06F9/50 文献下载
摘要：一种本地数据流加速方法、数据流加速系统、计算机设备及存储介质，所述方法包括步骤：接受数据采集设备采集的原始数据流并对所述原始数据流进行初步处理(101)；配置本地数据流加速引擎，并将所述初步处理后的原始数据流输入所述数据流加速引擎进行加速处理，得到数据流加速处理结果(102)；将所述数据流加速处理结果输出(103)。根据获取的数据流类型在本地动态配置数据流加速引擎，并通过该动态配置好的本地数据流加速引擎对数据流进行加速处理，可以提高数据流处理分析的实时性并降低数据传输的成本。
本地数据流加速方法系统计算机设备

[发明专利]直接内存访问控制方法、系统、计算机设备及存储介质-CN201980067046.6在审
发明人： 伍永情;黄炯凯;蔡权雄;牛昕宇 -专利权人：深圳鲲云信息科技有限公司
申请日： 2019-10-29 - 公布日： 2021-08-06 - 主分类号： G11C5/14 文献下载
摘要：一种直接内存访问控制方法、装置、系统、计算机设备及可读存储介质，属于内存访问技术领域，方法包括：获取应用端传输的控制指令，所述控制指令包括开始指令、至少一条直接内存访问指令、结束指令(101)；执行所述开始指令，依次解析所述至少一条直接内存访问指令，得到指令解析结果(102)；根据所述指令解析结果调用硬件进行内存的直接访问，直到所述指令解析结果为所述结束指令(103)。通过获取应用端的对内存的多条操作指令，在本地依次进行解析后直接对内存进行操作，可以降低应用端软件与内存硬件之间的交互次数，且可以尽量减少因操作系统调度打断软件对硬件的配置而引起的硬件空闲，从而提高系统整体性能和数据吞吐率。
直接内存访问控制方法系统计算机设备存储介质

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