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[发明专利]超导脉冲计数器以及提高超导电路工作频率的方法-CN202310254158.0在审
发明人：陈凤冰;瞿佩瑶;杨佳洪;邓守业;唐光明 -专利权人：中国科学院计算技术研究所
申请日： 2023-03-16 - 公布日： 2023-06-23 - 主分类号： H03K23/76 文献下载
摘要：提供一种超导脉冲计数器以及提高超导电路工作频率的方法，所述计数器包括：n个TFFE器件、p个TFFO器件以及m个带时钟端口的超导器件，其中，n和m为正整数，p为大于等于0的整数；所述n+m+p个器件线性串联连接，其中第一个器件的输入端为所述超导脉冲计数器的输入端，所述n+m+p个器件中的每一个器件的输出端连接至下一个器件的输入端，最后一个器件的输出端为所述超导脉冲计数器的输出端；所述m个带时钟端口的超导器件的时钟端连接到所述超导脉冲计数器的时钟端；以及其中，输入至所述超导脉冲计数器的输入端和时钟端的超导脉冲具有相同的频率。
超导脉冲计数器以及提高电路工作频率方法

[发明专利]一种超导电路的清零方法及系统-CN201911340498.5有效
发明人：张志敏;唐光明;张阔中;轩伟;瞿佩瑶;杨佳洪 -专利权人：中国科学院计算技术研究所
申请日： 2019-12-23 - 公布日： 2021-11-05 - 主分类号： H03K3/012 文献下载
摘要：本发明提出一种超导电路的清零方法及系统，包括：发送清零指令信号至非破坏读出寄存器的指令输入接口，非破坏读出寄存器根据高频局部时钟信号输出数据至第一磁通量子分离器件，第一磁通量子分离器件将输出数据分离为清零信号和触发信号，并将清零信号输入至超导处理器各流水级之间的超导寄存器；输入低频系统时钟信号至第二磁通量子分离器件，第二磁通量子分离器件将低频系统时钟信号拆分为第一低频系统时钟脉冲和第二低频系统时钟脉冲；第一D触发器根据触发信号和第一低频系统时钟脉冲，输出信号脉冲，第二磁通量子分离器件根据信号脉冲和第二低频系统时钟脉冲，输出延时脉冲，非破坏读出寄存器根据延时脉冲进行复位，以停止输出清零信号。
一种超导电路清零方法系统

[发明专利]一种超导触发器及其运行方法-CN201911316279.3有效
发明人：张志敏;唐光明;轩伟;张阔中;瞿佩瑶;杨佳洪 -专利权人：中国科学院计算技术研究所
申请日： 2019-12-19 - 公布日： 2021-10-22 - 主分类号： H03K3/38 文献下载
摘要：本发明提出一种超导触发器及其运行方法，包括：磁通量子分离器件、可复位触发器和非破坏读出寄存器；该磁通量子分离器件的输入端用于接收该超导触发器的使能信号，该磁通量子分离器件的输出端与该非破坏读出寄存器的复位输入端相连，该磁通量子分离器件的另一输出端与可复位触发器的时钟输入端相连；该可复位触发器的输入端作为该超导触发器的输入端，该可复位触发器的复位端用于接收该超导触发器的清空信号，该可复位触发器的输出端与该非破坏读出寄存器的输入端相连；该非破坏读出寄存器的时钟输入端作为该超导触发器的时钟输入端，该非破坏读出寄存器的输出端作为该超导触发器的输出端。
一种超导触发器及其运行方法

[发明专利]一种RSFQ FFT处理器的蝶形运算处理方法及系统-CN201811560119.9有效
发明人： 瞿佩瑶;唐光明;叶笑春;范东睿 -专利权人：中国科学院计算技术研究所
申请日： 2018-12-20 - 公布日： 2021-03-09 - 主分类号： G06F7/57 文献下载
摘要：本发明涉及一种RSFQ FFT处理器的蝶形运算处理系统，包括用于执行计算的第一计算模块和第二计算模块，用于执行常数乘法的旋转因子模块和用于改变序列顺序的重排模块；在执行运算时，输入数据经所述第一计算模块执行计算后将获得的第一数据串输入至所述旋转因子模块中执行常数乘法并获得中间结果，所述中间结果经所述重排模块改变序列顺序后，将获得的第二数据串输入至所述第二计算模块执行计算并获得输出数据。
一种 rsfq fft 处理器蝶形运算处理方法系统

[发明专利]一种SFQ电路与CMOS电路间交互方法及系统-CN202011210460.9在审
发明人：杨佳洪;唐光明;瞿佩瑶;郑祥雨;叶旭东;于佩石 -专利权人：中国科学院计算技术研究所
申请日： 2020-11-03 - 公布日： 2021-02-09 - 主分类号： G11C16/08 文献下载
摘要：本发明提出一种SFQ电路与CMOS电路间交互方法，包括：单磁通量子芯片发送用于完成指定操作的单个SFQ脉冲至同步非破坏性读出单元的数据输入端，该同步非破坏性读出单元的数据输出端持续输出连续SFQ脉冲至CMOS电路中的电平逻辑输入端完成该指定操作；完成指定操作后该单磁通量子芯片发送复位信号至该同步非破坏性读出单元的复位端口，以停止输出SFQ脉冲至CMOS电路。本发明申请在需要ANDRO输出固定周期的连续SFQ脉冲的时候，在ANDRO的数据端口输入一个SFQ脉冲，就会有固定周期的连续SFQ脉冲输出；需要ANDRO停止输出SFQ脉冲的时候，那么在ANDRO的重置端口输入一个SFQ脉冲，ANDRO就会停止输出SFQ脉冲。以实现SFQ电路与CMOS电路的数据交互。
一种 sfq 电路 cmos 交互方法系统

[发明专利]用于超导单磁通量子集成电路的N进制计数器-CN202010965078.2在审
发明人： 瞿佩瑶;唐光明;杨佳洪 -专利权人：中国科学院计算技术研究所
申请日： 2020-09-15 - 公布日： 2020-12-22 - 主分类号： H03K21/02 文献下载
摘要：提供一种用于超导单磁通量子集成电路的N进制计数器，所述N进制计数器包括：串联连接的n个超导T触发器，其中，N＝2n，且n为正整数；其中，每个超导T触发器包括用于接收输入信号的输入端，以及用于将信号输出的输出端，并且仅当每个超导T触发器的输入端接收到偶数个信号时，其输出端有信号输出；以及其中，第i个超导T触发器的输出端与第i+1个超导T触发器的输入端相连接，1≤i＜n，第一个超导T触发器的输入端为该N进制计数器的输入端，第n个超导T触发器的输出端为该N进制计数器的输出端。
用于超导磁通量集成电路计数器

[发明专利]超导环及超导高频时钟发生器-CN201910447197.6在审
发明人：唐光明;瞿佩瑶 -专利权人：中国科学院计算技术研究所
申请日： 2019-05-27 - 公布日： 2019-10-08 - 主分类号： H03K5/133 文献下载
摘要：本发明涉及一种超导环，包括：前延迟器，用于将输入的触发信号经延迟后输出为第一延迟信号；分支器，与该前延迟器超导连接，用于接收该第一延迟信号，并经延迟后输出第二延迟信号；融合缓冲器，与该分支器超导连接，用于接收该第二延迟信号，并经延迟后输出第三延迟信号；后延迟器，与该融合缓冲器超导连接，用于接收该第三延迟信号经延迟后输出为第四延迟信号。
延迟信号延迟超导连接延迟器缓冲器输出超导环分支器高频时钟发生器触发信号融合

[发明专利]一种超导全加方法、装置和超导计算系统-CN201910188473.1在审
发明人：唐光明;瞿佩瑶 -专利权人：中国科学院计算技术研究所
申请日： 2019-03-13 - 公布日： 2019-07-30 - 主分类号： G06F7/501 文献下载
摘要：本发明提出一种一种超导全加方法、装置和超导计算系统，包括：获取本位i的两个待相加加数A_i和B_i以及前一位i‑1的进位C_i‑1，A_i和B_i通过第一级流水线的异或门和与门，分别得到和A_iB_i；C_i‑1和分别输入到第二级流水线的异或门和与门参与运算，得到和并将与A_iB_i一同输入到融合缓冲中得到输出作为本位和，输出作为向后一位i+1的进位。本发明公开的超导全加器能为未来能源高效的高性能计算机奠定基础，且该全加器结构简单，用CB代替了或门，减少了一级流水线，从而降低了硬件资源消耗，减少了面积开销，同时减少了电路延迟。
流水线计算系统全加器异或门进位与门加数高性能计算机硬件资源消耗电路延迟面积开销输出第一级缓冲或门向后相加运算融合能源

[发明专利]超导单磁通量子处理器的算术逻辑单元运算方法和系统-CN201711330475.7在审
发明人： 瞿佩瑶;唐光明;叶笑春;范东睿 -专利权人：中国科学院计算技术研究所
申请日： 2017-12-13 - 公布日： 2018-06-01 - 主分类号： G06F7/575 文献下载
摘要：本发明涉及一种超导单磁通量子处理器的算术逻辑单元运算方法和系统，包括采用超导RSFQ技术克服了传统技术低速度高功耗的问题，同时该高速单磁通量子处理器中的算术逻辑单元采用16位串‑并结构的加法器进行运算处理，而串‑并体系结构比串行结构运算速度更快，比并行结构需要的硬件资源更少；发明在实现超高速度的同时也保证了超低功耗。在基于国内外RSFQ大规模集成电路工艺满足64位RSFQ微处理器核心部件的条件下，对64位RSFQ ALU进行逻辑设计，为将来设计超高速64位RSFQ微处理器以及计算机系统奠定基础。
算术逻辑单元磁通量子处理器运算逻辑设计大规模集成电路工艺微处理器核心微处理器并行结构超低功耗串行结构体系结构硬件资源运算处理超高速高功耗加法器计算机系统位串保证

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