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- [发明专利]运算处理装置-CN201980027100.4在审
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古川英明
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奥林巴斯株式会社
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2019-05-09
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2020-11-27
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G06N3/063
- 运算处理装置的运算部具有:滤波处理部,其具有乘法器和第1加法器,进行所述滤波处理;第2加法器,其进行将以N并行方式执行的所述滤波处理的结果全部累积相加的所述累积相加处理;非线性变换部,其对所述累积相加处理的结果进行所述非线性运算处理;池化处理部,其对所述非线性运算处理的结果进行所述池化处理;以及运算控制部,其控制所述滤波处理部、所述第2加法器、所述非线性变换部和所述池化处理部。
- 运算处理装置
- [发明专利]运算处理装置-CN202080092013.X在审
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池谷亮志
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索尼集团公司
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2020-12-28
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2022-08-19
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G06F17/10
- 提供一种运算处理装置(10),具备:运算电路部(500),使用读取的第一数据及第二数据来反复进行运算;第一存储部(200),储存上述第一数据;第二存储部(202),储存上述第二数据;寄存器部(400),从上述第一存储部或上述第二存储部读取并暂时保存上述第一数据及上述第二数据中的被上述运算电路部反复使用的数据;第一选择器部(300),选择上述第一数据及上述第二数据中的保存于上述寄存器部的数据;以及控制部(600),基于运算的种类、运算量、上述第一存储部及上述第二存储部的种类、上述第一存储部及上述第二存储部的容量以及上述运算电路部的种类中的至少一个来控制上述第一选择器部。
- 运算处理装置
- [发明专利]运算处理装置-CN202310817708.5在审
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梶谷一彦;安达隆郎
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超极存储器股份有限公司
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2017-06-02
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2023-10-13
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G11C5/02
- 本发明的运算处理装置具有:处理部主体(21),其在规定的第一方向(F1)上排列设置;多个路由器部(30),其排列设置在与各个所述处理部主体(21)的所述第一方向(F1)交叉的第二方向(F2)上,对多个所述处理部主体(21)之间的数据通信进行中继;以及通信线(12),其连接多个所述路由器部(30),所述处理部主体(21)具有排列设置在与所述第一方向(F1)交叉的所述第二方向(F2)上的多个子部(22),所述子部(22)具有一个运算部(23)和一个存储部(24),所述运算部(23)包含至少一个核(25),所述存储部(24)排列设置在所述运算部(23)的第一方向(F1)上。
- 运算处理装置
- [发明专利]运算处理装置-CN200710087864.1有效
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广井聪幸;菅原彰彦
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索尼计算机娱乐公司
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2007-03-21
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2007-10-03
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H01L25/00
- 运算处理装置中,在第一半导体衬底(100)上一体地集成了执行不同处理的多个处理器(10、12、14、16)。在第二半导体衬底(200)上一体地集成了由第一半导体衬底(100)上集成的多个处理器(10、12、14、16)管理的多个存储器(20、22、24、26)。第一半导体衬底(100)上集成的多个处理器(10、12、14、16)包括存储器控制器,用于控制分别单独地集成在第二半导体衬底(200)上的成为管理对象的存储器(20、22、24、26)。
- 运算处理装置
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