专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体元件、半导体元件的制造方法-CN201410164661.8有效
  • 前田和弘;志贺俊彦 - 三菱电机株式会社
  • 2014-04-23 - 2017-04-12 - H01L23/482
  • 本发明目的是提供能够在衬底面上形成没有外观异常的导电膜的半导体元件以及该半导体元件的制造方法。其特征在于,包括六方晶系且衬底面为(0001)面的衬底(10);和在该衬底面上形成的多个导电膜(12)。该多个导电膜包括第一导电膜(14),晶体结构为不拥有与该衬底的该衬底面中的原子排列具有同等的对称性的平面;以及第二导电膜(16),形成于该第一导电膜的上方,晶体结构为具有至少一个与该衬底的该衬底面中的原子排列具有同等的对称性的平面,该第二导电膜为粒径是15μm以下的多晶。
  • 半导体元件制造方法
  • [发明专利]半导体装置及其制造方法-CN201210383347.X有效
  • 日坂隆行;中本隆博;志贺俊彦;西泽弘一郎 - 三菱电机株式会社
  • 2012-10-11 - 2013-04-17 - H01L23/485
  • 本发明提供能提高针对来自外部的杂质等的耐性的半导体装置及其制造方法。在GaAs衬底(1)上设置有下层布线(2)。在GaAs衬底(1)及下层布线(2)上设置有树脂膜(4)。树脂膜(4)在下层布线(2)上具有开口(5)。在下层布线(2)及树脂膜(4)上设置有SiN膜(6)。SiN膜(6)在开口(5)内具有开口(7)。在下层布线(2)及树脂膜(4)的一部分上设置有上层布线(8)。上层布线(8)具有经由开口(5)、(7)与下层布线(2)连接的Ti膜(8a)和设置在Ti膜(8a)上的Au膜(8b)。在上层布线(8)及树脂膜(4)上设置有SiN膜(9)。SiN膜(9)在树脂膜(4)上附着于SiN膜(6)。SiN膜(6)、(9)保护Ti膜(8a)的周围。
  • 半导体装置及其制造方法
  • [发明专利]晶体管-CN200710193300.6有效
  • 小山英寿;加茂宣卓;志贺俊彦 - 三菱电机株式会社
  • 2007-12-03 - 2008-10-08 - H01L29/812
  • 本发明的目的在于提供一种晶体管,具有将肖特基势垒高度或者理想系数值这样的特性保持为良好的值并且耐热性优良的电极。在AlGaN层(14)上层叠高氮化率的TaN层(22),得到良好的特性的肖特基结。在TaN层(22)的周围设置绝缘膜(16),在TaN层(22)的上层层叠耐热性优良的低氮化率TaN层(24)。由TaN层(24)和绝缘膜(16)覆盖TaN层(22),保护TaN层(22)不暴露在大气中。
  • 晶体管
  • [发明专利]半导体光学元件及其制造方法-CN200710139920.1无效
  • 志贺俊彦 - 三菱电机株式会社
  • 2007-08-03 - 2008-02-06 - H01S5/22
  • 本发明构成一种可防止金属电极层的剥离并且可抑制接触电阻的上升的半导体光学元件。本发明的LD(10)包括:半导体层叠结构(37),包含在n GaN基板(12)上依次层叠的有源层(26)、p包层(34)和接触层(36);波导脊(40),由该半导体层叠结构(37)的接触层(36)和p包层(34)的一部分形成;第1硅绝缘膜(44),与该波导脊(40)的顶部对应地具有开口部(44a),覆盖波导脊(40)的侧壁;紧密附着层(45),包含排除开口部(44a)地配设在第1硅绝缘膜(44)上的由Ti构成的第1紧密附着膜(45a);以及p侧电极(46),配设在该紧密附着层(45)上,并且经开口部(44a)与波导脊(40)的顶部的接触层(36)紧密附着在一起。
  • 半导体光学元件及其制造方法
  • [发明专利]半导体光元件的制造方法-CN200710137346.6无效
  • 志贺俊彦;佐久间仁 - 三菱电机株式会社
  • 2007-07-20 - 2008-01-23 - H01S5/00
  • 本发明提供一种半导体光元件的制造方法。可在波导脊的上表面,稳定地防止半导体层与电极层的接触面积的减少,提供一种成品率高的制造方法。本发明的LD(10)的制造方法是在层叠了半导体层的晶片中形成波导脊(40),在晶片整个面中形成SiO2膜(78),形成于波导脊(40)顶部的SiO2膜(78)的表面露出,同时,利用抗蚀剂膜埋设邻接于波导脊(40)的沟道(38)的SiO2膜(78),形成第2抗蚀剂图案(82),该抗蚀剂膜具有比波导脊(40)的p-GaN层(74)表面高、且比波导脊(40)顶部上的SiO2膜(78)表面低的表面,将第2抗蚀剂图案(82)作为掩膜,去除SiO2膜(78),使波导脊(40)的p-GaN层(74)表面露出,并在其上形成电极层(46)。
  • 半导体元件制造方法
  • [发明专利]半导体装置-CN200610073541.2有效
  • 天清宗山;志贺俊彦;国井彻郎;奥友希 - 三菱电机株式会社
  • 2006-04-10 - 2006-11-01 - H01L29/43
  • 提高肖特基电极的耐湿性而得到半导体装置。肖特基电极即栅电极(8)包括TaNx层(6)和Au层(7)。TaNx层(6)为了防止Au层(7)和基板(100)之间的原子扩散,起势垒金属的作用。TaNx不含Si,所以比含有Si的WSiN的耐湿性高。因此栅电极(8)与具有WSiN层的以往的栅电极相比耐湿性高。另外,设定氮含有率x小于0.8,与以往的栅电极相比可以避免肖特基特性的大幅度降低。或者氮含有率x在小于0.5的范围之内,与以往的栅电极相比能够提高肖特基特性。
  • 半导体装置

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