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[发明专利]一种基于BICMOS工艺具有冷备份和短路保护功能的高速驱动电路-CN202110726022.6有效
发明人：李全利;陈雷;李建成;岳素格;雷红萍;郭斌;薛钰 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2021-06-29 - 公布日： 2023-08-29 - 主分类号： H03K19/0185 文献下载
摘要：本发明涉及一种基于BICMOS工艺具有冷备份和短路保护功能的高速驱动电路100，该电路包括驱动级101、共模反馈电路102、短路保护电路103、冷备份电源偏置104等模块。此驱动电路100采用电流模架构，上电完成后，驱动器101开始工作，共模反馈电路102保证输出工作点满足驱动级协议要求，短路保护电路103监控输出端电压值，如果输出电压异常，短路保护电路将关闭驱动电路101，以免电路烧毁。电路同时支持冷备份使用，冷备份电源偏置104将输出端口到电源的漏电流控制在微安级以内，完全切断输出到电源的漏电通路。采用此架构适用于多种协议驱动器，满足多种使用条件，具备较强的保护能力和高速的驱动能力。
一种基于 bicmos 工艺具有备份短路保护功能高速驱动电路

[发明专利]一种通道随机化减小失配误差的MDAC电路-CN202110820818.8有效
发明人：郭瑞;初飞;王宗民;张铁良;冯文晓;靳翔;纪亚飞;邴兆航;方贤朋 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2021-07-20 - 公布日： 2023-08-29 - 主分类号： H03M1/10 文献下载
摘要：一种通道随机化减小失配误差的MDAC电路，包括四通道采样开关电容阵列和一个余量放大器模块，通过在采样阶段，随机从四个通道的采样开关电容阵列中选择一个通道对输入信号进行采样，将电容失配误差平均化，进而减小失配对电路产生的影响。本发明设计多个采样开关电容阵列通道，在每个余量放大器工作周期内，随机选取一个通道进行输入信号的采样，以达到减小电容失配误差的效果，进而提高了整个MDAC和模数转换器的性能。
一种通道随机化减小失配误差 mdac 电路

[发明专利]一种面向高速数据传输的可编程通用接口电路-CN202111012598.2有效
发明人：赫彩;陈雷;孙华波;倪劼;郭琨;杨佳奇;王科迪;吕小龙;甄淑琦;单程奕;李程 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2021-08-31 - 公布日： 2023-08-29 - 主分类号： G06F13/40 文献下载
摘要：本发明提供一种面向高速数据传输的可编程通用接口电路，包括可编程延时单元、延时自校准单元、串并转换器、数据恢复单元、时钟生成器和时钟对齐电路，可实现时钟和数据的精确相移、数据串并转换、边沿检测、数据恢复等功能，采用4个时钟相位和2个数据采样组合的方式实现一个时钟周期内对数据的8次采样，从而选择最佳采样点。本发明可在温度和电压变化、抖动等情况下实时更新最佳采样点位置，有效减小数据抖动，提高采样质量，最高采样频率可达到1.25Gbps。
一种面向高速数据传输可编程通用接口电路

[发明专利]一种方形电极玻璃二极管标识印制机构-CN202111138045.1有效
发明人：王潮洋;戴晨毅;王勇;李金月;冯小成;木瑞强 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2021-09-27 - 公布日： 2023-08-29 - 主分类号： B41F17/00 文献下载
摘要：本发明公开了一种一种方形电极玻璃二极管标识印制机构，包括：硅胶头、阵列轨道工装、钢片、清洁区、X方向伺服机构、Y方向伺服机构和工作平台；其中，所述阵列轨道工装、所述钢片、所述清洁区和所述Y方向伺服机构均设置于所述工作平台上；所述硅胶头与所述X方向伺服机构相连接，所述硅胶头能够沿着X方向伺服机构长度方向移动；所述X方向伺服机构与所述Y方向伺服机构相连接，所述X方向伺服机构能够沿着Y方向伺服机构长度方向移动。本发明攻克了自动化环状标识印制的瓶颈，从而克服了手工制作效率低、一致性差、良率低的缺点。
一种方形电极玻璃二极管标识印制机构

[发明专利]一种动态逻辑结构的鉴频鉴相器-CN202011413383.7有效
发明人：程泽;张佃伟;文武;段冲;侯训平 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2020-12-04 - 公布日： 2023-08-29 - 主分类号： H03L7/085 文献下载
摘要：本发明涉及一种动态逻辑结构的鉴频鉴相器，属于无线通信领域；包括逻辑控制电路、鉴频鉴相电路、锁存电路和复位电路；逻辑控制电路包括第一非门、D触发器、第一与门、第二与门和第二非门；鉴频鉴相电路包括第一MOS管M1、第二MOS管M2、第三MOS管M3、第四MOS管M4、第五MOS管M5和第六MOS管M6；锁存电路包括第一反相器、第三非门、第四非门、第二反相器、第五非门和第六非门；复位电路包括第三与门和第七非门；本发明减小了关键路径延迟时间，减小电路晶体管使用数量，提高了噪声性能。
一种动态逻辑结构鉴频鉴相器

[发明专利]一种宽范围输入输出接口电路-CN202011439450.2有效
发明人：陈雷;倪劼;李学武;孙华波;王文锋;郭琨;孙健爽;刘亚泽;赫彩;甄淑琦;张玉 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2020-12-07 - 公布日： 2023-08-29 - 主分类号： H03K19/017 文献下载
摘要：一种宽范围输入输出接口电路，属于集成电路领域；作为输出接口的情况下，利用辅助电压产生单元(103)的开启与关闭，通过双模式电平转换单元，使输出驱动单元(101)中PMOS晶体管栅源电压等于内核工作电源电压；作为输入接口的情况下，利用辅助电压产生单元(103)的开启与关闭，通过耐压输入缓冲器单元(104)和耐压输入缓冲器单元(105)的开启与关闭，使耐压输入缓冲器单元(104)中PMOS晶体管栅源电压等于输入输出接口电源电压。
一种范围输入输出接口电路

[发明专利]一种新型并串转换电路-CN202011543241.2有效
发明人：柳博;张铁良;张雷;杨龙;杨松 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2020-12-22 - 公布日： 2023-08-29 - 主分类号： H03M9/00 文献下载
摘要：本发明涉及一种新型并串转换电路，属于高速串行接口技术领域，包括数据预处理电路、数据合成电路和驱动器电路，数据预处理电路发送经过预处理的N位数据Qn1、Qn2、...、QnN‑1、QnN给数据合成电路，并利用第N位经过预处理的数据的反向数据QnNN与输入的N位并行数据Sn1、Sn2、...、SnN‑1、SnN做异或逻辑以及同或逻辑运算。本发明通过数据预处理电路以及驱动器电路代替了传统的并串转换方式，解决了在并串转换中面临的沟道电荷注入、时钟馈通及多相位时钟的问题。
一种新型转换电路

[发明专利]一种宽带正交混频器-CN202111461631.X有效
发明人：刘德鹏;陈雷;魏慧婷;王盟皓;文武;王利凡;张秋艳 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2021-12-02 - 公布日： 2023-08-29 - 主分类号： H03D7/14 文献下载
摘要：本发明提供了一种宽带正交混频器，RC移相器作为本振信号的接收端，将本振信号产生器产生的同频反相的两路差分信号拆分成同频正交的两对差分本振信号；第一、第二限幅放大器分别接收一对上述幅度不一致的差分本振信号，并放大成为幅度一致的正交的两对差分本振信号；第一、第二混频模块分别接收所述第一、第二限幅放大器输出的两路差分本振信号，与两路差分基带信号进行混频；带宽扩展‑增益平衡模块接收第一、第二混频模块输出的电流信号并将两路电流信号转换成电压信号输出至差分转单端放大器；差分转单端放大器将混频后的两路射频信号转换成单端信号并放大。本发明中宽带正交混频器，在宽工作频率范围内保证了良好的线性度、隔离度和低噪特性。
一种宽带正交混频器

[发明专利]一种应用于模拟滤波器工作频率自适应的控制字产生电路-CN202210343883.0有效
发明人：范柚攸;陈雷;王仕祯;翁勋维;张静;张龙;熊开利 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2022-03-31 - 公布日： 2023-08-29 - 主分类号： H03H21/00 文献下载
摘要：一种应用于模拟滤波器工作频率自适应调整的控制字产生电路，包括时序产生模块和主体模块。主体模块包括可变电阻电容、开关网络、电流源、比较器和计数器等，时序产生模块根据输入信号频率产生相应的时序信号控制开关网络。该电路的工作原理是通过改变开关网络连接方式控制比较器输入节点电压，比较器输出控制计数器，最终计数结果用以调整模拟滤波器工作频率，实现滤波器性能对输入信号频率的自适应调整。本发明可以应用于输入信号频率发生会变化的滤波环节，例如欠采样模数转换器中的抗混叠滤波器、MEMS陀螺驱动环路中的选频滤波器等。
一种应用于模拟滤波器工作频率自适应控制产生电路

[发明专利]一种带有双排定位导槽的CQFP封装形式老化插座-CN201710801983.2有效
发明人：胡会献;吴志军;邓小健 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2017-09-07 - 公布日： 2023-08-29 - 主分类号： H01R12/71 文献下载
摘要：一种带有双排定位导槽的CQFP封装形式老化插座，插座上盖和插座下盖通过套有弹簧的连接轴连接。插座下盖包括插座下盖座体和四个浮动板，四个浮动板沿插座下盖座体中心对称布置，每个浮动板上均设置有一排插座导针和两排插座定位导槽，插座导针的数量、位置和电路芯片的引腿一一对应，两排插座定位导槽中的每个插座定位导槽对应一个插座导针，方便电路引腿放置到相应插座导针上面，避免发生错位现象。插座下盖和插座上盖通过扣紧部件扣紧。本发明由于采用双排定位导槽的方式，避免了引腿比较多，引线比较长，引腿间距为0.5mm的CQFP封装型式的电路在使用该类型插座时，电路引腿间短路造成失效的问题，提高了老化插座的可靠性。
一种带有定位 cqfp 封装形式老化插座

[实用新型]一种淡硼预扩散工艺石英舟-CN202320437368.9有效
发明人：刘燕;钟立志;王倚天;李红歌 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2023-03-09 - 公布日： 2023-08-29 - 主分类号： H01L21/673 文献下载
摘要：一种淡硼预扩散工艺石英舟，所述石英舟呈半圆柱体，圆柱体的内壁开有槽，槽内放有用于进行淡硼预扩散工艺的硅片和硼源片，且放置的硅片和硼源片均与水平面成5°的仰角。本实用新型石英舟旁边摆放隔热挡片，解决了以往淡硼预扩散工艺过程中固体硼源片易变形、硼预扩散过程中硅片与硼源片间距不一致导致硼预扩散后硅片方阻均匀性和批次间一致性较差的问题。
一种淡硼预扩散工艺石英

[发明专利]一种封装互联结构、制备方法及电子系统-CN202310187286.8在审
发明人：王勇;林鹏荣;徐士猛;谢晓辰;黄颖卓;姜学明;郭亨通 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2023-03-02 - 公布日： 2023-08-25 - 主分类号： H01L23/538 文献下载
摘要：本发明涉及一种封装互联结构、制备方法及电子系统，该结构包括基板、桥接芯片、中介层芯片集合和顶层芯片集合，其中基板内部开有槽体，桥接芯片嵌入槽体内，桥接芯片上层布有布线层实现中介层芯片组片间互联，中介层芯片集合上下层均有布线层，顶层芯片集合通过中介层芯片集合的上层布线实现片间互联，边缘与基板互联实现供电与信号传输；制备方法包括将中介层芯片重组，然后将桥接芯片与中介层芯片集合连接，随后模组倒装于基板上，最后将顶层芯片集合连接于中介层芯片组和基板上，本发明满足高性能、高集成、小型化产品封装需求，在增加封装集成度的同时，有效缩短片间信号互联，增强供电性能，从而满足产品性能提高。
一种封装联结制备方法电子系统

[发明专利]一种基于DICE的抗多节点和时钟单粒子翻转的锁存器-CN202310343632.7在审
发明人：杜芊;李同德;于春青;王亚坤;朱永钦;苑靖爽;鲍一豪;孙雨;王亮 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2023-03-31 - 公布日： 2023-08-22 - 主分类号： H03K3/3562 文献下载
摘要：本发明一种基于DICE的抗多节点单粒子翻转和时钟信号单粒子翻转的D型锁存器。通过设计由1个C单元及延迟结构组成的输入电路，可以抵抗输入信号的单粒子瞬态脉冲；由4个时钟控制的传输单元、DICE结构组成的锁存电路和由3个C单元及1个反相器组成的输出电路，可以抵抗多节点单粒子翻转；由4个反相器组成的双时钟信号电路使得锁存器可以抵抗时钟信号单粒子翻转。
一种基于 dice 节点时钟粒子翻转锁存器

[发明专利]一种具有失调调节功能的温度传感器电路-CN202310417073.X在审
发明人：赵进才;张铁良;刘清远;邴兆航;王国奥;张丛丛;李东亢;李宁 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2023-04-18 - 公布日： 2023-08-22 - 主分类号： G01K7/01 文献下载
摘要：一种具有失调调节功能的温度传感器电路，包括感温核电路、10位SAR ADC、一级转换寄存器、二级输出寄存器、上下限寄存器、失调校准寄存器、加法器、比较器。感温核电路用于感知温度对应的电压值，经10位SAR ADC进行数字化转换，所得10位二进制数字码储存在一级转换寄存器中；10位二进制数字码与失调校准寄存器中存储的8位数字码通过加法器修正温度转换值，校准后的10位数字码储存在二级输出寄存器中并向外输出，通过比较器将二级输出寄存器中的数据和上下限寄存器中的数据进行比较，得到温度指示端INT的输出信号，防止芯片过热烧毁或低温损坏。本发明解决当前温度传感器温度失调调节困难、工作范围窄、体积大、功耗高等难题。
一种具有失调调节功能温度传感器电路

[发明专利]一种针对微系统内FPGA及FLASH单元的测试方法-CN202310476572.6在审
发明人：武昊男;王勇;冯长磊;秦贺;程长征;魏晓飞;李晓龙;贾森;黄耀慷;张昊 -专利权人： 北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2023-04-27 - 公布日： 2023-08-18 - 主分类号： G01R31/28 文献下载
摘要：一种针对微系统内FPGA及FLASH单元的测试方法，采用由PXI测试仪、多个通用IO测试板卡以及测试夹；PXI测试仪对测试向量进行编码，控制通用IO板卡提供测试通道，测试夹具保障测试对象的电气连接。测试系统具备针对测试对象的自动化测试能力，主要包含以SELECTMAP模式对FPGA编程的能力；以测试向量的形式提供FPGA、FLASH的测试激励的能力；采集并判断FPGA、FLASH测试响应的能力。此外，在FLASH测试过程中，可以使用专用测试适配板进行多路并行测试，有效减少FLASH测试时间，提高测试效率。
一种针对系统 fpga flash 单元测试方法