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[发明专利]一种输出无毛刺的低占空比误差的时钟信号倍频电路-CN202211173393.7有效
发明人：张才志 -专利权人：成都市安比科技有限公司;重庆市安比科技有限公司
申请日： 2022-09-26 - 公布日： 2022-12-13 - 主分类号： H03K5/00 文献下载
摘要：本发明公开了一种输出无毛刺的低占空比误差的时钟信号倍频电路，涉及集成电路技术领域，包括：使能信号控制单元，根据外部输入的使能信号、复位信号和输出控制单元输入的输出使能信号生成使能信号；时钟信号控制单元，根据外部输入的时钟频率信号和使能信号生成时钟信号；倍频信号产生单元，根据时钟信号、使能信号和输出使能信号生成复位信号、比较器信号和倍频输出信号；输出控制单元根据比较器信号和使能信号生成输出使能信号。本发明中输出使能信号为高电平时，复位信号上升沿触发使能信号控制单元生成使能信号。由于复位信号的触发，使得倍频输出信号能够输出完整的周期信号而不会产生毛刺。
一种输出毛刺低占空误差时钟信号倍频电路

[发明专利]倍频电路以及倍频装置-CN202210923543.5在审
发明人：黄汇钦;吴龙江;曾健忠 -专利权人：天狼芯半导体（成都）有限公司
申请日： 2022-08-02 - 公布日： 2022-11-22 - 主分类号： H03K5/00 文献下载
摘要：本申请涉及一种倍频电路以及倍频装置。倍频电路包括：第一高压开关电路、第二高压开关电路和延时电路。本申请通过第一高压开关电路、第二高压开关电路和延时电路代替传统倍频电路中的运算放大器，可以基于参考脉冲信号和输入电压生成倍频信号，可适应高电压环境。同时，由于倍频信号是由第一高压开关电路以及各个第二高压开关电路输出的脉冲信号合成得到，单个第一高压开关电路或第二高压开关电路在一个参考脉冲信号的周期内仅需要输出一个脉冲，从而避免由于单个高压开关电路的开关速率较低，无法直接输出高频信号的问题。
倍频电路以及装置

[发明专利]相位旋转器设备-CN201810642737.1有效
发明人：威廉·L·步柯西;海登·克莱·小克兰福德;V·K·莎尔玛;张奉琦 -专利权人：马维尔亚洲私人有限公司
申请日： 2018-06-21 - 公布日： 2022-11-18 - 主分类号： H03K5/00 文献下载
摘要：本发明涉及相位旋转器设备，该相位旋转器设备具有相位内插级与跨阻放大器(TIA)级。这将增益与带宽分为数个设计自由度，有助于降低功率消耗，同时使数据链路能够传送及接收更高速资料。输入信号的四个相位由相位内插级使用加权电流与电流源负载来组合，用以产生TIA级当作输入接收的以相移电流为基础的信号。TIA级接着将信号转换成以电压为基础的信号。此阶段输出的静操作电压可用共模回授电路与注射器电流来维持。
相位旋转设备

[发明专利]一种基于深阱MOS管的超低电压冷启动振荡器延迟单元-CN201911280483.4有效
发明人：吴建辉;谢祖帅;瞿剑;周全才;吴志强;李红 -专利权人：东南大学
申请日： 2019-12-13 - 公布日： 2022-11-15 - 主分类号： H03K5/00 文献下载
摘要：本发明公开了一种基于深阱MOS管的超低电压冷启动振荡器延迟单元，包括：采用深阱工艺制成的PMOS管M1、M3、M5及NMOS管M2、M4、M6，其中将M1和M2的衬底，M3和M4的衬底，M5和M6的衬底分别相连，且将延迟单元的信号输入端Vin连接至各PMOS管和NMOS管的衬底；M1和M2的栅极，M3和M4的栅极，M5和M6的栅极分别相连后连接至延迟单元的信号输入端Vin，M1的漏极与M2的漏极相连并作为公共漏极X端口，且M1的源极连接供电电源，M2的源极接地。本发明保证了低输入电源电压下，提高了延迟单元的输出电压摆幅，增大了延迟单元的直流增益，可实现更低的电源电压下产生振荡。
一种基于 mos 电压冷启动振荡器延迟单元

[发明专利]光电隔离脉冲放大器-CN202110514467.8在审
发明人：葛文彬;马志健;张冬冬 -专利权人：天津市科德电气成套有限公司
申请日： 2021-05-10 - 公布日： 2022-11-11 - 主分类号： H03K5/00 文献下载
摘要：本发明公开了光电隔离脉冲放大器，包括脉冲放大器主体、导热底座和金属贴附片，所述导热底座的顶部通过螺钉安装有脉冲放大器主体，所述脉冲放大器主体的顶端一侧通过定位片安装有主电源，所述脉冲放大器主体的顶部焊接有光电隔离器，所述光电隔离器的一端焊接有激光器，所述光电隔离器的另一端焊接有光衰减器，所述光衰减器的一端通过螺钉安装副电源。该新型光电隔离脉冲放大器功能多样，操作简单，便于生产，满足了使用中的多种需求，适合广泛推广使用。
光电隔离脉冲放大器

[发明专利]时钟同步电路、半导体装置以及时钟同步方法-CN202210268622.7在审
发明人：二瓶乃亮 -专利权人：蓝碧石科技株式会社
申请日： 2022-03-18 - 公布日： 2022-10-04 - 主分类号： H03K5/00 文献下载
摘要：本发明提供时钟同步电路、半导体装置以及时钟同步方法。具备：信号生成电路部，通过由两个逻辑电路部接受基于第一时钟输出的信号来生成第一信号及第二信号，上述两个逻辑电路部以与上述第一时钟不同的第二时钟分别进行动作；以及同步化电路部，被输入上述第一信号、上述第二信号、用于调整上述第一信号及上述第二信号的相位的同步化允许信号，并通过对上述第一信号及上述同步化允许信号的逻辑运算的结果与上述第二信号进行逻辑运算得到的第一输出、和对上述第二信号及上述同步化允许信号的逻辑运算的结果与上述第一信号进行逻辑运算得到的第二输出来控制上述第一信号及上述第二信号的相位。
时钟同步电路半导体装置以及方法

[发明专利]时序转换装置、方法、写入均衡系统及计算机可读取介质-CN202210699757.9在审
发明人：赖荣钦 -专利权人：东芯半导体股份有限公司
申请日： 2022-06-20 - 公布日： 2022-09-06 - 主分类号： H03K5/00 文献下载
摘要：本发明提供能以简单的结构高精度地实现信号时序延迟的时序转换装置、方法、写入均衡系统及计算机可读取介质。时序转换装置包括：从外部获取具有第一周期的第一信号、基于第一周期来生成粗码的时间数字转换单元；从时间数字转换单元获取粗码、并向时间数字转换单元输出细码以用于粗码的生成、当粗码不是Y的整数倍时对细码进行调整直至粗码成为Y的整数倍的细码调整单元，Y为正整数；从时间数字转换单元获取粗码、对粗码的X/Y倍进行计算的乘法单元，X为正整数；以及从细码调整单元获取细码、从乘法单元获取粗码的X/Y倍、并从外部获取第二信号、基于粗码的X/Y倍及细码将第二信号延迟第一周期的X/Y倍并输出至外部的数字时间转换单元。
时序转换装置方法写入均衡系统计算机读取介质

[实用新型]一种精度可调二倍频电路结构-CN202221210400.1有效
发明人：陈肃;夏建宝;陈志明;田杰峰;彭河锦;钟旭恒 -专利权人：厦门澎湃微电子有限公司
申请日： 2022-05-19 - 公布日： 2022-08-26 - 主分类号： H03K5/00 文献下载
摘要：本实用新型属于倍频电路设计技术领域，具体提供一种精度可调二倍频电路结构，包括：可编程延时单元、倍频器、伪反相器及电荷泵；时钟源信号先经过可编程延时单元进行占空比粗调，然后经过倍频器进行信号倍频得到倍频时钟信号，最后将所述倍频时钟信号作为输入信号输入至伪反相器；所述伪反相器用于将所述输入信号处理后输出占空比为50％的时钟信号；所述电荷泵与所述伪反相器的输出端连接，用以检测输入时钟信号的占空比，并反馈调节所述伪反相器以辅助调节所述伪反相器输出占空比为50％的时钟信号。该方案具备结构简单、频率可调整范围比较宽、低功耗以及占空比可调的特点，在低功耗、高精度、高速的应用下均能够起到不可或缺的作用。
一种精度可调倍频电路结构

[发明专利]一种精度可调二倍频电路结构-CN202210547941.1在审
发明人：陈肃;夏建宝;陈志明;田杰峰;彭河锦;钟旭恒 -专利权人：厦门澎湃微电子有限公司
申请日： 2022-05-19 - 公布日： 2022-07-15 - 主分类号： H03K5/00 文献下载
摘要：本发明属于倍频电路设计技术领域，具体提供一种精度可调二倍频电路结构，包括：可编程延时单元、倍频器、伪反相器及电荷泵；时钟源信号先经过可编程延时单元进行占空比粗调，然后经过倍频器进行信号倍频得到倍频时钟信号，最后将所述倍频时钟信号作为输入信号输入至伪反相器；所述伪反相器用于将所述输入信号处理后输出占空比为50％的时钟信号；所述电荷泵与所述伪反相器的输出端连接，用以检测输入时钟信号的占空比，并反馈调节所述伪反相器以辅助调节所述伪反相器输出占空比为50％的时钟信号。该方案具备结构简单、频率可调整范围比较宽、低功耗以及占空比可调的特点，在低功耗、高精度、高速的应用下均能够起到不可或缺的作用。
一种精度可调倍频电路结构

[发明专利]用于探地雷达的100GHz等效采样电路及阵列探地雷达组合方法-CN201911239592.1有效
发明人：韩怀鹏;李琳;许振丰;王长璟 -专利权人：北京华航无线电测量研究所
申请日： 2019-12-06 - 公布日： 2022-07-08 - 主分类号： H03K5/00 文献下载
摘要：本发明公开了一种用于探地雷达的100GHz等效采样电路，包括ARM主控通信模块；FPGA时序控制模块；10ps步进延时模块；100MSPS高速ADC采样模块。上位机发送采集参数配置到ARM主控通信模块，ARM主控通信模块根据采集参数控制FPGA时序控制模块完成时序配置，FPGA时序控制模块的差分时钟信号通过延时模块连接到ADC采样模块的采样时钟接口，通过调整延时模块的延时时间实现100GHz的等效采样，通过配置FPGA时序控制模块的时钟信号数量，实现采样窗口的调整。本发明解决了传统探地雷达采样时窗不易调节的问题，提高了等效采样率和探测深度。本发明通过时钟输入输出信号线即可组成阵列探地雷达，提高了单通道探地雷达的运用范围。
用于雷达 100 ghz 等效采样电路阵列组合方法

[发明专利]一种使能信号产生方法及电路-CN201810815991.7有效
发明人：王科迪;陈雷;杨铭谦;祁逸;周雷;付勇;孙雷;肖阳;王媛媛;于晓华 -专利权人：北京时代民芯科技有限公司;北京微电子技术研究所
申请日： 2018-07-24 - 公布日： 2022-06-28 - 主分类号： H03K5/00 文献下载
摘要：一种使能信号产生方法及电路，电路主要包括初始化电路、使能信号输出电路、检测码产生电路。本发明通过接收延时链延时单元控制信号，对延时单元控制信号的数值进行检测，产生延时单元使能信号，对含使能控制端的可调延时链进行分组控制。本发明采用使能信号分组控制方案和使能信号预开启控制方案对延时单元进行使能控制，减少了使能信号产生电路中的硬件资源，提高了使能信号响应速度，使设计人员可以根据延时链级数和设计需求自由选择延时单元使能信号的控制方案。
一种信号产生方法电路

[发明专利]一种基于SAW传感器的延时电路-CN202210326469.9在审
发明人：马培元;王金磊;练赛;王宁;雷绍充 -专利权人：西安交通大学
申请日： 2022-03-30 - 公布日： 2022-06-14 - 主分类号： H03K5/00 文献下载
摘要：本发明公开了一种基于SAW传感器的延时电路，包括：反相器组包括末端反相器组、中间反相器组和顶端反相器组；中间反相器组的数量为若干个；顶端反相器组的输入端连接信号发生器，顶端反相器组的输出端连接中间反相器组的输入端和多路选择器的数据输入端；中间反相器组的输出端连接多路选择器的数据输入端和末端反相器组的输入端；末端反相器组的输出端连接多路选择器的数据输入端；上位机连接多路选择器的数据选择端。本发明具有电路结构简单，占用逻辑资源少、复制性和灵敏度高的优点，同时对施加小信号的器件，具有易于测量、捕捉峰值，可以提高实验结果准确度。
一种基于 saw 传感器延时电路

[发明专利]一种可配置延迟电路-CN202010667700.1有效
发明人：李建军;谢宇;陈诚;杜涛;李威 -专利权人：电子科技大学
申请日： 2020-07-13 - 公布日： 2022-06-14 - 主分类号： H03K5/00 文献下载
摘要：本发明属于集成电路技术领域，提出了一种可配置延迟电路。一种可配置延迟单元，可包含：带使能端的配置电路1；可包含带使能端的配置电路2的延迟元件；可选择性地包含脉冲整形电路。一种包含有可配置延迟单元的可配置延迟模块，可包含：至少一个可配置延迟单元；可选择性地包含一个或若干不可配置延迟单元。一种包含有可配置延迟模块的延迟电路，可包含：至少一个可配置延迟模块；可选择性地包含p‑q译码模块；至少一个输出端口；可选择性地包含数据选择模块，数据选择模块有m+1个输入端口，n个输出端口；可选择性地包含若干个脉冲整形电路。
一种配置延迟电路

[发明专利]延迟电路-CN202011383371.4在审
发明人：不公告发明人 -专利权人：上海寒武纪信息科技有限公司
申请日： 2020-11-30 - 公布日： 2022-06-03 - 主分类号： H03K5/00 文献下载
摘要：本公开涉及一种延迟电路，包括第一缓冲器、第二缓冲器、绕线及选择器。第一缓冲器用以缓冲输入信号，以产生所述第一中间信号。第二缓冲器，用以缓冲所述输入信号，以产生所述第二中间信号。绕线用以延迟第一中间信号，以产生延迟信号。选择器用以选择所述延迟信号或所述第二中间信号为输出信号。本公开通过调整绕线长度，可以实现高精度时序延迟。
延迟电路

[发明专利]一种基于数据控制的脉冲移相电路-CN201811000602.1有效
发明人：田新凯;程志勇;潘成章 -专利权人：广州金升阳科技有限公司
申请日： 2018-08-30 - 公布日： 2022-05-20 - 主分类号： H03K5/00 文献下载
摘要：本发明提供一种基于数据控制的脉冲移相电路，通过两个控制电路，分别产生分别产生死区可调、占空比小于50％互补脉冲信号，并且第二控制电路产生的互补脉冲信号，在第一计数器的控制下与第一控制电路产生的互补脉冲信号产生相移。本发明对可编程数字芯片(ARM)的输出信号进行调制，省去了CPLD和FPGA芯片，只需ARM芯片+该发明的调制电路即可实现，可以满足控制移相全桥拓扑等大功率拓扑。
一种基于数据控制脉冲电路