专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]数据处理装置以及相关产品-CN202010390294.9有效
  • 请求不公布姓名 - 安徽寒武纪信息科技有限公司
  • 2020-05-08 - 2023-10-13 - G06F9/312
  • 本公开涉及一种数据处理装置以及相关产品。所述产品包括控制模块,所述控制模块包括:指令缓存单元、指令处理单元和存储队列单元;所述指令缓存单元,用于存储所述人工神经网络运算关联的计算指令;所述指令处理单元,用于对所述计算指令解析得到多个运算指令;所述存储队列单元,用于存储指令队列,该指令队列包括:按该队列的前后顺序待执行的多个运算指令或计算指令。通过以上装置,本公开可以提高相关产品在进行神经网络模型的运算时的运算效率。
  • 数据处理装置以及相关产品
  • [发明专利]数据处理装置以及相关产品-CN202010382526.6有效
  • 请求不公布姓名 - 安徽寒武纪信息科技有限公司
  • 2020-05-08 - 2023-10-03 - G06F9/312
  • 本公开涉及一种数据处理装置以及相关产品。所述产品包括控制模块,所述控制模块包括:指令缓存单元、指令处理单元和存储队列单元;所述指令缓存单元,用于存储所述人工神经网络运算关联的计算指令;所述指令处理单元,用于对所述计算指令解析得到多个运算指令;所述存储队列单元,用于存储指令队列,该指令队列包括:按该队列的前后顺序待执行的多个运算指令或计算指令。通过以上装置,本公开可以提高相关产品在进行神经网络模型的运算时的运算效率。
  • 数据处理装置以及相关产品
  • [发明专利]向队列存储数据的方法、装置及设备-CN201580002944.5有效
  • 罗庆超 - 华为技术有限公司
  • 2015-11-27 - 2023-09-22 - G06F9/312
  • 本发明公开了向队列存储数据的方法、装置及设备,属于数据存储领域。所述方法包括:接收入队请求消息,所述入队请求消息包括待入队的数据;根据队列的队列标识和第一数据的入队序号,确定所述待入队的数据的Key名,所述第一数据是当前位于所述队列的队尾的数据;将所述Key名从所述队列的队尾入队,以及将包括所述Key名和所述待入队的数据的键值KV对存储在KV存储系统中。所述装置包括接收模块、确定模块和存储模块。本发明队列中存储由队列标识和入队序号所确定的Key名,使得队列元素整齐有序,便于队列的恢复;基于KV对存储数据,数据不必按最小粒度对齐存储,节约存储空间;通过键值对KV存储系统存储数据,掉电不丢数据。
  • 队列存储数据方法装置设备
  • [发明专利]一种CPU中优化寄存器访问的方法-CN201910710720.X有效
  • 李晓辉;胡胜发 - 广州安凯微电子股份有限公司
  • 2019-08-01 - 2023-07-07 - G06F9/312
  • 本发明公开了一种CPU中优化寄存器访问的方法,包括:根据预设的映射策略将数据寄存器和内存栈建立映射关系;根据所述数据寄存器和内存栈的映射关系,将栈存取操作指令进行精简,并根据精简后的操作指令进行数据访问操作。在建立数据寄存器与内存栈的映射关系后,可假定所有的临时变量都在栈上,系统直接访问寄存器即可访问内存栈上这些变量。通过实施本发明,能够在大幅增加数据寄存器的同时,精简了大量的栈存取代码,从而有效降低了编译的复杂度与难度,有效提升了CPU性能。
  • 一种cpu优化寄存器访问方法
  • [发明专利]用于实现通过有界能力寻址的非冗余元数据存储装置的电路和方法-CN202211653105.8在审
  • M·勒梅 - 英特尔公司
  • 2022-12-20 - 2023-06-23 - G06F9/312
  • 描述了用于实现通过有界能力寻址的非冗余元数据存储装置的系统、方法和装置。在某些示例中,硬件处理器核心包括执行电路和能力管理电路,该执行电路用于:生成通过第一能力对存储器中的第一单个对象的第一存储器访问请求、以及通过第二能力对存储器中的不同大小的第二单个对象的第二存储器访问请求,其中第一能力和第二能力中的每一者的格式包括单个元数据字段、边界字段和地址字段;该能力管理电路用于:确定对应的第一元数据字段在存储器中的第一位置,继续进行第一存储器访问请求,确定对应的第二元数据字段在存储器中的第二位置,以及继续进行第二存储器访问请求。
  • 用于实现通过能力寻址冗余数据存储装置电路方法
  • [发明专利]一种支持乱序处理器数据预取的缓存访问系统-CN202210828128.1在审
  • 韩军;刘旭东 - 复旦大学
  • 2022-07-14 - 2022-11-08 - G06F9/312
  • 本发明属于集成电路设计技术领域,具体为一种支持乱序处理器数据预取的缓存访问系统。本发明系统具体包括:LOAD访存信息追踪排序模块、LOAD访存地址历史缓冲器、预取器和目标预取地址缓冲器。LOAD访存信息追踪排序模块将乱序LOAD访存信息变为顺序LOAD访存信息,再输入预取器;预取器利用顺序的访存信息实现更准确的训练和目标预取地址预测,预取器输出的有效目标预取地址存储在目标预取地址缓冲器中等待后续发送,目标预取地址缓冲器实时更新以失效不及时地址,以避免发送无用的预取地址。本发明可提高访存规律的学习效率和地址预测的准确率,减少预取请求对缓存系统的资源占用。
  • 一种支持处理器数据缓存访问系统
  • [发明专利]一种系统寄存器访问指令的执行方法、装置及电子设备-CN202210683046.2有效
  • 游柏青;高军;苑佳红;袁媛;曹华嘉 - 飞腾信息技术有限公司
  • 2022-06-17 - 2022-09-23 - G06F9/312
  • 本申请公开了一种系统寄存器访问指令的执行方法、装置及电子设备,该方法包括:从指令缓存中取出系统寄存器访问指令;确定系统寄存器访问指令对应的执行部件,执行部件包括多个执行单元,多个执行单元间使用频率或使用时间不同,多个执行单元共享同一发射队列和结果总线;将系统寄存器访问指令分派至与执行部件对应的发射队列;将发射队列中的系统寄存器访问指令发射至对应的执行单元;执行系统寄存器访问指令,得到执行结果。本申请实施例中,可以不用单独设置一个执行部件来处理系统寄存器访问指令,可以减少微处理器中通用寄存器文件的访问端口,减少一个发射队列的资源,在对性能影响很小的情况下,达到降低微处理的体积和功耗的目的。
  • 一种系统寄存器访问指令执行方法装置电子设备
  • [发明专利]神经网络处理器、片上系统及电子设备-CN201911414951.2有效
  • 张建中 - OPPO广东移动通信有限公司
  • 2019-12-31 - 2022-05-17 - G06F9/312
  • 本申请实施例提供一种神经网络处理器、片上系统及电子设备,该神经网络处理器包括处理模块和加载存储模块,处理模块被配置为根据获取到的预设指令确定所要传输的数据的字节个数,并根据所要传输的数据的字节个数计算出目标地址;加载存储模块与所述处理模块连接,所述加载存储模块被配置为根据所述目标地址搬移数据。本申请实施例提供的神经网络处理器可以根据所要传输的数据的字节个数计算出目标地址,针对不同数量的字节个数可以计算出目标地址,使得数据传输过程更加灵活。
  • 神经网络处理器系统电子设备
  • [发明专利]计算机系统及内存访问技术-CN201680090723.2有效
  • 方磊;陈溪;蔡卫光 - 华为技术有限公司
  • 2016-12-12 - 2022-05-13 - G06F9/312
  • 一种计算机系统及内存访问技术。在本申请提供的计算机系统中,在处理具有依赖关系的访存指令时,能够在处理器中获取生产者访存指令和消费者访存指令之间的依赖信息,并根据获取的依赖信息向计算机系统中的内存控制器发送消费者访存请求,从而内存控制器能够根据接收的消费者访存请求中的依赖信息在内存控制器本地解决访存请求之间的依赖关系,并执行消费者访存请求。本申请提供的计算机系统及内存访问技术能够减少内存控制器和处理器核之间的通信次数,缩短内存访问延时,提高内存访问效率。
  • 计算机系统内存访问技术

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