[发明专利]存算芯片内的加权融合变换部件、存算电路及协同计算方法在审
申请号: | 202310104821.9 | 申请日: | 2023-01-19 |
公开(公告)号: | CN116414456A | 公开(公告)日: | 2023-07-11 |
发明(设计)人: | 严洪泽;邢小地;孙旭光 | 申请(专利权)人: | 杭州知存智能科技有限公司 |
主分类号: | G06F9/30 | 分类号: | G06F9/30;G06F7/501;G06F7/523;G06N3/048;G06N3/063 |
代理公司: | 北京三友知识产权代理有限公司 11127 | 代理人: | 王涛 |
地址: | 311121 浙江省杭州市余杭*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 芯片 加权 融合 变换 部件 电路 协同 计算方法 | ||
1.一种存算芯片内的加权融合变换部件,其特征在于,包括:
第一加法器,与存算阵列和查表寄存器连接,用于根据所述存算阵列的存算输出值以及所述查表寄存器的地址值得到索引地址,所述存算输出值为存算阵列实现像素级卷积计算获得的定点数据;
激活函数查表模块,与所述第一加法器连接,用于根据所述索引地址以及预设的查表映射表确定对应的权重值,所述权重值为预设的所述存算输出值对应的映射定点数据;
第一乘法器,与所述激活函数查表模块连接,用于根据定点化的第一图像数据以及所述权重值按位取反后的值得到第一乘积;
第二乘法器,与所述激活函数查表模块连接,用于根据定点化的第二图像数据以及所述权重值得到第二乘积;
第二加法器,与所述第一乘法器和所述第二乘法器连接,用于计算所述第一乘积与所述第二乘积的和值;
移位寄存器,与所述第二加法器连接,用于对所述和值进行移位操作,得到所述第一图像数据与所述第二图像数据对应的加权融合结果。
2.一种存算芯片内的平方加权融合变换部件,其特征在于,包括:
第一加法器,与存算阵列和查表寄存器连接,用于根据所述存算阵列的存算输出值以及所述查表寄存器的地址值得到索引地址,所述存算输出值为存算阵列实现像素级卷积计算获得的定点数据;
激活函数查表模块,与所述第一加法器连接,用于根据所述索引地址以及预设的查表映射表确定对应的权重值,所述权重值为预设的所述存算输出值对应的映射定点数据;
第一乘法器,与所述激活函数查表模块连接,用于根据定点化的第一图像数据以及所述权重值按位取反后的值得到第一乘积;
第二乘法器,与所述激活函数查表模块连接,用于根据定点化的第二图像数据以及所述权重值得到第二乘积;
第三乘法器,与所述第一乘法器连接,用于根据所述第一乘积以及所述权重值按位取反后的值得到第三乘积;
第四乘法器,与所述第二乘法器连接,用于根据所述第二乘积以及所述权重值得到第四乘积;
第二加法器,与所述第三乘法器和所述第四乘法器连接,用于计算所述第三乘积与所述第四乘积的和值;
移位寄存器,与所述第二加法器连接,用于对所述和值进行移位操作,得到所述第一图像数据与所述第二图像数据对应的平方加权融合结果。
3.一种存算电路,其特征在于,包括:
高速缓存单元,用于缓存第一帧图像的一行或多行数据和第二帧图像的一行或多行数据;
预处理模块,与所述高速缓存单元连接,用于对所述第一帧图像和所述第二帧图像分别进行预处理,得到第一帧图像对应的第一像素重排结果、第一平均池化结果和第一噪声水平分量,第二帧图像对应的第二像素重排结果、第二平均池化结果和第二噪声水平分量,所述第一平均池化结果和所述第二平均池化结果差的绝对值,以及所述差的绝对值与所述第二噪声水平分量的拼接结果;
存算阵列,与所述预处理模块连接,用于将所述差的绝对值以及所述第二噪声水平分量的拼接结果与预设的卷积函数进行卷积运算,得到存算输出值;
权利要求1所述的存算芯片内的加权融合变换部件,与所述预处理模块以及所述存算阵列连接,用于根据所述第一像素重排结果、第二像素重排结果以及所述存算输出值得到所述第一帧图像与所述第二帧图像对应的加权融合结果;
权利要求2所述的存算芯片内的平方加权融合变换部件,与所述预处理模块以及所述存算阵列连接,用于根据所述第一噪声水平分量、第二噪声水平分量以及所述存算输出值得到所述第一帧图像与所述第二帧图像对应的噪声水平分量平方加权融合结果。
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